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ST公布導(dǎo)入經(jīng)認(rèn)證的設(shè)計流程,加快下一代半導(dǎo)體開發(fā)過程

  • 　　微電子半導(dǎo)體解決方案全球領(lǐng)先廠商意法半導(dǎo)體（紐約證券交易所代碼：STM）宣布，采用經(jīng)權(quán)威機(jī)構(gòu)認(rèn)證的電子系統(tǒng)級（ESL）系統(tǒng)芯片參考設(shè)計流程。 　　在十多個采用新設(shè)計流程開發(fā)的專用集成電路（ASIC）成功定案后，顯示新設(shè)計流程較傳統(tǒng)方法提高生產(chǎn)率四到十倍，已經(jīng)在ST內(nèi)部推廣應(yīng)用，。此外，市場對整合數(shù)字信號和射頻/混合信號技術(shù)的完整系統(tǒng)級平臺的需求日益增長，ST的解決方案還能滿足消費(fèi)電子市場領(lǐng)先廠商的設(shè)計需求。ST的很多尖端產(chǎn)品都已利用這個參考設(shè)計流程開發(fā)，如200萬像素YUV CMOS 圖像傳感器和高
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量產(chǎn)應(yīng)用的高功效定制

  • 　　編者按：可配置處理器正在通過它的靈活性為系統(tǒng)架構(gòu)是和開發(fā)人員減輕設(shè)計負(fù)擔(dān)。以便攜式產(chǎn)品為例，產(chǎn)品功能日益復(fù)雜 上市時間要求越來越短，設(shè)計預(yù)算也在縮減，應(yīng)對這些設(shè)計挑戰(zhàn)的關(guān)鍵是在一個通用平臺上開發(fā)新產(chǎn)品，這一平臺要足夠靈活以實現(xiàn)定制化和優(yōu)化功能。而在機(jī)器視覺領(lǐng)域，實時深度感知目前是通過立體圖像來計算深度的，算法的計算量很大。而采用FPGA的解決方案能使處理器的時間得到緩解，減少器件的成本，例如MPU、DSP、激光器和鏡頭等。通過提供給機(jī)器人其環(huán)境中的差異測繪，F(xiàn)PGA使機(jī)器人中的CPU專注于重要的高層任
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核心硅片市場大者恒大

  • 　　全球核心硅片市場2007年強(qiáng)勁增長, 從2006年的929.7億美元增長至991億美元，增長率為6.6%。核心硅片是半導(dǎo)體市場中最大的單一領(lǐng)域，占總體營業(yè)收入的36%以上，該市場由ASIC、可編程邏輯器件(PLD)和專用標(biāo)準(zhǔn)產(chǎn)品(ASSP)構(gòu)成。iSuppli公司認(rèn)為，只有市場中的領(lǐng)先廠商受益最多，它們的市場份額繼續(xù)上升，擠占規(guī)模較小廠商的份額。 　　按總體核心硅片營業(yè)收入排名，第一位仍然是德州儀器，2007年銷售額為74億美元，不過比2006年下降了4.1%。英特爾繼續(xù)位居第二，高通和索尼分別
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傳感器/ASIC集成縮小電流變送器體積

  • 　　電力電子的發(fā)展趨勢與其他電子領(lǐng)域的發(fā)展趨勢沒有什么不同——更大規(guī)模集成加降低元件數(shù)量。但是，由于電力電子系統(tǒng)中存在散熱器、磁性元件與線圈等元件，使高水平集成更加困難。微機(jī)電系統(tǒng)（MEMS）已在檢測系統(tǒng)得到應(yīng)用，并可能應(yīng)用于系統(tǒng)的其他部分。 　　傳統(tǒng)的電流變送器不適合于家電產(chǎn)品和空調(diào)系統(tǒng)市場，因為它們體積太大、價格高昂。而一種成本較低、體積較小的變送器則使得測量這些系統(tǒng)的電流成為可能，唯一受到的限制是漏電、間隙和絕緣等級等外界因素。 　　用于LEM自己的LTS電流變送器的應(yīng)用
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嵌入式系統(tǒng)中IP協(xié)議用ASIC器件電路設(shè)計

  • 設(shè)計并實現(xiàn)一個能完成IP協(xié)議功能的ASIC器件；討論器件的穩(wěn)定工作條件。任何數(shù)字化的工業(yè)設(shè)備都可以使用個IP協(xié)議器件直接連接到基于IP的網(wǎng)絡(luò)中。
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Altera發(fā)布業(yè)界首款40-nm FPGA和HardCopy ASIC

  • ? 　為幫助設(shè)計人員提高集成度，進(jìn)一步創(chuàng)新，Altera公司今天發(fā)布了業(yè)界的首款40-nm FPGA和HardCopy? ASIC。Stratix? IV FPGA和HardCopy IV ASIC都提供收發(fā)器，在密度、性能和低功耗上遙遙領(lǐng)先。Stratix IV系列有680K邏輯單元(LE)，比Altera的Stratix III系列高2倍，是目前市場上密度最大的FPGA。HardCopy IV ASIC系列在密度上和Stratix IV器件等價，具有1330萬邏輯門。Alte
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多媒體處理器DM642及其在視頻監(jiān)控中的應(yīng)用

  • 　　引　言 　　視頻監(jiān)控系統(tǒng)的設(shè)計方案有很多種，但是市場產(chǎn)品的主流一般選擇兩種方案：一是基于CPU和專用的視頻編解碼ASIC芯片。該方案選擇以ARM為核心的CPU和專用媒體處理芯片搭建。優(yōu)點是開發(fā)時間相對較短，但由于采用ASIC，靈活性較差，產(chǎn)品一旦定型，很難更改。二是采用面向媒體處理的專用DSP。其開發(fā)時間不長，優(yōu)點是由于算法是軟件代碼，所以可以不斷對產(chǎn)品性能進(jìn)行升級，重復(fù)開發(fā)成本較低。由全球最大的DSP制造商德州儀器（TI）推出的TMS320DM642（以下簡稱DM642）作為一款高性價比、專用于多
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FPGA競爭好像在演戲（上）

  • 　　若要問：半導(dǎo)體業(yè)哪個領(lǐng)域最有趣？我認(rèn)為FPGA。作為記者，大家一提起FPGA公司就很興奮，太充滿活力了，有時過分得充滿戲劇性。 　　當(dāng)中國第一高樓——上海金茂大廈剛剛落成時，A公司在上海成立辦事處，邀請記者從北京到上海觀摩，下榻金茂。一周后，X公司也宣布已經(jīng)成立上海辦事處，也盛情邀請記者去那里看看，也同樣入住金茂。 ????????????&nbs
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FPGA挑戰(zhàn)特殊應(yīng)用，將吞食更多市場

  •         根據(jù)牧本定律（Makimoto’s Wave）,從2007年開始的10年,進(jìn)入了在可編程性基礎(chǔ)上的客戶定制產(chǎn)品流行時代。專做標(biāo)準(zhǔn)產(chǎn)品的FPGA也在悄然分化，更加面向特定的應(yīng)用。                    
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基于軟件的GPS接收機(jī)本地系統(tǒng)

  • 　　0引言 　　對于一個普通的GPS(全球定位系統(tǒng))接收機(jī)來說，其對信號的捕獲和追蹤均由硬件進(jìn)行處理，主要是用ASIC(專用集成電路)實現(xiàn)。用ASIC的主要好處之一是它的有效性，能夠?qū)PS信號進(jìn)行有效處理，但它的造價較高，而目前GPS技術(shù)還在高速發(fā)展，各種算法還在不斷研究，如果都用ASIC來實現(xiàn)，顯然并不現(xiàn)實。而使用軟件來模擬搭建GPS的接收系統(tǒng)，不但可以方便地對現(xiàn)有的一些算法進(jìn)行比較，而且也能快速地應(yīng)用到實際中。在該系統(tǒng)中，用A／D轉(zhuǎn)換器將輸入的模擬信號數(shù)字化，然后交由軟件接收機(jī)處理，由此重構(gòu)的系統(tǒng)
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Catalyst新型5通道電壓監(jiān)控器降低系統(tǒng)成本節(jié)約板基空間

  • 　　Catalyst半導(dǎo)體繼續(xù)快速擴(kuò)展電壓監(jiān)控產(chǎn)品線，為微處理器、微控制器，ASIC器件和其它系統(tǒng)處理器的應(yīng)用新增一款高精度超低功耗5通道監(jiān)控器件。5通道電壓監(jiān)控被整合于一個小尺寸的8引腳MSOP封裝之內(nèi)，CAT885能有效降低系統(tǒng)成本、節(jié)約電路板空間。 　　CAT885具備低有效漏極開路輸出及手動復(fù)位輸入的特點，可針對各種電子產(chǎn)品完成系統(tǒng)復(fù)位和監(jiān)控功能。CAT885可以監(jiān)控多達(dá)5通道的系統(tǒng)電壓，若所有被監(jiān)控的電源電壓已經(jīng)超過額定電平值，并且隨后被啟動的器件內(nèi)部計時器超時溢出后，有效的復(fù)位輸出才會終止，
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采用DSP、PLD和ASIC實現(xiàn)多速濾波器設(shè)計的比較

  • 許多通信系統(tǒng)都要用到多速濾波器(multirate filter)，多速濾波器是指輸出數(shù)據(jù)速率與輸入數(shù)據(jù)速率不相等的濾波器，常用于某個物理接口如數(shù)模轉(zhuǎn)換器(DAC)或模數(shù)轉(zhuǎn)換器(ADC)的接口處。
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VERISILICON加盟“功耗前鋒倡議”加速高級低功耗設(shè)計

  • 　　世界級ASIC設(shè)計晶圓廠及定制解決方案供應(yīng)商VeriSilicon Holdings Co., Ltd.（VeriSilicon）“已經(jīng)加盟功耗前鋒倡議”（ Power Forward Initiative，PFI），計劃為其ASIC客戶提供基于通用功率格式（Common Power Format，CPF）的設(shè)計解決方案。 　　VeriSilicon采用Cadence低功耗解決方案，是業(yè)界領(lǐng)先的完整的設(shè)計流程，以Si2標(biāo)準(zhǔn)的CPF為基礎(chǔ)，貫穿邏輯設(shè)計、驗證、實現(xiàn)等技術(shù)。這種針
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加速ASIC/SoC原型設(shè)計的軟件技術(shù)

  • ASIC和SoC器件成本的逐步上升迫使半導(dǎo)體供應(yīng)商必須進(jìn)一步開拓各個器件的市場以尋求滿意的投資回報。日益增長的軟件使用為此提供了有效的機(jī)制，因為增加的軟件內(nèi)容等同于更多的功能和軟件變化提供了特定市場產(chǎn)品的差異化。
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以高性能匯聚平臺 迎接視頻監(jiān)控新挑戰(zhàn)

  • 　　隨著人們對安全需求的日益重視和性能的不斷增強(qiáng)、價格的迅速降低，應(yīng)用市場正快速膨脹。但是不管是定位于中小企業(yè)、中小網(wǎng)絡(luò)的DVR解決方案，還是定位在高端、企業(yè)級用戶的DVS，以及廣被業(yè)界看好的IP攝像機(jī)，都對方案提供商提出了更高的要求（更多挑戰(zhàn)）：更高的視頻信號分辨率和壓縮比；更靈活的媒體格式支持；更安全的內(nèi)容保護(hù)；更低的功耗、成本和開發(fā)復(fù)雜度。 　　在視頻監(jiān)控應(yīng)用領(lǐng)域主要包括媒體處理器、DSC、ASIC、以及FPGA等幾種方案。其中DSC雖然具有部分DSP的功能，但是從總體來講，DSC和媒體處理器一樣
  • 關(guān)鍵字： 視頻監(jiān)控  DVS  DSC  ASIC  
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