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寬帶低相噪高分辨率頻率合成器設計

作者: 時間:2012-06-27 來源:網(wǎng)絡 收藏

主線圈驅動電路如圖2所示,這部分電路是在鎖相環(huán)路之外,有助于實現(xiàn)的快速鎖定,為精確調(diào)諧YTO主線圈,這里選用的是ADI公司的AD7528雙8位DAC(D4),直接接受FPGA的并口數(shù)據(jù)控制(PRED0~PRED7),實現(xiàn)16位預置數(shù)送數(shù)的目的。AA0為低時送高8位預置數(shù),AA0高為時送低8位預置數(shù),運放TL072ACD完成了ADC的輸出電流到電壓的轉換。經(jīng)由R101、R102、R103和D6,其中R102=256R101組成的加法電路將兩路電壓相加。D/A送數(shù)改變MOS管IRF9520的G極、S極電壓值,VGS電壓差隨著DA預置數(shù)增大而增大,VGS增大使D極電流ID變大,
MOS管IRF9520的D極直接與YT0主線圈相連,從而改變了流經(jīng)YTO主線圈的電流值,達到調(diào)諧的目的。

本文引用地址:http://butianyuan.cn/article/176843.htm

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副線圈驅動電路如圖3所示,為得到調(diào)頻端合適的驅動電流和適應調(diào)頻端的電流正、負偏,了一種驅動電路如圖3所示。正的相位誤差電壓經(jīng)帶偏移的差分放大電路轉變成正或負的電壓,D22的3腳從變阻器R206的2腳獲得相應的正或負的電壓。文中使用的YTO調(diào)頻端的調(diào)諧 靈敏度是300 kHz/mA,通過調(diào)節(jié)變阻器R206的2腳位置將環(huán)路捕捉帶寬設定約為30 MHz。利用運算放大器D22兩個電壓輸入腳的等電位特性來獲得YTO調(diào)頻線圈的驅動電流。當D22的3腳輸入電壓為正時,V23導通,電流從YTO的FM+端到FM-端。反之,當D22的3腳輸入電壓為負時,V24導通,電流從YTO的FM-端到FM+端。
2.2 小數(shù)分頻電路設計
直接數(shù)字合成(DDS)作為新一代合成技術,具有輸出頻率高、頻率切換速度快、相位變化連續(xù)以及數(shù)字可控等優(yōu)點。采用小數(shù)分頻在不降低鑒相頻率的前提下,可以提高頻率。本方案利用DDS芯片AD9858實現(xiàn)小數(shù)分頻。AD9858內(nèi)部集成有10位數(shù)模轉換器,其頻率為32位。根據(jù)公式
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式中,F(xiàn)TW表示DDS頻率控制字;F0表示DDS輸出頻率;N表示DDS頻率控制字的位長;SYSCLK表示DDS參考時鐘;YTO振蕩器輸出3~7 GHz的頻率經(jīng)8分頻為375~875 MHz作為AD9858的參考時鐘。方案要求AD9858輸出頻率F0始終為100 MHz,根據(jù)式(2)可以計算出頻率控制字FTW,由FPGA通過并行送給AD9858。由AD9858分頻輸出100MHz頻率經(jīng)低通濾波器后與100 MHz參考頻率fr進行鑒相。根據(jù)式(1)可以計算出頻率分辨率為0.09~0.2Hz。
2.3 環(huán)路濾波器設計
在鎖相環(huán)路中,環(huán)路濾波器起著至關重要的作用,它將誤差電流分量轉化為誤差電壓分量,濾除誤差電壓中的高頻分量和噪聲,以保證環(huán)路所需要的性能,增加環(huán)路穩(wěn)定性。在鎖相環(huán)電路設計中,為達到優(yōu)異的相位噪聲,人們往往采用無源環(huán)路濾波器完成設計,設計時需要重點考慮帶寬,相位裕度,濾波器結構、階數(shù)、極點等參數(shù)。在本方案中由于相位誤差電壓在0~5 V之間,故選擇無源濾波器,利用PLL DesignSimulation V4.0仿真軟件設計出環(huán)路帶寬200 kHz,相位裕度45°,阻尼系數(shù)0.707的二階無源濾波器如圖4所示。經(jīng)實際調(diào)試后R1=2 kΩ,R2=39.2 Ω,C1=0.1μF,C2=11 nF。

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