CPLD在DSP系統(tǒng)中的應(yīng)用設(shè)計
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當系統(tǒng)出現(xiàn)錯誤時，可以采用手工方式復(fù)位。
復(fù)位信號產(chǎn)生原理圖如圖2所示。其中，RST#為整個系統(tǒng)的復(fù)位信號，由MAX7000輸出。PBSW_RST#為手動復(fù)位信號，由按鍵接入MAX7000,經(jīng)MAX7000去抖動后輸出給TPS3307。SVS_RST#為電源管理芯片TPS3307產(chǎn)生的復(fù)位信號（包括手動復(fù)位和電源監(jiān)控功能）。本文引用地址：http://butianyuan.cn/article/191213.htm
1.2.2 BOOT模式的實現(xiàn)
系統(tǒng)復(fù)位后，DSP需要進行BOOT自舉。在復(fù)位信號為低期間，BOOTMODE[4:0]管腳上的設(shè)置值被鎖存，決定芯片的存儲器映射方式以及自舉模式。但TMS320C6202沒有專門的管腳作為BOOTMODE[4:0]輸入管腳，而是將擴展總線的XD[4:0]映射為BOOTMODE[4:0],利用上拉/下拉電阻在復(fù)位時進行芯片啟動模式設(shè)置。總線上的其它位也在復(fù)位期間被鎖定，決定系統(tǒng)相應(yīng)的設(shè)定值。而擴展總線XD在HPI口讀寫時要用到，所以使用MAX7000進行隔離。系統(tǒng)處在復(fù)位階段，則通過MAX7000使得DSP的相應(yīng)管腳的值等于設(shè)定值，復(fù)位結(jié)束后，MAX7000相應(yīng)管腳為高阻態(tài)，使得XD可以作為正常的總線使用。
DSP自舉有特定的時間要求。在復(fù)位結(jié)束后，XD的配置管腳必須保持一段時間，TMS320C6202要求時間為5個時鐘周期，例如在200MHz時鐘情況下必須保持25ns。
1.2.3 HPI口接口邏輯實現(xiàn)
MPEG-4壓縮編碼器壓縮后的數(shù)據(jù)，通過網(wǎng)絡(luò)傳輸控制模塊傳輸?shù)骄W(wǎng)絡(luò)上去，從而實現(xiàn)網(wǎng)絡(luò)實時圖像傳輸。而DSP與網(wǎng)絡(luò)傳輸模塊（MCF5272）通過HPI口連接。其接口邏輯由CPLD完成。硬件連線圖如圖3所示。
根據(jù)系統(tǒng)的邏輯要求以及實際的仿真結(jié)果，CPLD選用EPM7128SLC84。該芯片共有2500門，128個宏單元，最多100個用戶自定義管腳。
2 CPLD邏輯控制的具體實現(xiàn)
2.1 復(fù)位信號的實現(xiàn)
復(fù)位信號邏輯產(chǎn)生較簡單，需要處理的是按鍵的去抖動。由于按鍵是機械觸點，當機械觸點斷開、閉合時會有抖動，為使每一次按鍵只作一次響應(yīng)，就必須考慮去除抖動。在通過按鍵獲得復(fù)位信號為低的信息時，不是立即認定按鍵已被按下，而是延時一段時間后再次檢測復(fù)位信號。如果仍為低，說明按鍵的確按下了，這實際上是避開了按鍵按下時的抖動時間。同樣，在檢測到按鍵釋放后，再延時幾個毫秒，消除后沿的抖動，然后再對鍵值處理。由于抖動現(xiàn)象主要出現(xiàn)在按鍵按下后，采用延時方法可有效地減少按鍵的抖動現(xiàn)象。
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