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低功耗概述及特性優(yōu)勢(shì)

低功耗概述及特性優(yōu)勢(shì),　　概述
　　由于功耗敏感應(yīng)用大幅增加，加上功率預(yù)算日益緊張，低的系統(tǒng)功耗已成為越來(lái)越多應(yīng)用的需要。當(dāng)今，F(xiàn)PGA技術(shù)更多地用于低功耗設(shè)備，這使得降低系統(tǒng)功耗成為日益重要的挑戰(zhàn)。近年來(lái)，F(xiàn)PGA因?yàn)椴捎昧四?/li>
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降低設(shè)備功耗的方法――精確測(cè)量

精確的功耗測(cè)量和持續(xù)監(jiān)視產(chǎn)生的數(shù)據(jù)可以提交給本地?cái)?shù)據(jù)和控制網(wǎng)絡(luò)。一旦數(shù)據(jù)到達(dá)網(wǎng)絡(luò)，許多種經(jīng)過(guò)最低程度折中的功率消耗改進(jìn)措施可以自動(dòng)給出。實(shí)際上，這樣的數(shù)據(jù)網(wǎng)絡(luò)可以指導(dǎo)我們改善生活方式.
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電池供電裝置的低功耗設(shè)計(jì)

　　從制造過(guò)程開(kāi)始，一直到所有的應(yīng)用領(lǐng)域，極低功耗技術(shù)逐漸成為所有設(shè)計(jì)中必不可少的需求。對(duì)能源敏感的應(yīng)用，特別是必須以單顆電池提供連續(xù)數(shù)小時(shí)運(yùn)作時(shí)間的產(chǎn)品，更需要加入超低功耗設(shè)計(jì)概念。要滿足這些要求，
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FPGA架構(gòu)的功耗(圖)

減少FPGA的功耗可帶來(lái)許多好處，如提高可靠性、降低冷卻成本、簡(jiǎn)化電源和供電方式、延長(zhǎng)便攜系統(tǒng)的電池壽命等。無(wú)損于性能的低功耗設(shè)計(jì)既需要有高功率效率的FPGA架構(gòu)，也需要有能駕馭架構(gòu)組件的良好設(shè)計(jì)規(guī)范。
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基于Freeze技術(shù)的低功耗設(shè)計(jì)

基于Freeze技術(shù)的低功耗設(shè)計(jì),由于更嚴(yán)格的功耗限制、規(guī)范和標(biāo)準(zhǔn)要求，系統(tǒng)設(shè)計(jì)師現(xiàn)在比什么時(shí)候都關(guān)注功耗問(wèn)題。對(duì)于下一代的設(shè)計(jì)，功耗預(yù)算通常得到穩(wěn)定的控制，或者降低，但卻增加了更多的特性和處理能力需求。通常，盡管產(chǎn)品特性和性能需求不
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基于絕熱邏輯的低功耗乘法器電路設(shè)計(jì)

基于絕熱開(kāi)關(guān)理論的能量回收邏輯與傳統(tǒng)的靜態(tài)CM0s邏輯相比，能夠大大減少電路的功率消耗。這里介紹了一種使用單相正弦電源時(shí)鐘的能量回收邏輯，分別用靜態(tài)CMOS邏輯和這種能量回收邏輯設(shè)計(jì)，并仿真了一個(gè)兩位乘法器電路，比較了這兩種電路的性能。研究表明，采用能量回收邏輯設(shè)計(jì)的乘法器顯著降低了電路的功率消耗。
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嵌入式低功耗射頻/紅外轉(zhuǎn)換控制器的研制

嵌入式低功耗射頻/紅外轉(zhuǎn)換控制器的研制,用超低功耗的微控制器 MSP430F1121設(shè)計(jì)一個(gè)嵌入式低功耗的射頻/紅外轉(zhuǎn)換控制器,該控制器完全由中斷事件驅(qū)動(dòng)，在等待用戶按鍵或未接收到無(wú)線遙控信號(hào)時(shí),系統(tǒng)功耗僅為0.1μA。該控制器能夠?qū)崿F(xiàn)紅外遙控信號(hào)的自學(xué)習(xí)及紅外-射頻信號(hào)的自動(dòng)轉(zhuǎn)換功能，完成對(duì)紅外遙控設(shè)備的控制,實(shí)驗(yàn)結(jié)果表明：該設(shè)計(jì)方案能夠有效地將無(wú)線遙控信號(hào)轉(zhuǎn)變?yōu)榧t外遙控信號(hào)，并進(jìn)行有效的控制。
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一種低溫漂低功耗的簡(jiǎn)易帶隙基準(zhǔn)電壓設(shè)計(jì)

電壓基準(zhǔn)在模擬電路中提供一個(gè)受電源或溫度等影響較小的參考電壓，以保證整個(gè)電路正常工作。設(shè)計(jì)了一種低溫漂低功耗帶隙基準(zhǔn)電壓源，采用不受電源影響的串聯(lián)電流鏡做偏置，利用PTAT電壓的正向溫度系數(shù)和基極發(fā)射極電壓的負(fù)向溫度系數(shù)特性，以適當(dāng)?shù)南禂?shù)加權(quán)構(gòu)造零溫度系數(shù)的電壓量。該設(shè)計(jì)避開(kāi)了運(yùn)放的應(yīng)用，結(jié)構(gòu)簡(jiǎn)易，原理清晰，便于入門級(jí)的同學(xué)在短時(shí)間內(nèi)學(xué)習(xí)掌握。0～70℃范圍內(nèi)，溫漂系數(shù)為16．4 ppm／℃。供電電壓在5～6 V范圍內(nèi)變化時(shí)，電源抑制比達(dá)57．7 dB?？傒敵鲈肼暈?40．3μV，功耗為300．6 μW。
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FPGA的功耗概念與低功耗設(shè)計(jì)研究

隨著半導(dǎo)體工藝的飛速發(fā)展和芯片工作頻率的提高，芯片的功耗迅速增加，而功耗增加又導(dǎo)致芯片發(fā)熱量的增大和可靠性的下降。因此，功耗已經(jīng)成為深亞微米集成電路設(shè)計(jì)中的一個(gè)重要考慮因素。本文圍繞FPGA功率損耗的組成和產(chǎn)生原理，從靜態(tài)功耗、動(dòng)態(tài)功耗兩大方面出發(fā)，分析了影響FPGA功率耗散的各種因素，并通過(guò)Actel產(chǎn)品中一款低功耗的FPGA進(jìn)一步進(jìn)行說(shuō)明。最后提出了在FPGA低功耗設(shè)計(jì)中的一些問(wèn)題。
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基于MSP430的無(wú)線傳感器低功耗設(shè)計(jì)

0 引言　　無(wú)線傳感器網(wǎng)絡(luò)是由多個(gè)帶有傳感器、數(shù)據(jù)處理單元和通信模塊的節(jié)點(diǎn)組織而成的網(wǎng)絡(luò)，因?yàn)樵谲娛隆⒐I(yè)、醫(yī)療、農(nóng)業(yè)等領(lǐng)域的巨大應(yīng)用前景而成為近年來(lái)的研究熱點(diǎn)。由于無(wú)線傳感器節(jié)點(diǎn)通常工作在人們難以觸及
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基于CS42L37設(shè)計(jì)的低功耗音頻CODEC技術(shù)

CS42L37是高度集成的低功耗音頻和電話CODEC,主要用于手持應(yīng)用如智能手機(jī)和超小型移動(dòng)計(jì)算機(jī). CS42L37具有靈活的時(shí)鐘架構(gòu),時(shí)鐘頻率有6, 12, 24, 13, 26, 19.2, 或38.4 MHz,具有立體聲ADC,支持雙路模擬或數(shù)字MIC,雙路M
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電流源輸出電路的功耗

電流源輸出電路具有線性的優(yōu)勢(shì)，通常在一些專門的總路線應(yīng)用中采用。當(dāng)驅(qū)動(dòng)一個(gè)長(zhǎng)的總線時(shí)，其電流輸出自然而然地相互疊加，與電壓源輸出中非線性方式的相互影響形成鮮明對(duì)比。由于這些電路被設(shè)計(jì)線性甲類放大器，驅(qū)
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TTL或CMOS集電極開(kāi)路輸出的功耗

用來(lái)計(jì)算TTL集電極開(kāi)路輸出電路靜態(tài)功耗的公式如下：其中：VT=上拉電阻的有效端接電壓
R=端接電阻的有效值
VHI=高電平輸出（通常等于VT）
VLO=低電平輸出
VEE=輸出晶體管的射極（或源極
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一種面向多媒體SOC的微狀態(tài)低功耗設(shè)計(jì)方法

本文針對(duì)移動(dòng)多媒體SOC設(shè)計(jì)中的功耗問(wèn)題，提出了一種系統(tǒng)級(jí)低功耗設(shè)計(jì)方法。該方法的核心是利用各種IP所提供的配置空間，將多媒體SOC系統(tǒng)細(xì)分為不同的微狀態(tài)。同時(shí)結(jié)合傳統(tǒng)的DVS以及DPM思想，利用反饋控制和負(fù)載預(yù)測(cè)相結(jié)合的方式，實(shí)時(shí)調(diào)整系統(tǒng)運(yùn)行過(guò)程中的微狀態(tài)，從而在保證多媒體服務(wù)質(zhì)量的基礎(chǔ)上，讓系統(tǒng)負(fù)載盡可能均勻分布于整個(gè)運(yùn)行期間，達(dá)到降低功耗的目的。
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基于ATmega128RFA1設(shè)計(jì)的低功耗ZigBee解決方案

Atmel公司的ATmega128RFA1是低功耗CMOS 8位MCU,采用AVR增強(qiáng)性RISC架構(gòu)和2.4GHz ISM頻段高數(shù)據(jù)速率收發(fā)器,吞吐量達(dá)1 MIPS per MHz .無(wú)線收發(fā)器的數(shù)據(jù)速率從250 kb/s到高達(dá)2 Mb/s,還提供幀處理,有杰出的接收靈敏度(-10
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