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FPGA重復配置和測試的實現(xiàn)

  • 從制造的角度來講,F(xiàn)PGA測試是指對FPGA器件內(nèi)部的邏輯塊、可編程互聯(lián)線、輸入輸出塊等資源的檢測。完整的FPGA測試包括兩步,一是配置FPGA、然后是測試FPGA,配置FPGA是指將FPGA通過將配置數(shù)據(jù)下載編程使其內(nèi)部的待測資源連接成一定的結(jié)構(gòu),在盡可能少的配置次數(shù)下保證FPGA內(nèi)部資源的測試覆蓋率,配置數(shù)據(jù)稱為TC,配置FPGA的這部分時間在整個測試流程占很大比例;測試FPGA則是指對待測FPGA施加設計好的測試激勵并回收激勵,測試激勵稱為TS。
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H.264中二進制化編碼器的FPGA實現(xiàn)

  • 在對H.264標準中二進制化部分研究和分析的基礎上,提出其FPGA電路結(jié)構(gòu),采用并行結(jié)構(gòu)及流水線方式設計電路。該結(jié)構(gòu)經(jīng)Spartan3 FPGA實現(xiàn),其吞吐量為每周期1 bit,最大時鐘頻率為100 MHz,能夠滿足H.264中第3級及其以上檔次實時視頻編碼的要求。
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目標設計平臺使基于FPGA的系統(tǒng)開發(fā)易如反掌

  • ISE設計套件11的全功能版本將作為Virtex-6 FPGA套件的一部分推出,器件支持僅限于Vitex-6 LX240T-FF1156。Spartan-6 FPGA 套件包括ISE設計套件11 WebPACK軟件。ISE設計套件作為獨立產(chǎn)品另外提供,可提供全面的器件支持,邏輯版本的起價為2995美元??蛻艨蓮馁愳`思網(wǎng)站免費下載 ISE設計套件11的全功能30天評估版本。
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快閃FPGA實現(xiàn)創(chuàng)新FPGA設計

  • 在FPGA領域,隨著全球市場“消費化”趨勢的日益明顯,人們對于低功率、小占位面積FPGA的需求不斷增加。此外,環(huán)保節(jié)能理念日漸深入人心,也使得更多的企業(yè)開始使用低功率組件,從而降低系統(tǒng)的能耗。產(chǎn)品上市時間的縮短、效率和可靠性的提高、開發(fā)成本的降低以及對設計靈活性的高要求,使得FPGA有了愈來愈廣闊的發(fā)展空間,也變得愈加重要。
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FPGA設計工具視點

  • 作為一個負責FPGA企業(yè)市場營銷團隊工作的人,我不得不說,由于在工藝技術(shù)方面的顯著成就以及硅芯片設計領域的獨創(chuàng)性,F(xiàn)PGA正不斷實現(xiàn)其支持片上系統(tǒng)設計的承諾。隨著每一代新產(chǎn)品的推出,F(xiàn)PGA在系統(tǒng)中具有越來來越多的功能,可作為協(xié)處理器、DSP 引擎以及通信平臺等,在某些應用領域甚至還可用作完整的片上系統(tǒng)。
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依托FPGA開發(fā)高性能網(wǎng)絡安全處理平臺

  • 通過FPGA來構(gòu)建一個低成本、高性能、開放架構(gòu)的數(shù)據(jù)平面引擎可以為網(wǎng)絡安全設備提供性能提高的動力。隨著互聯(lián)網(wǎng)技術(shù)的飛速發(fā)展,性能成為制約網(wǎng)絡處理的一大瓶頸問題。FPGA作為一種高速可編程器件,為網(wǎng)絡安全流量處理提供了一條低成本、高性能的解決之道。
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目標設計平臺使基于FPGA的系統(tǒng)開發(fā)易如反

  • 賽靈思公司在正式發(fā)布新一代旗艦產(chǎn)品高性能Virtex-6和低成本Spartan-6 FPGA時,首次提出了“目標設計平臺”的新概念。賽靈思目標設計平臺包含五個關(guān)鍵部分:Virtex-6和Spartan-6 FPGA器件、支持和集成業(yè)界成熟設計方法的設計環(huán)境、采用業(yè)界標準FPGA多層連接器的可擴展板和套件、提供接口的IP內(nèi)核和強大的參考設計。
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全面剖析SOPC

  • SOPC一詞主要是源自Altera, 其涵義是因為目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上價格下跌的推波助瀾之下, 以往ASIC產(chǎn)品才能具有的 SoC觀念, 也能移植到CPLD/FPGA上, 并且因為CPLD/FPGA的可編程(Programmable)能力, 使得CPLD/FPGA不僅能實現(xiàn)一個高復難度的系統(tǒng), 而且還能快速改變系統(tǒng)的特性. 類似的觀念也鑒于Xilinx的Platform FPGA.
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利用MATLAB增強MAX+PLUS II的仿真功能

  • 紹了一種利用工具軟件MATLAB強大的數(shù)學功能來增強ALTERA公司的可編程邏輯器件設計軟件MAX+PLUSII的仿真功能、提高設計品質(zhì)的方法,有較強的針對性。
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數(shù)字懸浮控制系統(tǒng)中的降噪方法及FPGA實現(xiàn)

  • 為抑制電磁噪聲對懸浮控制系統(tǒng)的影響,介紹了一種通過避開噪聲持續(xù)時間進行A/D采樣的方法,詳細討論了該方法的原理與實現(xiàn)。實踐表明,它能有效地防止噪聲引入控制系統(tǒng),提高系統(tǒng)的性能
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基于FPGA的線陣CCD驅(qū)動時序及模擬信號處理的設計

  • 基于FPGA設計的驅(qū)動電路是可再編程的,與傳統(tǒng)的方法相比,其優(yōu)點是集成度高、速度快、可靠性好。若要改變驅(qū)動電路的時序,增減某些功能,僅需要對器件重新編程即可,在不改變?nèi)魏斡布那闆r下,即可實現(xiàn)驅(qū)動電路的更新?lián)Q代。通過對TCDl50lD輸出圖像信號特征的簡要分析,分別闡述了內(nèi)、外2種除噪方法,并給出了相應的時序,再利用Quartus II 7.2軟件平臺對TCDl501D CCD驅(qū)動時序及AD9826的采樣時序進行了設計及結(jié)果仿真,使CCD的驅(qū)動變得簡單且易于處理,這是傳統(tǒng)邏輯電路無法比擬的,對其他CCD時
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用FPGA在數(shù)字電視系統(tǒng)中進行級聯(lián)編碼

基于高速FPGA的PCB設計技術(shù)

  • 本文只談及了一些基本的概念。這里所涉及的任何一個主題都可以用整本書的篇幅來討論。關(guān)鍵是要在為PCB版圖設計投入大量時間和精力之前搞清楚目標是什么。一旦完成了版圖設計,重新設計就會耗費大量的時間和金錢,即便是對走線的寬度作略微的調(diào)整。不能依賴PCB版圖工程師做出能夠滿足實際需求的設計來。原理圖設計師要一直提供指導,作出精明的選擇,并為解決方案的成功負起責任。
  • 關(guān)鍵字: PCB  電容  SERDES  FPGA  

用FPGA實現(xiàn)FIR濾波器

  • 你接到要求用FPGA實現(xiàn)FIR濾波器的任務時,也許會想起在學校里所學的FIR基礎知識,但是下一步該做什么呢?哪些參數(shù)是重要的?做這個設計的最佳方法是什么?還有這個設計應該怎樣在FPGA中實現(xiàn)?現(xiàn)在有大量的低成本IP核和工具來幫助你進行設計,因為FIR是用FPGA實現(xiàn)的最普通的功能。
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克服FPGA I/O引腳分配挑戰(zhàn)

  • 賽靈思公司開發(fā)了一種規(guī)則驅(qū)動的方法。首先根據(jù)PCB和FPGA設計要求定義一套初始引腳布局,這樣利用與最終版本非常接近的引腳布局設計小組就可以盡可能早地開始各自的設計流程。 如果在設計流程的后期由于PCB布線或內(nèi)部FPGA性能問題而需要進行調(diào)整,在采用這一方法晨這些問題通常也已經(jīng)局部化了,只需要在PCB或FPGA設計中進行很小的設計修改。
  • 關(guān)鍵字: PCB  IO引腳分配  FPGA  
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