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嵌入式系統(tǒng)中IP協(xié)議用ASIC器件電路設(shè)計(jì)
- 設(shè)計(jì)并實(shí)現(xiàn)一個(gè)能完成IP協(xié)議功能的ASIC器件;討論器件的穩(wěn)定工作條件。任何數(shù)字化的工業(yè)設(shè)備都可以使用個(gè)IP協(xié)議器件直接連接到基于IP的網(wǎng)絡(luò)中。
- 關(guān)鍵字: 嵌入式系統(tǒng) IP ASIC
Altera發(fā)布業(yè)界首款40-nm FPGA和HardCopy ASIC
- ? 為幫助設(shè)計(jì)人員提高集成度,進(jìn)一步創(chuàng)新,Altera公司今天發(fā)布了業(yè)界的首款40-nm FPGA和HardCopy? ASIC。Stratix? IV FPGA和HardCopy IV ASIC都提供收發(fā)器,在密度、性能和低功耗上遙遙領(lǐng)先。Stratix IV系列有680K邏輯單元(LE),比Altera的Stratix III系列高2倍,是目前市場(chǎng)上密度最大的FPGA。HardCopy IV ASIC系列在密度上和Stratix IV器件等價(jià),具有1330萬(wàn)邏輯門。Alte
- 關(guān)鍵字: Altera 40-nm FPGA ASIC
多媒體處理器DM642及其在視頻監(jiān)控中的應(yīng)用
- 引 言 視頻監(jiān)控系統(tǒng)的設(shè)計(jì)方案有很多種,但是市場(chǎng)產(chǎn)品的主流一般選擇兩種方案:一是基于CPU和專用的視頻編解碼ASIC芯片。該方案選擇以ARM為核心的CPU和專用媒體處理芯片搭建。優(yōu)點(diǎn)是開發(fā)時(shí)間相對(duì)較短,但由于采用ASIC,靈活性較差,產(chǎn)品一旦定型,很難更改。二是采用面向媒體處理的專用DSP。其開發(fā)時(shí)間不長(zhǎng),優(yōu)點(diǎn)是由于算法是軟件代碼,所以可以不斷對(duì)產(chǎn)品性能進(jìn)行升級(jí),重復(fù)開發(fā)成本較低。由全球最大的DSP制造商德州儀器(TI)推出的TMS320DM642(以下簡(jiǎn)稱DM642)作為一款高性價(jià)比、專用于多
- 關(guān)鍵字: 多媒體 處理器 視頻監(jiān)控 ASIC CPU DSP CCS DM642
基于軟件的GPS接收機(jī)本地系統(tǒng)
- 0引言 對(duì)于一個(gè)普通的GPS(全球定位系統(tǒng))接收機(jī)來(lái)說(shuō),其對(duì)信號(hào)的捕獲和追蹤均由硬件進(jìn)行處理,主要是用ASIC(專用集成電路)實(shí)現(xiàn)。用ASIC的主要好處之一是它的有效性,能夠?qū)PS信號(hào)進(jìn)行有效處理,但它的造價(jià)較高,而目前GPS技術(shù)還在高速發(fā)展,各種算法還在不斷研究,如果都用ASIC來(lái)實(shí)現(xiàn),顯然并不現(xiàn)實(shí)。而使用軟件來(lái)模擬搭建GPS的接收系統(tǒng),不但可以方便地對(duì)現(xiàn)有的一些算法進(jìn)行比較,而且也能快速地應(yīng)用到實(shí)際中。在該系統(tǒng)中,用A/D轉(zhuǎn)換器將輸入的模擬信號(hào)數(shù)字化,然后交由軟件接收機(jī)處理,由此重構(gòu)的系統(tǒng)
- 關(guān)鍵字: GPS ASIC A/D轉(zhuǎn)換器 MATLAB
Catalyst新型5通道電壓監(jiān)控器降低系統(tǒng)成本節(jié)約板基空間
- Catalyst半導(dǎo)體繼續(xù)快速擴(kuò)展電壓監(jiān)控產(chǎn)品線,為微處理器、微控制器,ASIC器件和其它系統(tǒng)處理器的應(yīng)用新增一款高精度超低功耗5通道監(jiān)控器件。5通道電壓監(jiān)控被整合于一個(gè)小尺寸的8引腳MSOP封裝之內(nèi),CAT885能有效降低系統(tǒng)成本、節(jié)約電路板空間。 CAT885具備低有效漏極開路輸出及手動(dòng)復(fù)位輸入的特點(diǎn),可針對(duì)各種電子產(chǎn)品完成系統(tǒng)復(fù)位和監(jiān)控功能。CAT885可以監(jiān)控多達(dá)5通道的系統(tǒng)電壓,若所有被監(jiān)控的電源電壓已經(jīng)超過額定電平值,并且隨后被啟動(dòng)的器件內(nèi)部計(jì)時(shí)器超時(shí)溢出后,有效的復(fù)位輸出才會(huì)終止,
- 關(guān)鍵字: Catalyst 電壓監(jiān)控器 微處理器 微控制器 ASIC
采用DSP、PLD和ASIC實(shí)現(xiàn)多速濾波器設(shè)計(jì)的比較
- 許多通信系統(tǒng)都要用到多速濾波器(multirate filter),多速濾波器是指輸出數(shù)據(jù)速率與輸入數(shù)據(jù)速率不相等的濾波器,常用于某個(gè)物理接口如數(shù)模轉(zhuǎn)換器(DAC)或模數(shù)轉(zhuǎn)換器(ADC)的接口處。
- 關(guān)鍵字: ASIC DSP PLD 濾波器設(shè)計(jì)
VERISILICON加盟“功耗前鋒倡議”加速高級(jí)低功耗設(shè)計(jì)
- 世界級(jí)ASIC設(shè)計(jì)晶圓廠及定制解決方案供應(yīng)商VeriSilicon Holdings Co., Ltd.(VeriSilicon)“已經(jīng)加盟功耗前鋒倡議”( Power Forward Initiative,PFI),計(jì)劃為其ASIC客戶提供基于通用功率格式(Common Power Format,CPF)的設(shè)計(jì)解決方案。 VeriSilicon采用Cadence低功耗解決方案,是業(yè)界領(lǐng)先的完整的設(shè)計(jì)流程,以Si2標(biāo)準(zhǔn)的CPF為基礎(chǔ),貫穿邏輯設(shè)計(jì)、驗(yàn)證、實(shí)現(xiàn)等技術(shù)。這種針
- 關(guān)鍵字: 晶圓 VeriSilicon ASIC 低功耗 CPF
加速ASIC/SoC原型設(shè)計(jì)的軟件技術(shù)
- ASIC和SoC器件成本的逐步上升迫使半導(dǎo)體供應(yīng)商必須進(jìn)一步開拓各個(gè)器件的市場(chǎng)以尋求滿意的投資回報(bào)。日益增長(zhǎng)的軟件使用為此提供了有效的機(jī)制,因?yàn)樵黾拥能浖?nèi)容等同于更多的功能和軟件變化提供了特定市場(chǎng)產(chǎn)品的差異化。
- 關(guān)鍵字: ASIC SoC 原型設(shè)計(jì) 軟件技術(shù)
以高性能匯聚平臺(tái) 迎接視頻監(jiān)控新挑戰(zhàn)
- 隨著人們對(duì)安全需求的日益重視和性能的不斷增強(qiáng)、價(jià)格的迅速降低,應(yīng)用市場(chǎng)正快速膨脹。但是不管是定位于中小企業(yè)、中小網(wǎng)絡(luò)的DVR解決方案,還是定位在高端、企業(yè)級(jí)用戶的DVS,以及廣被業(yè)界看好的IP攝像機(jī),都對(duì)方案提供商提出了更高的要求(更多挑戰(zhàn)):更高的視頻信號(hào)分辨率和壓縮比;更靈活的媒體格式支持;更安全的內(nèi)容保護(hù);更低的功耗、成本和開發(fā)復(fù)雜度。 在視頻監(jiān)控應(yīng)用領(lǐng)域主要包括媒體處理器、DSC、ASIC、以及FPGA等幾種方案。其中DSC雖然具有部分DSP的功能,但是從總體來(lái)講,DSC和媒體處理器一樣
- 關(guān)鍵字: 視頻監(jiān)控 DVS DSC ASIC
針對(duì)未來(lái)的任務(wù)關(guān)鍵設(shè)計(jì)應(yīng)采用那種耐輻射平臺(tái)?(06-100)
- 暴露在惡劣的太空環(huán)境下的系統(tǒng)必須能在各種極端的條件下正常工作,且不喪失任何功能。太空系統(tǒng)在其生命期內(nèi)采集的信息若有任何微小偏差,都可能會(huì)對(duì)整個(gè)數(shù)據(jù)作出錯(cuò)誤的詮釋。由于這些太空系統(tǒng)都是執(zhí)行特別重要任務(wù)的系統(tǒng),在設(shè)計(jì)時(shí)就必須考慮多個(gè)因素,除了功耗、系統(tǒng)重量、體積和發(fā)射時(shí)間等因素外,系統(tǒng)的可靠性是最主要關(guān)鍵。例如,執(zhí)行太空任務(wù)的衛(wèi)星必須能夠在整個(gè)生命期內(nèi) (通常是數(shù)十年) 耐受各種惡劣的環(huán)境條件。就可靠性而言,在太空運(yùn)行的系統(tǒng)面臨最大的挑戰(zhàn)也許是持續(xù)的輻射轟擊。提高系統(tǒng)的耐輻射能力正迅速成為系統(tǒng)工程師的一項(xiàng)
- 關(guān)鍵字: Actel FPGA 耐輻射 RH-ASIC
在FPGA中集成高速串行收發(fā)器面臨的挑戰(zhàn)(04-100)
- Altera公司對(duì)PCI Express,串行Rapid I/O和SerialLite等串行標(biāo)準(zhǔn)和協(xié)議的認(rèn)可,將促進(jìn)具有時(shí)鐘和數(shù)據(jù)恢復(fù)(CDR)功能的高速串行收發(fā)器的應(yīng)用。這些曾在4或8位ASSP中使用的收發(fā)器現(xiàn)在可以集成在高端FPGA中。帶有嵌入式收發(fā)器的FPGA占據(jù)更小的電路板空間,具有更高的靈活性和無(wú)需接口處理的兩芯片方案等優(yōu)勢(shì),因此,采用這種FPGA對(duì)電路板設(shè)計(jì)者是很具有吸引力的選擇。 在FPGA中集成收發(fā)器使得接口電路處理工作由電路板設(shè)計(jì)者轉(zhuǎn)向芯片設(shè)計(jì)者。本文闡述在一個(gè)FPGA中集成1
- 關(guān)鍵字: Altera FPGA ASSP ASIC
紅外動(dòng)目標(biāo)識(shí)別跟蹤系統(tǒng)的DSP+FPGA實(shí)現(xiàn)
- 與通用集成電路相比,ASIC芯片具有體積小、重量輕、功耗低、可靠性高等幾個(gè)方面的優(yōu)勢(shì),而且在大批量應(yīng)用時(shí),可降低成本?,F(xiàn)場(chǎng)可編程門陣列(FPGA)是在專用ASIC的基礎(chǔ)上發(fā)展出來(lái)的,它克服了專用ASIC不夠靈活的缺點(diǎn)。與其他中小規(guī)模集成電路相比,其優(yōu)點(diǎn)主要在于它有很強(qiáng)的靈活性,即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置,對(duì)電路的修改和維護(hù)很方便。DSP+FPGA結(jié)構(gòu)最大的特點(diǎn)是結(jié)構(gòu)靈活,有較強(qiáng)的通用性,適于模塊化設(shè)計(jì),從而能夠提高算法效率;同時(shí)其開發(fā)周期較短,系統(tǒng)易于維護(hù)和擴(kuò)展,適合于實(shí)時(shí)數(shù)字信號(hào)處理。本
- 關(guān)鍵字: ASIC
asic 介紹
ASIC(Application Specific Integrated Circuit)是專用集成電路。
目前,在集成電路界ASIC被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。ASIC的特點(diǎn)是面向特定用戶的需求,ASIC在批量生產(chǎn)時(shí)與通用集成電路相比具有體積更小、功耗更低、可靠性提高、性能提高、保密性增強(qiáng)、成本降低等優(yōu)點(diǎn)。
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