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EEPW首頁 >> 主題列表 >> asic-to-fpga

14nm的FPGA需要什么樣的電源管理IC？

  • 現(xiàn)在的FPGA不僅僅是一個邏輯器件，它現(xiàn)在更加像一個平臺，在一個FPGA中常常會包含有數(shù)字信號處理、嵌入式處理、高速串行和其他高端技術(shù)模塊。那么，這樣的FPGA需要什么樣的電源管理IC來與之配合呢？
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分析FPGA的基本結(jié)構(gòu)

  • FPGA由6部分組成，分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內(nèi)嵌專用硬核等。
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如何通過RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計

  • EDA 公司和 FPGA 廠商不斷開發(fā)新的工具和方法，推進(jìn)繁瑣任務(wù)的自動化，幫助設(shè)計團(tuán)隊集中精力做好創(chuàng)造性工作。下面我們就來看看 FPGA 工具流程的演進(jìn)發(fā)展，了解一下現(xiàn)代 FPGA 團(tuán)隊是如何利用 RTL分析、約束生成和綜合導(dǎo)向來減少設(shè)計迭代的。
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基于FPGA的視頻信號發(fā)生器設(shè)計與應(yīng)用研究

  • 本文介紹了一種基于FPGA的新型視頻信號發(fā)生器，它可以滿足多種被測系統(tǒng)對輸入視頻信號制式的要求。該系統(tǒng)利用USB總線與上位機(jī)進(jìn)行通信，同時解決了系統(tǒng)供電的問題。在FPGA內(nèi)部，通過軟件編程的方法生成視頻信號的圖像和時序控制信號，并送入視頻D /A模塊。
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用智能的調(diào)試與綜合技術(shù)隔離FPGA設(shè)計中的錯誤

  • Synopsys公司的Synplify Premier 和Synplify Pro FPGA設(shè)計工具以及Identify RTLDebugger 等產(chǎn)品能幫助設(shè)計人員完成上述工作。這些工具的特性使得設(shè)計人員能快速隔離錯誤，有效縮短運(yùn)行時間，并減少開發(fā)板啟動所需的迭代次數(shù)。
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信號去直流方法

  • 本文介紹一種根據(jù)Xilinx FPGA中DSP48E1資源設(shè)計的去直流模塊，其基本原理采用一階濾波器，如圖1所示，通過一個一階RC電路，在V0端可等效一個低通濾波器，得到直流分量。
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用于實現(xiàn)嵌入式安全的開源硬件

  • 想像一下你正在排隊等待參加一個重要活動。門票是通過網(wǎng)上購買的，存儲在你的智能手機(jī)中。你需要將手機(jī)放到某個指定區(qū)域上，建立起NFC連接，門票隨之得到確認(rèn)，大門開啟允許你進(jìn)入。好消息是，所有這一切都是在匿名情況下發(fā)生的。
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FPGA與多核CPU如何改變嵌入式設(shè)計

  • 隨著嵌入式器件在過去數(shù)十年來的爆炸性成長，使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新，但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計方法卻少有進(jìn)步，并逐漸變成一種障礙。有鑒于新標(biāo)準(zhǔn)與協(xié)議的快速發(fā)展，以及對產(chǎn)品上市壓力的日益增加，嵌入式系統(tǒng)設(shè)計也即將發(fā)生顛覆性的典范改變。隨著硬件技術(shù)及軟件工具的進(jìn)步在加速成長，由整合所帶來的挑戰(zhàn)也
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高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之： 產(chǎn)品定型和設(shè)計文檔備案

  • 產(chǎn)品的定型包括系統(tǒng)的基本組成、基本配置及互聯(lián)方法，運(yùn)行環(huán)境，硬件整體系統(tǒng)及各分系統(tǒng)的基本功能和主要性能指標(biāo)，功能模塊的劃分，關(guān)鍵技術(shù)的使用，采購的硬件器件名稱型號、生產(chǎn)單位、主要技術(shù)指標(biāo)，主要儀器設(shè)備，電源、工藝結(jié)構(gòu)設(shè)計等。
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高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：產(chǎn)品穩(wěn)定性和可靠性測試

  • 完成一個產(chǎn)品的設(shè)計后和初步調(diào)試后，就可以對產(chǎn)品進(jìn)行完整的測試流程。一般來說，對產(chǎn)品需要進(jìn)行下面一些測試，通過測試后才能對產(chǎn)品的穩(wěn)定性和可靠性得出一個結(jié)論。
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高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：樣機(jī)的調(diào)試方法和技巧

  • 不管是復(fù)雜的電子系統(tǒng)還是簡單的電路，樣機(jī)的調(diào)試都是有一些基本步驟的。對于本案例的信號采集設(shè)備同樣如此。最先進(jìn)行的就是電源系統(tǒng)的調(diào)試，包括是否有短路、斷路，是否有虛焊，各電壓系統(tǒng)是否正常，電源模塊輸出電流是否足夠驅(qū)動負(fù)載等。只有電源系統(tǒng)正常工作，才能談得上實現(xiàn)系統(tǒng)功能。
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高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：硬件系統(tǒng)實現(xiàn)

  • FPGA作可編程器件，可以根據(jù)用戶的需要進(jìn)行現(xiàn)場可編程。為此，本系統(tǒng)實現(xiàn)了兩種編程配置方式。一種是直接對FPGA進(jìn)行編程，使用JTAG模式，在QuartusII 工具中輸出SOF文件（SRAM Object File）。其好處是編程速度快，并且由于是對FPGA的SRAM結(jié)構(gòu)進(jìn)行編程，編程次數(shù)要多得多，但是掉電后，SRAM保存的編程信息
  • 關(guān)鍵字： 高速PCI信號采集卡  PCI9054  PCI總線  LDO可調(diào)模塊  FPGA  

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之： FPGA內(nèi)部結(jié)構(gòu)設(shè)計

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：主機(jī)應(yīng)用程序和驅(qū)動程序的接口設(shè)計

  • 通過調(diào)用PCI設(shè)備驅(qū)動程序的例程，我們可以實現(xiàn)操作系統(tǒng)對PCI設(shè)備的控制。但是直接調(diào)用例程進(jìn)行編程往往顯得不夠直接，也不具有足夠的針對性。因此在高級語言里面對PCI設(shè)備或者信號采集設(shè)備的控制，往往是調(diào)用已經(jīng)封裝過的例程。
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