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一種基于FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)

  • 引言隨著信息化和數(shù)字化的發(fā)展，現(xiàn)在社會(huì)中人們的生活變得更加豐富多彩，生活更加便利。但是有一種...
  • 關(guān)鍵字： FPGA  智能導(dǎo)盲犬  

甚于ARM和FPGA的全彩獨(dú)立視頻LED系統(tǒng)

  • 目前，顯示屏按數(shù)據(jù)的傳輸方式主要有兩類(lèi):一類(lèi)是采用與計(jì)算機(jī)顯示同一內(nèi)容的實(shí)時(shí)視頻屏;另一類(lèi)為通過(guò)USB、以太網(wǎng)等通信手段把顯示內(nèi)容發(fā)給顯示屏的獨(dú)立視頻源顯示屏，若采用無(wú)線(xiàn)通信方式，還可以隨時(shí)更新顯示內(nèi)容，靈
  • 關(guān)鍵字： 視頻  LED  系統(tǒng)  獨(dú)立  全彩  ARM  FPGA  甚于  

基于IPTV系統(tǒng)中的FPGA供電問(wèn)題解

  • IPTV視頻廣播中采用FPGA作為編碼和解碼平臺(tái)的好處是明顯的。然而，為FPGA供電可能是一個(gè)挑戰(zhàn)，而采用根據(jù)電源要求設(shè)計(jì)的專(zhuān)用電源管理器件，如MIC68200，將極大地縮短新系統(tǒng)的上市時(shí)間。
  • 關(guān)鍵字： 供電  問(wèn)題  FPGA  系統(tǒng)  IPTV  基于  通信協(xié)議  

FPGA的嵌入式系統(tǒng)USB接口設(shè)計(jì)

  • FPGA的嵌入式系統(tǒng)USB接口設(shè)計(jì),摘要：設(shè)計(jì)基于FPGA的IP-BX電話(huà)應(yīng)用系統(tǒng)，用于傳統(tǒng)的電話(huà)網(wǎng)絡(luò)(PSTN)與PC機(jī)之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統(tǒng)與PC機(jī)之間提供數(shù)據(jù)和命令通道，從
  • 關(guān)鍵字： 接口  設(shè)計(jì)  USB  系統(tǒng)  嵌入式  FPGA  

FPGA 協(xié)處理的進(jìn)展

  • 對(duì)許多包含并行性或可流水化的算法而言，由于裕量連接帶寬可實(shí)現(xiàn)用戶(hù)自定義的數(shù)據(jù)通路，這樣，邏輯可在一個(gè)時(shí)鐘周期內(nèi)訪(fǎng)問(wèn)存儲(chǔ)器或訪(fǎng)問(wèn)另一個(gè)邏輯塊的結(jié)果，從而使FPGA的持續(xù)性能可接近峰值性能。由于固定架構(gòu)具備預(yù)先確定的用以實(shí)現(xiàn)不同功能的邏輯塊集合，所以可以為FPGA配置支持某種給定算法的最優(yōu)邏輯函數(shù)比例來(lái)實(shí)現(xiàn)器件資源的最佳利用。




  • 關(guān)鍵字： 進(jìn)展  處理  FPGA  交換  

基于高速幀同步和相位模糊估計(jì)法的FPGA實(shí)現(xiàn)

Altera Stratix IV GT FPGA與QSFP實(shí)現(xiàn)互操作性

  • 　　Altera 公司今天宣布其Stratix® IV GT FPGA 實(shí)現(xiàn)了與Avago公司 的 40G 四通道小型可插拔 (QSFP) 光學(xué)模塊的互操作性。QSFP 光學(xué)模塊在單條光纖電纜鏈路上數(shù)據(jù)速率為 40-Gbps。利用 Stratix IV GT FPGA 中特有的 11.3-Gbps 嵌入式收發(fā)器，設(shè)計(jì)人員現(xiàn)在可以運(yùn)用 FPGA 的靈活性和性能優(yōu)勢(shì)在其線(xiàn)卡中將 40G QSFP 光學(xué)模塊橋接到其它器件，從而增加總系統(tǒng)帶寬。 　　QSFP 是一些計(jì)算及電信應(yīng)用中使用的高性能交換機(jī)、路
  • 關(guān)鍵字： Altera  FPGA  Stratix  QSFP  

基于FPGA的DDS設(shè)計(jì)

  • 摘要：利用現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)設(shè)計(jì)并實(shí)現(xiàn)直接數(shù)字頻率合成器(DDS)。結(jié)合DDS的結(jié)構(gòu)和原理，給出系統(tǒng)設(shè)計(jì)方法，并推導(dǎo)得到參考頻率與輸出頻率間的關(guān)系。DDS具有高穩(wěn)定度，高分辨率和高轉(zhuǎn)換速度，同時(shí)利用Ahera公司
  • 關(guān)鍵字： FPGA  DDS    

基于FPGA的時(shí)間間隔測(cè)量模塊設(shè)計(jì)

  • 摘要：介紹一種基于FPGA技術(shù)的時(shí)間間隔測(cè)量方法，通過(guò)分析FPGA的主要技術(shù)優(yōu)勢(shì)及其在工業(yè)控制領(lǐng)域中所處的重要地位，給出設(shè)計(jì)時(shí)間間隔測(cè)量模塊所選用的FPGA器件并進(jìn)行硬件設(shè)計(jì)，以及所選用的軟件并進(jìn)行軟件設(shè)計(jì)。描述
  • 關(guān)鍵字： FPGA  時(shí)間間隔測(cè)量  模塊設(shè)計(jì)    

FPGA和ARM的Profibus-DP主站通信平臺(tái)設(shè)計(jì)

  • 摘要：提出一個(gè)使用FPGA和ARM微控制器實(shí)現(xiàn)Profibus-DP主站(1類(lèi))通信平臺(tái)的解決方案；解析了Profibus-DP通信協(xié)議，重點(diǎn)是令牌輪轉(zhuǎn)協(xié)議；給出了該主站通信平臺(tái)的系統(tǒng)構(gòu)建。該通信平臺(tái)可以獨(dú)立實(shí)現(xiàn)Profibus-DP主站(1類(lèi))
  • 關(guān)鍵字： Profibus-DP  FPGA  ARM  通信    

基于FPGA的偽隨機(jī)序列發(fā)生器設(shè)計(jì)

  • 摘要：討論了應(yīng)用移位寄存器在Ahera的FPGA芯片中實(shí)現(xiàn)線(xiàn)性和非線(xiàn)性偽隨機(jī)序列的方法，該算法基于m序列本原多項(xiàng)式來(lái)獲得線(xiàn)性m序列和非線(xiàn)性m子序列移位寄存器的反饋邏輯式。文中給出了以Altera的QuartusⅡ?yàn)殚_(kāi)發(fā)平臺(tái)，并
  • 關(guān)鍵字： FPGA  偽隨機(jī)序列  發(fā)生器    

FPGA芯片在高速數(shù)據(jù)采集緩存系統(tǒng)中的應(yīng)用

  • 摘要：給出了以FPGA為核心邏輯控制模塊的高性能數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法，并在QuartusII8．0集成環(huán)境中進(jìn)行軟件設(shè)計(jì)和系統(tǒng)仿真，最后給出了新型緩存系統(tǒng)中主要功能模塊的仿真圖形。
    關(guān)鍵詞：FPGA；高速；數(shù)據(jù)采集；緩
  • 關(guān)鍵字： FPGA  芯片  高速數(shù)據(jù)  采集    

基于FPGA+DSP的雷達(dá)回波發(fā)生器設(shè)計(jì)

  • 雷達(dá)回波發(fā)生器利用現(xiàn)代仿真技術(shù)生成蘊(yùn)含雷達(dá)目標(biāo)和環(huán)境信息的模擬雷達(dá)信號(hào)，用來(lái)對(duì)雷達(dá)系統(tǒng)進(jìn)行性能測(cè)試和評(píng)估。根據(jù)通用性、靈活性要求，提出了一種基于DSP+FPGA的雷達(dá)回波發(fā)生器的設(shè)計(jì)方法；簡(jiǎn)要介紹了設(shè)計(jì)思想，詳細(xì)闡述了系統(tǒng)的硬件組成和軟件設(shè)計(jì)，并給出了測(cè)試結(jié)果并總結(jié)了該雷達(dá)回波發(fā)生器的一些優(yōu)點(diǎn)。
  • 關(guān)鍵字： FPGA  DSP  雷達(dá)回波  發(fā)生器    

基于Simulink的數(shù)據(jù)鏈系統(tǒng)仿真及性能分析

  • 未來(lái)戰(zhàn)場(chǎng)必是網(wǎng)絡(luò)中心戰(zhàn)格局下的系統(tǒng)一體化作戰(zhàn)，用于制導(dǎo)的武器數(shù)據(jù)鏈?zhǔn)瞧渲兄匾画h(huán)。通常武器數(shù)據(jù)鏈用...
  • 關(guān)鍵字： Simulink  數(shù)據(jù)鏈系統(tǒng)  仿真  FPGA  

ISPl362在基于FPGA的紅外成像系統(tǒng)中的應(yīng)用

  • 摘要：ISPl362是飛利浦推出的一款USB可編程控制芯片，其內(nèi)部集成了一個(gè)高級(jí)主控制器，一個(gè)外設(shè)控制器，主機(jī)和設(shè)備控制器兼容USB 2．O協(xié)議，支持12 Mb／s的全速傳輸和1．5 Mb／s的低速傳輸；芯片有三種工作模式，即主
  • 關(guān)鍵字： ISPl  FPGA  362  紅外成像系統(tǒng)    
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