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CPLD DDS正交信號源濾波器

  • 桂林電子科技大學(xué) 韓劍 李德明 馮雪1 引言由于傳統(tǒng)的多波形函數(shù)信號發(fā)生器需采用大量分離元件才能實(shí)現(xiàn)，且設(shè)計(jì)復(fù)雜，這里提出一種基于CPLD的多波形函數(shù)信號發(fā)生器。它采用CPLD作為函數(shù)信號發(fā)生器的處理器，以單片機(jī)和
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FPGA工程師的研發(fā)之道――總線的研究

  • 如果設(shè)計(jì)中有多個(gè)模塊，每個(gè)模塊內(nèi)部有許多寄存器或者存儲塊需要配置或者提供讀出那么實(shí)現(xiàn)方式有多種，主要如下：實(shí)現(xiàn)方式一：可以在模塊頂部將所有寄存器引出，提供統(tǒng)一的模塊進(jìn)行配置和讀出。這種方式簡單是簡單，
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Lark Board評估板 Cyclone V SoC的專用舞臺

  • 隨著FPGA技術(shù)的高速發(fā)展，芯片規(guī)模不斷提升，帶來了更強(qiáng)的性能的同時(shí)，也實(shí)現(xiàn)了更低的功耗。FPGA憑借其強(qiáng)大的并行信號處理能力，在應(yīng)對控制復(fù)雜度低、數(shù)據(jù)量大的運(yùn)算時(shí)具有較強(qiáng)的優(yōu)勢。但是在復(fù)雜算法的實(shí)現(xiàn)上，F(xiàn)PGA
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FPGA與CPLD的概念及其區(qū)別

  • 一、FPGA與CPLD的基本概念1.CPLDCPLD主要是由可編程邏輯宏單元(LMC，Logic Macro Cell)圍繞中心的可編程互連矩陣單元組成，其中LMC邏輯結(jié)構(gòu)較復(fù)雜，并具有復(fù)雜的I/O單元互連結(jié)構(gòu)，可由用戶根據(jù)需要生成特定的電路結(jié)
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基于FPGA的短波AM解調(diào)器的設(shè)計(jì)

  • 摘要：調(diào)幅是中短波廣播中一種主要的調(diào)制方式。本文針對現(xiàn)有的模擬短波AM解調(diào)器的不足，提出了一種基于FPGA的全數(shù)字解調(diào)器。其最大的優(yōu)點(diǎn)是將系統(tǒng)中的模擬電路壓縮到最小。短波信號在前端經(jīng)過模數(shù)轉(zhuǎn)換器采樣后直接送
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一種大功率數(shù)字音頻系統(tǒng)設(shè)計(jì)

  • 摘要：音頻編解碼芯片WM8731因其高性能、低功耗等優(yōu)點(diǎn)在很多音頻產(chǎn)品中得到了廣泛應(yīng)用。本文提出了WM8731與FPGA的音頻編解碼系統(tǒng)，并嵌入大功率D類功放技術(shù)作為音頻系統(tǒng)的功率放大應(yīng)用，使得本系統(tǒng)效率高，體積小，音
  • 關(guān)鍵字： WM8731  FPGA  音頻系統(tǒng)  數(shù)字功放  

首款嵌入式FPGA誕生 AI將迎來最好時(shí)代？

  • 想要把FPGA嵌入到SoC中并非易事，不僅需要擁有FPGA的經(jīng)驗(yàn)，更需要有IP集成的經(jīng)驗(yàn)，不過收購Altera的英特爾剛好滿足。
  • 關(guān)鍵字： AI  FPGA  

基于圖像增強(qiáng)的去霧快速算法的FPGA實(shí)現(xiàn)

  • 摘要：基于圖像增強(qiáng)方法，本文提出了一種使用亮度映射的圖像去霧快速算法。此算法通過調(diào)整室外多霧場景圖像的對比度，提高了霧中物體的辨識度。算法的復(fù)雜度低、處理延遲小，實(shí)時(shí)性高，利于FPGA的實(shí)現(xiàn)。實(shí)現(xiàn)時(shí)不需外
  • 關(guān)鍵字： 圖像增強(qiáng)  實(shí)時(shí)去霧  FPGA 亮度映射  

如何用FPGA實(shí)現(xiàn)4G無線球形檢測器

  • MIMO無線系統(tǒng)最佳硬判決檢測方式是最大似然檢測器。ML檢測因?yàn)楸忍卣`碼率 (BER)性能出眾，非常受歡迎。不過，直接實(shí)施的復(fù)雜性會隨著天線和調(diào)制方案的增加呈指數(shù)級增強(qiáng)，使ASIC或FPGA僅能用于使用少數(shù)天線的低密度調(diào)
  • 關(guān)鍵字： FPGA  MIMO  

SOPC進(jìn)階，自定義AD轉(zhuǎn)換IP核設(shè)計(jì)全流

  • 今天帶大家來設(shè)計(jì)一個(gè)自定義的IP核，我們從最基本的做起，包括datasheet 的理解，設(shè)計(jì)的整體框架，AD轉(zhuǎn)換代碼的編寫，仿真，Avalon-MM總線接口的編寫，硬件系統(tǒng)還是基于上次的硬件系統(tǒng)，不過我們不再用altera給我們
  • 關(guān)鍵字： fpga    sopc  

SDR SDRAM（架構(gòu)篇）

  • 今天我們來講的是SDRAM的架構(gòu)以及設(shè)計(jì)，這也是小墨第一次接觸架構(gòu)，也談不上給大家講，就是把我理解的當(dāng)做一個(gè)筆記分享給大家，我也試著做了一個(gè)SDRAM 的架構(gòu)word文檔，在文章的后面，喜歡的朋友可以下載下來看一下
  • 關(guān)鍵字： SDRAM    FPGA  

SDR SDRAM（理論篇）

  • 由于SDRAM本身就是一個(gè)比較復(fù)雜的東西，之前小墨在學(xué)這方面東西的時(shí)候感覺很是吃力，于是那時(shí)候便暫時(shí)放下了，知道年后這段時(shí)間，小墨又重新拾起這個(gè)知識點(diǎn)，想要一口氣把它調(diào)通了，再往下看其他的東西。學(xué)SDRAM，理
  • 關(guān)鍵字： fpga    sram  

基于FPGA的天線選通電路設(shè)計(jì)

  • 某定向設(shè)備采用多普勒效應(yīng)測向原理，即當(dāng)天線振子做圓周運(yùn)動時(shí)，天線振子本身與目標(biāo)信號源就會產(chǎn)生相對速度，使振子感應(yīng)到的信號產(chǎn)生了多普勒頻移，通過對振子感應(yīng)信號相位的處理，從而達(dá)到測向的目的。而為了提高天
  • 關(guān)鍵字： FPGA  VHDL  選通電路  分頻  

基于FPGA流水線結(jié)構(gòu)并行FFT的設(shè)計(jì)與實(shí)現(xiàn)

  • 離散傅里葉變換DFT在通信、控制、信號處理、圖像處理、生物信息學(xué)、計(jì)算物理、應(yīng)用數(shù)學(xué)等領(lǐng)域中有著廣泛的應(yīng)用。FFT算法是作為DFT快速算法提出的，它將長序列的DFT分解為短序列的DFT，大大減少了運(yùn)算量。FFT的FPGA實(shí)
  • 關(guān)鍵字： FFT  FPGA  流水線  并行處理  

一種精確幀同步算法及FPGA實(shí)現(xiàn)

  • 在衛(wèi)星通信系統(tǒng)中，發(fā)送端通常利用不同的分組時(shí)隙同步傳送處在同一傳輸頻帶內(nèi)的各路信號，而接收端為了準(zhǔn)確識別和分離出數(shù)據(jù)流中的各路信號，需要采用幀同步算法進(jìn)行分組檢測和符號同步，其中分組檢測用來識別數(shù)據(jù)分
  • 關(guān)鍵字： 幀同步  相關(guān)  FPGA  衛(wèi)星通信接收機(jī)  
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