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基于FPGA的等效時間采樣

  • 在現(xiàn)代電子測量、通訊系統(tǒng)以及生物醫(yī)學(xué)等領(lǐng)域，經(jīng)常涉及對寬帶模擬信號進(jìn)行數(shù)據(jù)采集和存儲，以便計算機(jī)進(jìn)一步進(jìn)行數(shù)據(jù)處理。為了對高速模擬信號進(jìn)行不失真采集，根據(jù)奈奎斯特定理，采樣頻率必須為信號頻率的2倍以上
  • 關(guān)鍵字： 等效時間采樣  FPGA  數(shù)據(jù)采集  變頻  

基于PCI CAN的數(shù)據(jù)轉(zhuǎn)換系統(tǒng)設(shè)計

  • CAN總線是當(dāng)前最流行的工業(yè)現(xiàn)場總線之一，PCI則是一種應(yīng)用普遍的高速同步總線，具有32 bit帶寬，時鐘頻率為0～33 MHz，最大傳輸速率可達(dá)132 Mbitmiddot;s-1，廣泛應(yīng)用于數(shù)字圖像、語音及數(shù)據(jù)實時采集與處理等領(lǐng)域
  • 關(guān)鍵字： PCI  CAN  FPGA  PCI9054  

基于FPGA的參數(shù)可調(diào)RS422接口電路設(shè)計實現(xiàn)

  • 當(dāng)前應(yīng)用廣泛的串行通信接口標(biāo)準(zhǔn)主要有RS232，RS422和RS485，其中RS232串行通信方式采用單端輸入輸出，傳輸距離短、通信速率低、抗干擾性能差;RS485與RS422均采用差分串行輸入輸出，但RS485只有一對雙絞線，只能工作
  • 關(guān)鍵字： FPGA  RS422  接口電路  

基于FPGA有限域構(gòu)造的QC-LDPC分層譯碼器設(shè)計

  • 低密度奇偶校驗(Low Density Parity—Check，LDPC)碼最早于1962年由R.Gallager提出，其實質(zhì)是一類具有稀疏校檢矩陣的線性分組碼。1996年，Mackay、Neal等人證明了LDPC碼是一種具有逼近Shannon極限性能的好碼，
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基于FPGA的電子表決器電路的設(shè)計與實現(xiàn)

  • 電子設(shè)計自動化(Electronic Design Automation，EDA)是以計算機(jī)為載體，在EDA軟件平臺上，用硬件描述語言VHDL完成設(shè)計文件，然后由計算機(jī)自動地完成邏輯編譯、化簡、分割、綜合、優(yōu)化、布局、布線和仿真，直至對于
  • 關(guān)鍵字： 表決器  設(shè)計  FPGA  仿真  

在系統(tǒng)設(shè)計中的如何選擇半導(dǎo)體器件：ASIC，還是FPGA？

  • 作為一個系統(tǒng)設(shè)計工程師，經(jīng)常會遇到這個問題：是選用ASIC還是FPGA?讓我們來看一看這兩者有什么不同。所謂ASIC，是專用集成電路(Application Specific Integrated Circuit)的簡稱，電子產(chǎn)品中，應(yīng)用非常廣泛。ASIC的
  • 關(guān)鍵字： FPGA  ASIC  系統(tǒng)設(shè)計  成本因素  

基于FPGA的DDR3多端口讀寫存儲管理設(shè)計

  • 引言本文以Xilinx公司的Kintex-7系列XC7K410T FPGA芯片和兩片Micron公司的MT41J128M16 DDR3 SDRAM芯片為硬件平臺，設(shè)計并實現(xiàn)了基于FPGA的視頻圖形顯示系統(tǒng)的DDR3多端口存儲管理。1 總體架構(gòu)設(shè)計機(jī)載視頻圖形顯示系
  • 關(guān)鍵字： 存儲器控制  多端口  幀地址  DDR3  FPGA  

通過EDA設(shè)計工具了解FPGA的設(shè)計流程

  • 對于初學(xué)者而言,FPGA的設(shè)計流程是否顯的又臭又長呢?呵呵,如果真的有這樣的感覺,沒有關(guān)系,下面我就通過對軟件的使用來了解FPGA的設(shè)計流程。1)使用synplify pro對硬件描述語言編譯并生成netlist綜合前要注意對器件的
  • 關(guān)鍵字： EDA  FPGA  

NANO2開發(fā)板實例之USB2.0接口通信回環(huán)

  • 基于FPGA實現(xiàn)USB2.0接口通信， USB2.0 PHY芯片是Cypress68013, 68013內(nèi)部集成8051 內(nèi)核，USB2.0芯片讀寫需要對8051核進(jìn)行固件配置。一.FX2特性介紹1.1介紹Cypress Semiconductor公司的EZ-USB FX2是世界上第一款集
  • 關(guān)鍵字： FPGA    USB  

經(jīng)驗之談，工程師在電路設(shè)計中的八大誤區(qū)

  • 我們常常會發(fā)現(xiàn)，自己想當(dāng)然的一些規(guī)則或道理往往會存在一些差錯。電子工程師在電路設(shè)計中也會有這樣的例子。下面是一位工程師總結(jié)的八大誤區(qū)點?，F(xiàn)象一：這板子的PCB設(shè)計要求不高，就用細(xì)一點的線，自動布吧點評：
  • 關(guān)鍵字： 電路設(shè)計    PCB設(shè)計    FPGA    存儲器    降低功耗  

在FPGA上優(yōu)化實現(xiàn)復(fù)數(shù)浮點計算

  • 性能浮點處理一直與高性能CPU相關(guān)聯(lián)。在過去幾年中，GPU也成為功能強(qiáng)大的浮點處理平臺，超越了圖形，稱為GP-GPU(通用圖形處理單元)。新創(chuàng)新是在苛刻的應(yīng)用中實現(xiàn)基于FPGA的浮點處理。本文的重點是FPGA及其浮點性能和
  • 關(guān)鍵字： FPGA  浮點計算  

如何將PetaLinux移植到Xilinx FPGA上

  • 用戶可輕松將這款高穩(wěn)健操作系統(tǒng)安裝到目標(biāo)FPGA平臺上，以供嵌入式設(shè)計項目使用。從最初不起眼的膠合邏輯開始，F(xiàn)PGA已經(jīng)歷了漫長的發(fā)展道路。當(dāng)前FPGA的邏輯容量和靈活性已將其帶入了嵌入式設(shè)計的中心位置。目前，在
  • 關(guān)鍵字： PetaLinux  FPGA  賽靈思  

基于FPGA的除顫器解決方案

  • 越來越多的人們認(rèn)識到當(dāng)心臟病患者的心臟驟停時，快速及時的救治能夠帶來很大的好處。這促使更多公共場所和辦公室配備有AED設(shè)備。而且在美國，因為各州政府強(qiáng)制規(guī)定，如果場地所有者沒有配備足夠的AED設(shè)備，將有可能
  • 關(guān)鍵字： FPGA  除顫器解決方案  

CPLD 實現(xiàn)DDS 信號源的設(shè)計

  • 中文摘要:利用CPLD 在高速數(shù)據(jù)處理方面的特點設(shè)計出以VHDL 硬件描述語言為設(shè)計輸入, 以AL TERA 公司的 EPM 7256 芯片為設(shè)計載體, 基于DDS 技術(shù)的任意波形信號發(fā)生器。該信號發(fā)生器能同時輸出兩路信號, 輸出信號的頻
  • 關(guān)鍵字： CPLD  DDS 信號源  設(shè)計  

東亞LTE設(shè)備需求強(qiáng)勁　FPGA喜迎4G商機(jī)

  • 東亞地區(qū)長程演進(jìn)計畫(LTE)設(shè)備需求，驅(qū)動現(xiàn)場可編程閘陣列(FPGA)業(yè)者營收攀升。2014年中國大陸及臺灣陸續(xù)啟動LTE商轉(zhuǎn)，帶動龐大的LTE設(shè)備購置及基礎(chǔ)建設(shè)投資潮，深耕通訊領(lǐng)域有成的FPGA業(yè)者也趁著這波潮流搭上順風(fēng)
  • 關(guān)鍵字： 4G  LTE  FPGA  IP  嵌入式  PLD  CPLD  
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