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交流斬波調(diào)壓器中PWM控制的FPGA實現(xiàn)

  • 本文就是利用EDA開發(fā)平臺，實現(xiàn)基于IGBT器件的交流斬波調(diào)壓器中PWM波的控制。這種基于IGBT器件和PWM控制的交流調(diào)壓器，相比于傳統(tǒng)的變壓器調(diào)壓和可控硅
  • 關(guān)鍵字： 交流斬波調(diào)壓器  PWM  FPGA  

一種基于CPLD的DMA控制器IP核設(shè)計

  • 但是由于8013硬件結(jié)構(gòu)和指令系統(tǒng)的限制，當(dāng)需要高速率大批量數(shù)據(jù)傳送時，數(shù)據(jù)吞吐速率往往不能滿足設(shè)計要求。即使采用提升振蕩器頻率的辦法，結(jié)果仍不
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基于CPLD的測試系統(tǒng)接口設(shè)計

  • 介紹了一種用CPLD(復(fù)雜可編程邏輯器件)作為核心控制電路的測試系統(tǒng)接口，通過時cPLD和竹L電路的比較及cPLD在系統(tǒng)中實現(xiàn)的強大功能，論述了CPLD在測試系
  • 關(guān)鍵字： EDA  CPLD  測試系統(tǒng)接口  VHDL  

基于FPGA的Petri網(wǎng)的硬件實現(xiàn)

  • Petri網(wǎng)是異步并發(fā)現(xiàn)象建模的重要工具，Petri網(wǎng)的硬件實現(xiàn)將為并行控制器的設(shè)計提供一種有效的途徑.本文在通用的EDA軟件Max+PlusII中，研究了基本Petr
  • 關(guān)鍵字： EDA技術(shù)  FPGA  VHDL  Petri網(wǎng)  

FPGA芯片選擇策略

  • FPGA器件的選用同其它通用邏輯器件不同，除考慮器件本身的性能外，軟件下具也很重要。目前市場上已有的FPGA器件生產(chǎn)廠家有20多個，而設(shè)計軟件除生產(chǎn)廠
  • 關(guān)鍵字： FPGA  FPGA選型  FPGA選型策略和原則  

如何設(shè)計基于CPLD的溫度計（原理和代碼）？

  • 1. 概述本設(shè)計基于CPLD設(shè)計一款數(shù)字溫度計，溫度傳感器使用DS18B20，CPLD采用EPM240T100C5。DS18B20 具有體積小，硬件開銷低(只需要一根信號線)，抗干
  • 關(guān)鍵字： 溫度計  cpld  

如何基于設(shè)計Verilog FPGA 流水燈？

  • 1 功能概述流水廣告燈主要應(yīng)用于LED燈光控制。通過程序控制LED的亮和滅， 多個LED燈組成一個陣列，依次逐個點亮的時候像流水一樣，所以叫流水燈。由于
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多功能存儲器芯片的測試系統(tǒng)設(shè)計方案

  • 隨著電子技術(shù)的飛速發(fā)展， 存儲器的種類日益繁多，每一種存儲器都有其獨有的操作時序，為了提高存儲器芯片的測試效率，一種多功能存儲器芯片的測試系統(tǒng)
  • 關(guān)鍵字： 測試  控制  FPGA  

以FPGA為控制核心的實時圖像監(jiān)控系統(tǒng)

  • 　　目前，圖像監(jiān)控系統(tǒng)大多采用PC和視頻采集卡作為系統(tǒng)主要部分，基于嵌入式技術(shù)的圖像監(jiān)控系統(tǒng)設(shè)備在我國還只是起步階 段，沒有成熟的產(chǎn)品應(yīng)用。這一現(xiàn)狀的根本原因就是我國在開發(fā)這類產(chǎn)品時，沒有統(tǒng)一的開發(fā)標準和共用的開發(fā)平臺，而且沒有可靠的功能和性能測試標準，各個企 業(yè)的開發(fā)技術(shù)力量分散，極大的影響了該類產(chǎn)品開發(fā)的效率和可靠性。而制造出來的產(chǎn)品同國外同類產(chǎn)品相比，功能相差太大，沒有競爭力，市場基本上被國外公司 所占領(lǐng)。因此，開發(fā)一個該類嵌入式系統(tǒng)勢在必行?！　∠到y(tǒng)總體方案　　為了實現(xiàn)自動圖像報警和圖像采集，本文
  • 關(guān)鍵字： FPGA  芯片  

FPGA設(shè)計筆記：QSPI Flash與DDR3L SDRAM采用同一I/O分區(qū)

  • 眾所周知FPGA的硬件資源被劃分為若干個不同的bank，Xilinx一些高端的FPGA器件由22個甚至更多個bank組成，這樣設(shè)計主要是為了提高靈活性。FPGA的I/O支持
  • 關(guān)鍵字： FPGA  轉(zhuǎn)換器  

百度云RSA解密加速服務(wù)

  • RSA算法是一種最廣為使用的ldquo;非對稱加密算法rdquo;，一般公鑰/私鑰長度越長，安全性就越好，計算也越復(fù)雜。百度云https改造中應(yīng)用了RSA 2048加解
  • 關(guān)鍵字： FPGA  驅(qū)動  

簡述基于EDA技術(shù)的FPGA設(shè)計

  • 物聯(lián)網(wǎng)、人工智能、大數(shù)據(jù)等新興技術(shù)的推動，集成電路技術(shù)和計算機技術(shù)得到蓬勃發(fā)展。電子產(chǎn)品設(shè)計系統(tǒng)日趨數(shù)字化、復(fù)雜化和大規(guī)模集成化，各種電子系
  • 關(guān)鍵字： EDA技術(shù)  FPGA  設(shè)計  

FPGA也能做RNN

  • 導(dǎo)言：循環(huán)神經(jīng)網(wǎng)絡(luò)(RNNs)具有保留記憶和學(xué)習(xí)數(shù)據(jù)序列的能力。由于RNN的循環(huán)性質(zhì)，難以將其所有計算在傳統(tǒng)硬件上實現(xiàn)并行化。當(dāng)前CPU不具有大規(guī)模并行
  • 關(guān)鍵字： 嵌入式  FPGA  

一種基于FPGA硬件求解函數(shù)的簡化方法

  • 摘 要：本文研究了一種運用FPGA進行數(shù)據(jù)處理的方法，包括：提取輸入數(shù)據(jù)的高log2M個比特位的數(shù)據(jù)，作為高有效位，根據(jù)預(yù)先設(shè)置的目標函數(shù)的計算表格，
  • 關(guān)鍵字： 數(shù)字信號  FPGA  

基于FPGA的DDR3 SDRAM控制器用戶接口設(shè)計

  • 摘要：為了滿足高速圖像數(shù)據(jù)采集系統(tǒng)中對高帶寬和大容量的要求，利用Virtex-7 系列FPGA 外接DDR3 SDRAM 的設(shè)計方法，提出了一種基于Verilog-HDL 語言的
  • 關(guān)鍵字： 控制器  FPGA  
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