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基于DSP與串行A/D組成的高速并行數(shù)據(jù)采集系統(tǒng)方案
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- 關(guān)鍵字: DSP 數(shù)據(jù)采集 TLV1572
基于DSP和CPLD的低功耗多路數(shù)據(jù)處理系統(tǒng)設(shè)計(jì)方案
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- 關(guān)鍵字: DSP 數(shù)據(jù)處理 CPLD
定點(diǎn)DSP中高精度除法的實(shí)現(xiàn)方案
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- 關(guān)鍵字: DSP 中高精度除法 TMS320C5416
基于FPGA實(shí)現(xiàn)DSP與Rapid IO網(wǎng)絡(luò)互聯(lián)系統(tǒng)
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- 關(guān)鍵字: DSP FPGA Rapid網(wǎng)絡(luò)
基于FPGA設(shè)計(jì)DSP的實(shí)踐與改進(jìn)設(shè)計(jì)
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: DSP FPGA matlab Simulink環(huán)境
基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實(shí)現(xiàn)
- 基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實(shí)現(xiàn),引言 HDLC的ASIC芯片使用簡易,功能針對性強(qiáng),性能可靠,適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多,ASIC芯片出于專用性的目的難以通用于不同版本,缺乏應(yīng)用靈活性。有的芯片公司還有自己的標(biāo)
- 關(guān)鍵字: 鏈路 控制 功能 實(shí)現(xiàn) 數(shù)據(jù) 高級 FPGA DSP HDLC 基于
dsp 介紹
DSP數(shù)字信號(hào)處理(Digital Signal Processing,簡稱DSP)是一門涉及許多學(xué)科而又廣泛應(yīng)用于許多領(lǐng)域的新興學(xué)科。20世紀(jì)60年代以來,隨著計(jì)算機(jī)和信息技術(shù)的飛速發(fā)展,數(shù)字信號(hào)處理技術(shù)應(yīng)運(yùn)而生并得到迅速的發(fā)展。數(shù)字信號(hào)處理是一種通過使用數(shù)學(xué)技巧執(zhí)行轉(zhuǎn)換或提取信息,來處理現(xiàn)實(shí)信號(hào)的方法,這些信號(hào)由數(shù)字序列表示。在過去的二十多年時(shí)間里,數(shù)字信號(hào)處理已經(jīng)在通信等領(lǐng)域得到極為廣泛 [ 查看詳細(xì) ]
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