- 在今年舉辦的美國國廣播電視設備展上亮相的數(shù)項創(chuàng)新中，BBC RD新開發(fā)的Stagebox可以安裝到攝像機的背面，將有效傳輸距離從數(shù)百米延長到互聯(lián)網(wǎng)協(xié)議數(shù)據(jù)包能抵達的幾乎任何一個地方。在近期涌現(xiàn)的利用 FPGA與生俱來的可編程功能提供更多功能和適應性，實現(xiàn)協(xié)議和標準的對接的開創(chuàng)性設備中，Stagebox是最新一員。
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Zynq-7000 端到端廣播 FPGA
- 提出了一種基于FPGA的雷達回波實時模擬器的實現(xiàn)方法。該模擬器采用cPCI標準總線，以FPGA為核心計算單元，配有高速數(shù)模、模數(shù)轉(zhuǎn)換模塊，可實現(xiàn)雷達回波信號實時在線注入模擬。該模擬器可實現(xiàn)多種體制下復雜回波的模擬，具有很好的工程應用價值。
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雷達回波實時模擬器 并行處理 FPGA
- 提出了一種FPGA遠程動態(tài)重構的方法，結(jié)合FPGA動態(tài)重構技術和GSM通信技術來實現(xiàn)。利用GSM技術實現(xiàn)配置數(shù)據(jù)的無線傳輸，在單片機控制下將數(shù)據(jù)存儲于CF卡中。在內(nèi)嵌硬核微處理器PowerPC405控制下，F(xiàn)PGA通過內(nèi)部配置存取端口讀取CF卡中新的配置數(shù)據(jù)，對可重構區(qū)進行配置以實現(xiàn)新的功能。
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配置 GSM FPGA
- 大多數(shù)的勘探、觀測工作都是在嚴苛的環(huán)境中進行的，對數(shù)據(jù)的準確性、實時性都有著較高的要求，并且大多情況下要求多參數(shù)同步測量。北京恒頤針對勘探、測控等行業(yè)的特點，推出了基于ARM+FPGA的低功耗、高速率
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數(shù)據(jù)采集 ARM FPGA
- 近年來，軟件無線電已經(jīng)成為通信領域一個新的發(fā)展方向，數(shù)字下變頻技術(Digital Down Converter-DDC)是軟件無線電的核心技術之一，也是計算量最大的部分?；贔PGA的DDC設計一
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DSP DDC FPGA 濾波器
- 基于最大似然 (ML)估計算法，改進并利用FPGA實現(xiàn)了一種適用于TD-LTE系統(tǒng)的上行同步算法。主要介紹了如何利用FPGA實現(xiàn)ML算法。并以Virtex-5芯片為硬件平臺，進行了仿真、綜合、板級驗證、聯(lián)機驗證等工作。結(jié)果表明，該同步算法應用到TD-LTE系統(tǒng)具有良好的穩(wěn)定性和可行性。
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TD-LTE Virtex-5 FPGA
- 介紹了一種以FPGA 可編程邏輯器件為設計平臺的、采用大屏幕全彩led 顯示屏進行全彩灰度圖像顯示的掃描控制器實現(xiàn)方案。經(jīng)過對“19 場掃描”理論灰度實現(xiàn)原理的分析，針對采用該方法實現(xiàn)的全彩LED
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LED 顯示屏設計 FPGA
- 針對調(diào)制樣式在不同環(huán)境下的變化，采用了FPGA部分動態(tài)可重構的新方法，通過對不同調(diào)制樣式信號的解調(diào)模塊的動態(tài)加載，來實現(xiàn)了不同環(huán)境下針對不同調(diào)制樣式的解調(diào)這種方式比傳統(tǒng)的設計方式具有更高的靈活性、可擴展性，并減低了成本和功耗該設計方案同時也介紹了FPGA部分動態(tài)可重構的概念和特點，可以對其它通信信號處理系統(tǒng)設計提供一定的參考。
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可重構技術 解調(diào)模塊 FPGA
- 最近FPGA供應商推出的新型可編程器件進一步縮小了FPGA和ASIC之間的性能差別。盡管這類器件的可配置性對設計工程師很有吸引力，但使用這 些器件所涉及的復雜設計規(guī)則和接口協(xié)議，要求設計工程師經(jīng)過全面的培訓，并需要進行參考設計評估、設計仿真和驗證工作。另一方面，F(xiàn)PGA應用中非常復雜 的模擬設計，例如用于內(nèi)核、I/O、存儲器、時鐘和其它電壓軌的DC/DC穩(wěn)壓器，也要求新的解決方案。本文討論的高性能DC/DC轉(zhuǎn)換器有助于系統(tǒng)設計 工程師克服這些挑戰(zhàn)。
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電壓軌 DC/DC FPGA
- 為實現(xiàn)某專用接口裝置的接口功能檢測，文中詳細地介紹了一種34位串行碼的編碼方式，并基于FPGA芯片設計了該類型編碼的接收、發(fā)送電路。重點分析了電路各模塊的設計思路。電路采用SOPC模塊作為中心控制器，設計簡潔、可靠。試驗表明：該設計系統(tǒng)運行正常、穩(wěn)定。
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串行編碼 SOPC FPGA
- 目前基于銅電纜的高速串口能夠以數(shù)千兆位速率進行數(shù)據(jù)傳送，并可通過使用多個并行通道達成超過100Gbps的數(shù)據(jù)傳輸率，不過傳送的距離卻受到限制，一個可以改善傳輸距離的作法是使用光互連來取代銅電纜，Alt
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DSP LGA FPGA DDM
- 1 引言近年來，由于微電子學和計算機技術的迅速發(fā)展，給EDA技術行業(yè)帶來了巨大的變化。 HDL（hardware description language）硬件描述語言是一種描述電路行為的
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Verilog CPLD FPGA HDL 漢明碼
- 由于Canny算法自身的復雜性，使得其做邊緣檢測的處理時間較長。針對這個問題，提出和實現(xiàn)了一種Canny算法的硬件加速功能。加速功能的設計是以FPGA為硬件基礎，并采用了流水線技術來對系統(tǒng)的結(jié)構改進和優(yōu)化。最后通過對有加速器和無加速器的系統(tǒng)分別做圖像處理，并對統(tǒng)計時間對比分析。結(jié)果表明經(jīng)過加速改進的系統(tǒng)相對節(jié)約了處理時間，并能實時高效地處理復雜圖像的邊緣。
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流水線技術 圖像處理 FPGA
- 現(xiàn)場可編程邏輯門陣列（FPGA）在通信系統(tǒng)中的應用越來越廣泛。隨著通信系統(tǒng)的復雜化和功能多樣化,很多系統(tǒng)需要在不同時刻實現(xiàn)不同的功能,多數(shù)場合需要FPGA能夠支持在線動態(tài)配置;在某些安全領域,需要對FPGA程序進行加密存儲、動態(tài)升級。這里根據(jù)應用趨勢提出了一種基于CPU＋CPLD的可靠的FPGA動態(tài)加載方法。該方法具有靈活、安全、可靠的特點,在通信電子領域具有一定的參考價值。
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動態(tài)配置 FPGA CPLD
- 傳統(tǒng)的嵌入式產(chǎn)品只能實現(xiàn)某種特定的功能，不能滿足用戶可變的豐富多彩的應用需求。為解決這個問題，本文設計并實現(xiàn)了一種使用Java作為軟件平臺的基于FPGA的可編程嵌入式系統(tǒng)，以實現(xiàn)系統(tǒng)對多種本地應用和網(wǎng)絡的支持。
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Java平臺 JNI FPGA
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