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基于FPGA的高速PID控制器設(shè)計(jì)與仿真

　　在CNC(電腦數(shù)控)加工、激光切割、自動(dòng)化磨輥弧焊系統(tǒng)、步進(jìn)／伺服電機(jī)控制及其他由電機(jī)控制的機(jī)械組裝定位運(yùn)動(dòng)控制系統(tǒng)中，PID控制器應(yīng)用得非常廣泛。其設(shè)計(jì)技術(shù)成熟，長(zhǎng)期以來(lái)形成了典型的結(jié)構(gòu)，參數(shù)整定方便，結(jié)構(gòu)更改靈活，能滿足一般控制的要求。　　此類運(yùn)動(dòng)控制系統(tǒng)的被控量常為速度、角度等模擬量，被控量與設(shè)定值之間的誤差值經(jīng)離散化處理后，可由數(shù)字PID控制器實(shí)現(xiàn)的控制算法加以運(yùn)算，最后再轉(zhuǎn)換為模擬量反饋給被控對(duì)象，這就是PID控制中常用的近似逼近原理。　　采用這種結(jié)構(gòu)設(shè)計(jì)的控制系統(tǒng)，其性能只能與原連
關(guān)鍵字： FPGA PID控制器 A／D變換 EDA

釋放未來(lái)物理硬件設(shè)計(jì)的無(wú)限潛力

　　能否創(chuàng)建真正具有競(jìng)爭(zhēng)力的產(chǎn)品在本質(zhì)上取決于設(shè)計(jì)是否有優(yōu)勢(shì)，能否在市場(chǎng)獲得認(rèn)可。過(guò)去，組件在電路板上排布與連接的方式具有很高的區(qū)分度。而今天，業(yè)界不斷的全球化和接口的標(biāo)準(zhǔn)化讓板級(jí)的區(qū)分更加困難也更加難以維持。　　隨著技術(shù)不斷進(jìn)步，電子產(chǎn)品也在不斷發(fā)展，當(dāng)今可以真正區(qū)分產(chǎn)品的通常是嵌入在該器件中的智能水平-這一趨勢(shì)從20年前經(jīng)濟(jì)的微處理器快速發(fā)展時(shí)就開(kāi)始顯現(xiàn)。向軟領(lǐng)域的發(fā)展意味著產(chǎn)品的真正價(jià)值主要由器件中的編程智能實(shí)現(xiàn)，而不是取決于其所屬的物理平臺(tái)屬性。　　對(duì)于電子產(chǎn)品開(kāi)發(fā)公司，這意味著花在板級(jí)實(shí)
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JavaCard CPU的設(shè)計(jì)與FPGA實(shí)現(xiàn)

　　1 JavaCard簡(jiǎn)介　　智能卡是指集成了CPU、ROM、RAM、COS(芯片操作系統(tǒng))和EEPROM，能儲(chǔ)存信息和圖像，具備讀/寫(xiě)能力，信息能被加密保護(hù)的便攜卡。智能卡的最基本標(biāo)準(zhǔn)是 ISO/IEC7816。智能卡在銀行、電信等行業(yè)得到廣泛應(yīng)用，但在發(fā)展過(guò)程中也遇到很多問(wèn)題，主要有：各廠商指令集不統(tǒng)一；編程接口APIs太復(fù)雜；開(kāi)發(fā)環(huán)境不通用，新卡開(kāi)發(fā)都要熟悉開(kāi)發(fā)環(huán)境；系統(tǒng)不兼容，?？▽Ｓ?。由于開(kāi)發(fā)門(mén)檻過(guò)高，影響了智能卡的發(fā)展。市場(chǎng)對(duì)智能卡的發(fā)展提出了新的要求，Sun公司提出了Java Card
關(guān)鍵字： JavaCard CPU FPGA 智能卡

如何用DSP和FPGA構(gòu)建多普勒測(cè)量系統(tǒng)

隨著FPGA性能和容量的改進(jìn)，使用FPGA執(zhí)行DSP功能的做法變得越來(lái)越普遍。
關(guān)鍵字： FPGA DSP 多普勒測(cè)量系統(tǒng)

利用FPGA協(xié)處理提升無(wú)線子系統(tǒng)的性能

　　您可以顯著提高無(wú)線系統(tǒng)中信號(hào)處理功能的性能。怎樣提高呢？有效方法是利用FPGA結(jié)構(gòu)的靈活性和目前受益于并行處理的FPGA架構(gòu)中的嵌入式DSP模塊。　　常見(jiàn)于無(wú)線應(yīng)用中這類處理包括有限沖激響應(yīng)(FIR)濾波、快速傅里葉變換(FFT)、數(shù)字上下變頻和前向誤差校正(FEC)。Xilinx? Virtex-4和Virtex-5架構(gòu)提供多達(dá)512個(gè)并行嵌入式DSP乘法器，這些乘法器的工作頻率高于500MHz，最高可提供256 GMAC的DSP性能。　　將需要高速并行處理的工作卸載給FPGA，而將需要高速
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基于MAX+plusⅡ開(kāi)發(fā)平臺(tái)的EDA設(shè)計(jì)方法

　　MAX + plus Ⅱ是美國(guó)Altera 公司的一種EDA 軟件,用于開(kāi)發(fā)CPLD 和FPGA 進(jìn)行數(shù)字系統(tǒng)的設(shè)計(jì)。用圖形輸入方式和文本輸入方式設(shè)計(jì)了一模60 計(jì)數(shù)器,介紹了數(shù)字系統(tǒng)設(shè)計(jì)的一般方法和過(guò)程,揭示了其在數(shù)字系統(tǒng)中的重要作用。　　EDA ( Elect ronic Design Automation) 即電子設(shè)計(jì)自動(dòng)化技術(shù),是指以計(jì)算機(jī)為基本工作平臺(tái),把應(yīng)用電子技術(shù)、計(jì)算機(jī)技術(shù)、智能化技術(shù)融合在一個(gè)電子CAD 通用軟件包中,輔助進(jìn)行三方面的電子設(shè)計(jì)工作,即集成電路設(shè)計(jì)、電子電路設(shè)計(jì)以及
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利用FPGA協(xié)處理器優(yōu)化高性能數(shù)字?jǐn)z像監(jiān)控系統(tǒng)

　　數(shù)字?jǐn)z像監(jiān)視系統(tǒng)現(xiàn)在具有更多的能力，是傳統(tǒng)模擬系統(tǒng)強(qiáng)有力的替代方案。除了提供先進(jìn)的壓縮技術(shù)，如MPEG-4和H.264，數(shù)字?jǐn)z像監(jiān)視系統(tǒng)現(xiàn)在配備了如圖像穩(wěn)定，全景攝像和視頻運(yùn)動(dòng)檢測(cè)等算法。本文將討論這些新技術(shù)的優(yōu)點(diǎn)，和它們?cè)谟脭?shù)字信號(hào)處理器（DSP）和FPGA協(xié)處理器平臺(tái)上的優(yōu)化實(shí)現(xiàn)。它將詳盡地闡述現(xiàn)代監(jiān)視系統(tǒng)的需求，這些系統(tǒng)中常用的算法和加快系統(tǒng)設(shè)計(jì)的開(kāi)發(fā)平臺(tái)。　　商用攝像監(jiān)視系統(tǒng)的一般需求是支持一至八個(gè)攝像機(jī)，先進(jìn)的視頻壓縮如MPEG-4，Windows Media 9 H.264，低延遲編碼
關(guān)鍵字： FPGA 數(shù)字?jǐn)z像監(jiān)控系統(tǒng) DSP

基于FPGA的USB2.0控制器設(shè)計(jì)

　　在視頻存儲(chǔ)和圖像寬帶領(lǐng)域中，經(jīng)常遇到實(shí)時(shí)高速數(shù)據(jù)傳輸?shù)囊蟆?000年4月，由Intel、Microsoft、NEC、Compaq、Lucent、Phillips等公司共同制訂的USB2.0（Universal Serial Bus）傳輸協(xié)議，其速度遠(yuǎn)遠(yuǎn)超過(guò)了目前使用IEEE1394接口進(jìn)行視頻傳輸?shù)?00Mbps，達(dá)到了480Mbps；而且具有即插即用的PnP（Plug And Play）、可進(jìn)行菊花鏈?zhǔn)降募?jí)聯(lián)（通過(guò)USB HUB進(jìn)行外圍擴(kuò)展）、可串連多達(dá)127個(gè)USB設(shè)備等優(yōu)點(diǎn)。應(yīng)用該協(xié)議可支持實(shí)
關(guān)鍵字： FPGA USB 控制器

AES加密算法的一種優(yōu)化的FPGA實(shí)現(xiàn)方法

本文介紹AES加密算法的一種FPGA實(shí)現(xiàn)的方法以及對(duì)其加密速度的優(yōu)化處理技巧。
關(guān)鍵字： FPGA AES 加密算法實(shí)現(xiàn)方法

國(guó)內(nèi)首個(gè)開(kāi)放源碼硬件創(chuàng)新大賽圓滿閉幕

覆蓋全國(guó)50所高等院校，1000多位在校研究生和博士生及其導(dǎo)師，近200個(gè)團(tuán)隊(duì)的首屆“中國(guó)電子學(xué)會(huì)Xilinx杯開(kāi)放源碼硬件創(chuàng)新大賽”，于2008年4月20日在無(wú)錫國(guó)家集成電路基地經(jīng)過(guò)緊張的最后一輪顛峰對(duì)決和評(píng)委們的遴選，終于塵埃落定。來(lái)自北京郵電大學(xué)由林家儒教授指導(dǎo)的團(tuán)隊(duì)（田耘，徐文波，胡彬和谷濤）提交的“WCDMA系統(tǒng)字頻數(shù)域干擾抵消器”項(xiàng)目最終摘取桂冠，載譽(yù)而歸。獲得二等獎(jiǎng)的分別是東北大學(xué)的“基于FPGA動(dòng)態(tài)重配置技術(shù)的熱電廠集中監(jiān)控系
關(guān)鍵字：開(kāi)放源碼 FPGA Xilinx

如何用FPGA實(shí)現(xiàn)原型板原理圖的驗(yàn)證

　　首次流片成功取決于整個(gè)系統(tǒng)硬件和相關(guān)軟件的驗(yàn)證，有些公司提供的快速原型生成平臺(tái)具有許多調(diào)試功能，但這些平臺(tái)的價(jià)格非常高。　　因此最流行的做法是根據(jù)DUT和具體應(yīng)用設(shè)計(jì)復(fù)合FPGA板，驗(yàn)證這些板的原理圖通常是很麻煩的，本文提出一種利用FPGA實(shí)現(xiàn)原型板原理圖驗(yàn)證的新方法。　　由于價(jià)格競(jìng)爭(zhēng)越來(lái)越激烈，首次流片成功或只需少量的修改變得越來(lái)越重要。　　為了達(dá)到這一目標(biāo)，對(duì)整個(gè)系統(tǒng)(即硬件和相關(guān)軟件)的驗(yàn)證成為重中之重。　　業(yè)界也涌現(xiàn)了許多策略來(lái)幫助設(shè)計(jì)師完成RTL上的軟件運(yùn)行。這些策略提供了在
關(guān)鍵字： FPGA 原理圖

FPGA在微處理器系統(tǒng)中的在應(yīng)用配置

ALTERA公司SRAM工藝可編程器件應(yīng)用廣泛，專用配置器件比較昂貴。在具有微處理器的系統(tǒng)中，使用微處理器系統(tǒng)的存儲(chǔ)器來(lái)存儲(chǔ)配置數(shù)據(jù)，并通過(guò)微處理器配置FPGA，這種方法幾乎不增加成本。微處理器根據(jù)不同的程序應(yīng)用，采用不同的配置數(shù)據(jù)對(duì)FPGA進(jìn)行配置，使FPGA實(shí)現(xiàn)與該應(yīng)用有關(guān)的特定功能。詳細(xì)介紹了微處理器系統(tǒng)中連接簡(jiǎn)單的被動(dòng)串行配置方法和被動(dòng)并行異步配置方法。
關(guān)鍵字： FPGA 微處理器系統(tǒng)

Floorplanner工具在基于FPGA的嵌入式系統(tǒng)設(shè)計(jì)中的應(yīng)用

Floorplanner工具在基于FPGA的嵌入式系統(tǒng)設(shè)計(jì)中的應(yīng)用,利用本文談到的Floorplanner工具可以對(duì)嵌入式處理器、相關(guān)的IP和定制邏輯進(jìn)行布局控制和分組，簡(jiǎn)化復(fù)雜系統(tǒng)級(jí)芯片的開(kāi)發(fā)，提高系統(tǒng)整體性能。
關(guān)鍵字：系統(tǒng) 設(shè)計(jì) 應(yīng)用嵌入式 FPGA 工具基于 Floorplanner

FPGA中軟FIFO設(shè)計(jì)和實(shí)現(xiàn)

異步FIFO是一種在電子系統(tǒng)中得到廣泛應(yīng)用的器件，文中介紹了一種基于FPGA的異步FIFO設(shè)計(jì)方法。使用這種方法可以設(shè)計(jì)出高速、高可靠的異步FIFO。
關(guān)鍵字： FPGA FIFO 軟

將FPGA/CPLD技術(shù)用于防止移動(dòng)設(shè)備盜竊

從澳大利亞到中國(guó)，從美國(guó)到歐洲，手機(jī)制造商不斷為其產(chǎn)品增加新的語(yǔ)音/數(shù)據(jù)功能，而具有新功能的手機(jī)更容易被盜...
關(guān)鍵字： CPLD技術(shù) 移動(dòng)設(shè)備手機(jī) FPGA CVL-D T-Mobile Midland 防止盜竊盜竊犯罪 IMEI

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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫(xiě)，即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)新概念，內(nèi)部包括可 [ 查看詳細(xì) ]