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OFDM信道調(diào)制解調(diào)的仿真及其FPGA設計(06-100)
- OFDM(正交頻分復用)是一種高效的多載波調(diào)制技術,其最大的特點是傳輸速率高,具有很強的抗碼間干擾和信道選擇性衰落能力。OFDM最初用于高速MODEM、數(shù)字移動通信和無線調(diào)頻信道上的寬帶數(shù)據(jù)傳輸,隨著IEEE802.11a協(xié)議、BRAN(Broadband Radio Access Network)和多媒體的發(fā)展,數(shù)字音頻廣播(DAB)、地面數(shù)字視頻廣播((DVB-T)和高清晰度電視((HDTV)都應用了OFDM技術。 OFDM利用離散傅立葉反變換/離散傅立葉變換(IDFT/DFT)代替多載波調(diào)
- 關鍵字: OFDM FPGA
Xilinx推出Virtex-5 FXT FPGA
- 2008年4月3日,北京-全球可編程邏輯解決方案領導廠商賽靈思公司( Xilinx, Inc. (NASDAQ: XLNX) )今天宣布推出Virtex?-5 FXT 器件。這些FPGA器件在業(yè)界率先集成了嵌入式PowerPC? 440處理器模塊、高速RocketIO? GTX收發(fā)器和專用XtremeDSP? 處理能力。作為65nm Virtex-5系列的第四款平臺,Virtex-5 FXT提供了極高的性能,還可幫助設計人員降低系統(tǒng)成本、縮小板尺寸并減少元件數(shù)量。在
- 關鍵字: Xilinx FPGA
FPGA在高速互連中的應用
- 在技術發(fā)展的進程中,某些出現(xiàn)的里程碑式技術甚至引起了發(fā)展方向的全盤改變。最初常用的并行打印機端口現(xiàn)在幾乎已經(jīng)絕跡了。系統(tǒng)結構以8/16/32位并行總線的方式實現(xiàn)硅器件和存儲器之間的互連。傳統(tǒng)的系統(tǒng)背板會定義寬度達64位的并線總線。由于用戶對更高保真度多媒體體驗的需求不斷提升,導致數(shù)據(jù)率不斷提高,系統(tǒng)數(shù)據(jù)吞吐量的要求呈現(xiàn)幾何級數(shù)的增長。不過,增加并行總線的寬度和時鐘的頻率并不是長期可行的解決方案,因為這種方法本身已經(jīng)達到了某些技術死角,主要會碰到的問題包括PCB的空間限制、信號噪聲、信號完整性和避免信號
- 關鍵字: FPGA
賽靈思正式發(fā)布Virtex-5 FXT FPGA
- 65nm Virtex-5系列FPGA第四款平臺集成了PowerPC 440處理器模塊、 GTX高速收發(fā)器,以及超過190 GMACs的DSP性能
- 關鍵字: Virtex-5 FXT FPGA 賽靈思 65納米
撥開迷霧:FPGA用做數(shù)字信號處理應用?
- 在2004年加入賽靈思公司之前,與大多數(shù)人的觀點一樣,我也認為FPGA“非常適用于原型設計,但對于批量DSP系統(tǒng)應用來說,成本太高,功耗太大。”,我原來一直認為,F(xiàn)PGA在成本和功效方面無法滿足今天采用DSP系統(tǒng)架構完成的那些設計的預算要求。然而,沒過多久,我源于“DSP視角”的看法就被大大地并且不可逆轉(zhuǎn)地改變了。 今天針對DSP優(yōu)化的高性能FPGA已經(jīng)在DSP領域扮演著重要的角色。DSP領域的設計工程師逐漸發(fā)現(xiàn)他們所處的環(huán)境變化十分迅速,標準快速
- 關鍵字: FPGA 數(shù)字信號處理
FPGA電路設計:如何應對電源相關問題的挑戰(zhàn)
- 引言 在設計可編程門陣列(FPGA)電路時,必須極端重視電源問題,從而使最終產(chǎn)品能在所有可能的條件下無缺陷工作并處于最優(yōu)狀態(tài)。FPGA 電路電源有兩項需考慮的問題: FPGA 電路上電要求和電路功耗分析。這篇文章針對這兩方面的要求,討論您可能遇到的問題,以及解決方案。 目前FPGA電路設計所面臨的問題 FPGA電路通常需要多路電源輸入。為優(yōu)化開機時的電流拖曳,防止鎖死和永久性的電路損壞,同時也為了防止開機接通時的毛刺干擾和降低開機接通的功耗,這些電源輸入必須具有精確的上電序列以及正確
- 關鍵字: FPGA 電源
基于FPGA的并行可變長解碼器的實現(xiàn)技術
- 可變長編碼(VLC)是一種無損熵編碼,它廣泛應用于多媒體信息處理等諸多領域。在H.261/263、MPEG1/2/3等國際標準中,VLC占有重要地位。VLC的基本思想是對一組出現(xiàn)概率各不相同的信源符號,采用不同長度的碼字表示,對出現(xiàn)概率高的信源符號采用短碼字,對出現(xiàn)概率低的信源符號采用長碼字。Huffman編碼是一種典型的VLC,其編碼碼字的平均碼長非常接近于數(shù)據(jù)壓縮的理論極限——熵。 可變長解碼(VLD)是VLC的逆過程,它從一組連續(xù)的碼流中提取出可變長碼字,并將之轉(zhuǎn)換
- 關鍵字: VLD 串行解碼 FPGA
采用FPGA協(xié)處理器優(yōu)化汽車信息娛樂和信息通信系統(tǒng)(04-100)
- 集成了數(shù)據(jù)通信,定位服務和視頻娛樂的高端汽車信息娛樂系統(tǒng)需要高性能的可編程處理技術,其最佳實現(xiàn)方法是在主流汽車信息通信系統(tǒng)構架中集成FPGA協(xié)處理器。本文講述汽車娛樂系統(tǒng)的需求,討論主流系統(tǒng)構架,以及FPGA協(xié)處理器是如何集成到軟硬件體系中,以滿足高性能處理、靈活性和降低成本的要求。 娛樂電子消費已經(jīng)成為區(qū)分豪華轎車的標志之一,推動了汽車性能的快速發(fā)展,設計者必須在性能,成本和靈活性上進行綜合考慮。高端應用包括衛(wèi)星電話,后座娛樂,導航,各種音頻回放,語音合成、識別以及其他新的應用。 帶動汽
- 關鍵字: FPGA 汽車娛樂系統(tǒng)
FPGA 電路設計: 如何應對電源相關問題的挑戰(zhàn)
- 引言 在設計可編程門陣列(FPGA)電路時,必須極端重視電源問題,從而使最終產(chǎn)品能在所有可能的條件下無缺陷工作并處于最優(yōu)狀態(tài)。FPGA 電路電源有兩項需考慮的問題: FPGA 電路上電要求和電路功耗分析。這篇文章針對這兩方面的要求,討論您可能遇到的問題,以及解決方案。 目前FPGA電路設計所面臨的問題 FPGA電路通常需要多路電源輸入。為優(yōu)化開機時的電流拖曳,防止鎖死和永久性的電路損壞,同時也為了防止開機接通時的毛刺干擾和降低開機接通的功耗,這些電源輸入必須具有精確的上電序列以及正確
- 關鍵字: FPGA
在FPGA中集成高速串行收發(fā)器面臨的挑戰(zhàn)(04-100)
- Altera公司對PCI Express,串行Rapid I/O和SerialLite等串行標準和協(xié)議的認可,將促進具有時鐘和數(shù)據(jù)恢復(CDR)功能的高速串行收發(fā)器的應用。這些曾在4或8位ASSP中使用的收發(fā)器現(xiàn)在可以集成在高端FPGA中。帶有嵌入式收發(fā)器的FPGA占據(jù)更小的電路板空間,具有更高的靈活性和無需接口處理的兩芯片方案等優(yōu)勢,因此,采用這種FPGA對電路板設計者是很具有吸引力的選擇。 在FPGA中集成收發(fā)器使得接口電路處理工作由電路板設計者轉(zhuǎn)向芯片設計者。本文闡述在一個FPGA中集成1
- 關鍵字: Altera FPGA ASSP ASIC
fpga 介紹
FPGA是英文Field-Programmable Gate Array的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個新概念,內(nèi)部包括可 [ 查看詳細 ]
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