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信號去直流方法

本文介紹一種根據(jù)Xilinx FPGA中DSP48E1資源設(shè)計的去直流模塊，其基本原理采用一階濾波器，如圖1所示，通過一個一階RC電路，在V0端可等效一個低通濾波器，得到直流分量。
關(guān)鍵字：信號去直流 DSP48E1 FPGA 一階濾波器

用于實現(xiàn)嵌入式安全的開源硬件

想像一下你正在排隊等待參加一個重要活動。門票是通過網(wǎng)上購買的，存儲在你的智能手機中。你需要將手機放到某個指定區(qū)域上，建立起NFC連接，門票隨之得到確認(rèn)，大門開啟允許你進入。好消息是，所有這一切都是在匿名情況下發(fā)生的。
關(guān)鍵字：嵌入式安全開源硬件零知識證明 ZKPK FPGA

FPGA與多核CPU如何改變嵌入式設(shè)計

隨著嵌入式器件在過去數(shù)十年來的爆炸性成長，使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新，但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計方法卻少有進步，并逐漸變成一種障礙。有鑒于新標(biāo)準(zhǔn)與協(xié)議的快速發(fā)展，以及對產(chǎn)品上市壓力的日益增加，嵌入式系統(tǒng)設(shè)計也即將發(fā)生顛覆性的典范改變。隨著硬件技術(shù)及軟件工具的進步在加速成長，由整合所帶來的挑戰(zhàn)也
關(guān)鍵字：多核CPU 嵌入式設(shè)計 FPGA

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：產(chǎn)品定型和設(shè)計文檔備案

產(chǎn)品的定型包括系統(tǒng)的基本組成、基本配置及互聯(lián)方法，運行環(huán)境，硬件整體系統(tǒng)及各分系統(tǒng)的基本功能和主要性能指標(biāo)，功能模塊的劃分，關(guān)鍵技術(shù)的使用，采購的硬件器件名稱型號、生產(chǎn)單位、主要技術(shù)指標(biāo)，主要儀器設(shè)備，電源、工藝結(jié)構(gòu)設(shè)計等。
關(guān)鍵字：高速PCI信號采集卡單板硬件 FPGA 單板軟件

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：產(chǎn)品穩(wěn)定性和可靠性測試

完成一個產(chǎn)品的設(shè)計后和初步調(diào)試后，就可以對產(chǎn)品進行完整的測試流程。一般來說，對產(chǎn)品需要進行下面一些測試，通過測試后才能對產(chǎn)品的穩(wěn)定性和可靠性得出一個結(jié)論。
關(guān)鍵字：高速PCI信號采集卡容錯測試容限測試 FPGA

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：樣機的調(diào)試方法和技巧

不管是復(fù)雜的電子系統(tǒng)還是簡單的電路，樣機的調(diào)試都是有一些基本步驟的。對于本案例的信號采集設(shè)備同樣如此。最先進行的就是電源系統(tǒng)的調(diào)試，包括是否有短路、斷路，是否有虛焊，各電壓系統(tǒng)是否正常，電源模塊輸出電流是否足夠驅(qū)動負(fù)載等。只有電源系統(tǒng)正常工作，才能談得上實現(xiàn)系統(tǒng)功能。
關(guān)鍵字：高速PCI信號采集卡 QuartusII 跑馬燈 FPGA PCI9054

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：硬件系統(tǒng)實現(xiàn)

FPGA作可編程器件，可以根據(jù)用戶的需要進行現(xiàn)場可編程。為此，本系統(tǒng)實現(xiàn)了兩種編程配置方式。一種是直接對FPGA進行編程，使用JTAG模式，在QuartusII 工具中輸出SOF文件（SRAM Object File）。其好處是編程速度快，并且由于是對FPGA的SRAM結(jié)構(gòu)進行編程，編程次數(shù)要多得多，但是掉電后，SRAM保存的編程信息
關(guān)鍵字：高速PCI信號采集卡 PCI9054 PCI總線 LDO可調(diào)模塊 FPGA

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之： FPGA內(nèi)部結(jié)構(gòu)設(shè)計

基于FPGA及PCI9054的信號采集卡的核心設(shè)計部分是FPGA內(nèi)部結(jié)構(gòu)的邏輯設(shè)計。如圖13.15所示為本系統(tǒng)FPGA內(nèi)部結(jié)構(gòu)框圖。
關(guān)鍵字：高速PCI信號采集卡 PCI9054 內(nèi)部信號源 SDRAM控制器 FPGA

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：主機應(yīng)用程序和驅(qū)動程序的接口設(shè)計

通過調(diào)用PCI設(shè)備驅(qū)動程序的例程，我們可以實現(xiàn)操作系統(tǒng)對PCI設(shè)備的控制。但是直接調(diào)用例程進行編程往往顯得不夠直接，也不具有足夠的針對性。因此在高級語言里面對PCI設(shè)備或者信號采集設(shè)備的控制，往往是調(diào)用已經(jīng)封裝過的例程。
關(guān)鍵字：高速PCI信號采集卡驅(qū)動程序主機應(yīng)用程序接口設(shè)計 FPGA

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：PCI卡的驅(qū)動程序設(shè)計

設(shè)計完成的信號采集設(shè)備在插入計算機后，在對其進行控制之前，需要編寫基于操作系統(tǒng)平臺上的驅(qū)動程序。設(shè)備驅(qū)動程序是一個包含了許多操作系統(tǒng)可調(diào)用例程的容器，這些例程可以使硬件設(shè)備執(zhí)行相應(yīng)的動作，它是硬件與上層軟件之間溝通的橋梁。
關(guān)鍵字：高速PCI信號采集卡驅(qū)動程序 WDM驅(qū)動程序過濾驅(qū)動程序 FPGA

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：系統(tǒng)工作原理分析

如前所述，一個完整的信號采集系統(tǒng)，除了具備信號輸入單元、信號處理單元和信號輸出單元外，還需要緩沖區(qū)、時鐘以及電源等相關(guān)系統(tǒng)。如圖13.2所示是本案例信號采集系統(tǒng)的結(jié)構(gòu)框圖。
關(guān)鍵字：高速PCI信號采集卡數(shù)據(jù)總線控制總線地址總線 FPGA

利用FPGA實現(xiàn)外設(shè)通信接口之：利用FPGA實現(xiàn)RS-232C串行接口

RS-232C標(biāo)準(zhǔn)最初是為遠程通信連接數(shù)據(jù)終端設(shè)備DTE（Data Terminal Equipment）與數(shù)據(jù)通信設(shè)備DCE（Data Communication Equipment）而制定的。因此這個標(biāo)準(zhǔn)的制定，并未考慮計算機系統(tǒng)的應(yīng)用要求。
關(guān)鍵字： RS-232C串行接口 UART FPGA

數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之：FPGA在其他視頻和圖像處理系統(tǒng)中的應(yīng)用

目前，F(xiàn)PGA已經(jīng)廣泛應(yīng)用于視頻和圖像的很多領(lǐng)域領(lǐng)域，如在廣播基礎(chǔ)設(shè)施、HDTV顯示器、醫(yī)療成像、HDTV視頻會議以及視頻DVR、攝像機還有一些軍事成像領(lǐng)域。
關(guān)鍵字：數(shù)字圖像倍焦系統(tǒng) 視頻廣播 FPGA 視頻監(jiān)控醫(yī)療成像

如何用C語言描述AES256加密算法最高效？

高級加密標(biāo)準(zhǔn) (AES) 已經(jīng)成為很多應(yīng)用（諸如嵌入式系統(tǒng)中的應(yīng)用等）中日漸流行的密碼規(guī)范。
關(guān)鍵字： ASIC AES FPGA 嵌入式

經(jīng)典款嵌入式智能小車的設(shè)計技巧，提供硬件選型

傳統(tǒng)智能小車，特別是嵌入式系統(tǒng)，一般都是基于單片機或者ARM的嵌入式系統(tǒng)，基本上都由軟件系統(tǒng)和硬件系統(tǒng)組成的，硬件系統(tǒng)方面，跟傳統(tǒng)的搭建硬件環(huán)境一樣，只能做相對裁剪和功能拓展，但是，本項目的課題是通過xilinx的FPGA開發(fā)板搭建嵌入式的硬件環(huán)境，從最小系統(tǒng)到IP核的添加，都是根據(jù)需要進行拓展的，實現(xiàn)一對一的拓展，不浪費資源，而且基于F
關(guān)鍵字：智能小車 Spartan-6 FPGA 電源穩(wěn)壓芯片全橋驅(qū)動

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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細(xì) ]