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LOGi FPGA 開發(fā)板：可在樹莓派和Beaglebone上開發(fā)FPGA

最近在Kickstarter網(wǎng)站上，Valent F(x)團(tuán)隊正在為LOGi FPGA開發(fā)板的生產(chǎn)籌備資金。LOGi 是fpga開發(fā)與arm平臺的結(jié)合。Valent F(x)團(tuán)隊開發(fā)了可以支持樹莓派和Beaglebone上開發(fā)的FPGA開發(fā)板，LOGi系列。它讓FPGA開發(fā)
關(guān)鍵字： FPGA 樹莓派 Beaglebone FPGA IP

從業(yè)績來看，賽靈思已經(jīng)遠(yuǎn)遠(yuǎn)領(lǐng)先于Altera

Altera和賽靈思20年來都在FPGA這個窄眾市場激烈的競爭者，然而Peter Larson基于對兩個公司現(xiàn)金流折現(xiàn)法的研究表明，賽靈思是目前FPGA市場的絕對領(lǐng)先者。(http://seekingalpha.com/article/2008621-xilinx-appears-
關(guān)鍵字：賽靈思 Altera FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

FPGA：縱向創(chuàng)新與橫向整合引領(lǐng)變革

FPGA在先進(jìn)工藝路上的狂飚猛進(jìn)帶來了如影隨形的挑戰(zhàn)：一方面，進(jìn)入20nm和14nm階段后，不光是FPGA復(fù)雜度提升，對其外圍的電源管理等芯片也提出了“與時俱進(jìn)”的要求。另一方面，隨著SoC FPGA和3D IC技術(shù)
關(guān)鍵字： FPGA 創(chuàng)新 FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

基于FPGA的多通道高速采樣系統(tǒng)設(shè)計

摘要：旋轉(zhuǎn)機(jī)械的振動監(jiān)測，對于機(jī)械的安全運(yùn)行和提高設(shè)備利用率有重大意義。利用FPGA的并行處理能力，采用高速可編程FPGA模塊和嵌入式開發(fā)的結(jié)合方式，提出了一種基于FPGA的高速、多通道、同步采樣實現(xiàn)方法。闡述了
關(guān)鍵字： FPGA 高速采樣并行處理自定義指令

基于FPGA的視頻圖像畫面分割器設(shè)計

摘要：為了解決在一個屏幕上收看多個信號源的問題，對基于FPGA技術(shù)的視頻圖像畫面分割器進(jìn)行了研究。研究的主要特色在于構(gòu)建了以FPGA為核心器件的視頻畫面分割的硬件平臺，首先，將DVI視頻信號，經(jīng)視頻解碼芯片轉(zhuǎn)換為
關(guān)鍵字： FPGA DDR2 SDRAM 視頻提取圖像合成

基于FPGA和ARM的視頻采集處理系統(tǒng)

摘要：設(shè)計了一種可進(jìn)行實時視頻采集、壓縮和傳輸?shù)囊曨l采集處理系統(tǒng)。該系統(tǒng)充分結(jié)合FPGA和ARM的硬件優(yōu)勢，實現(xiàn)了設(shè)備接口和視頻信號處理的全數(shù)字化，易與信號處理新技術(shù)相結(jié)合，系統(tǒng)結(jié)構(gòu)緊湊，體積小巧、響應(yīng)快速;
關(guān)鍵字： FPGA ARM 視頻采集處理

采用FPGA設(shè)計智能能源系統(tǒng)

智能電網(wǎng)的目標(biāo)是更高效的管理電力傳送，以滿足我們?nèi)找嬖鲩L的能源需求。但是在實現(xiàn)的道路上會遇到一些困難。不斷發(fā)展的標(biāo)準(zhǔn)。高可靠性要求。低成本實現(xiàn)。雙向通信以支持實時傳輸。復(fù)雜的電能監(jiān)視和控制。通用性要求
關(guān)鍵字： FPGA 智能能源系統(tǒng)

FPGA開發(fā)靜態(tài)無功補(bǔ)償控制器

“我們在NI CompactRIO平臺上開發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時間又保證了系統(tǒng)的穩(wěn)定性。”
挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時也帶來了無功分量和高次諧波等危害
關(guān)鍵字： FPGA 靜態(tài) 控制器

電子設(shè)計發(fā)展趨勢 ― 開源PCB設(shè)計

電子設(shè)計領(lǐng)域的一大趨勢是開源硬件及其配套的開源原理圖和PCB布局圖的使用。使用開源硬件及其配套資源意味著工程師可以方便地使用現(xiàn)有設(shè)計方案，從而提高效率并縮短產(chǎn)品上市時間。隨著工程師更加深入地了解傳統(tǒng)PCB與
關(guān)鍵字：開源 PCB FPGA

基于FPGA多波束成像的聲納系統(tǒng)設(shè)計

摘要：給出了一種基于FPGA的多波束成像聲納整機(jī)的硬件電路設(shè)計方案，介紹了該方案中各分系統(tǒng)的具體電路實現(xiàn)，以Xilinx公司的FPGA芯片作為核心器件，根據(jù)干端PC下發(fā)的控制指令實現(xiàn)對180個基元的發(fā)射接收電路的控制，完
關(guān)鍵字：多波束成像聲納發(fā)射接收電路波束形成器千兆網(wǎng)傳輸控制指令 FPGA

基于CPLD/FPGA的出租車計費(fèi)器系統(tǒng)的設(shè)計實現(xiàn)

1 引言隨著EDA技術(shù)的發(fā)展及大規(guī)?？删幊踢壿嬈骷﨏PLD/FPGA的出現(xiàn)，電子系統(tǒng)的設(shè)計技術(shù)和工具發(fā)生了巨大的變化，通過EDA技術(shù)對CPLD/FP-GA編程開發(fā)產(chǎn)品，不僅成本低、周期短、可靠性高，而且可隨時在系統(tǒng)中修改其邏輯功
關(guān)鍵字： CPLD FPGA 出租車計費(fèi)器

低功耗FPGA設(shè)計技術(shù)

一、前言隨著系統(tǒng)功率預(yù)算的不斷緊縮，迫切需要新型低功率元器件。對通信基礎(chǔ)設(shè)施而言，電路板冷卻、機(jī)箱體積小型化以及系統(tǒng)可靠性在系統(tǒng)設(shè)計中都起著重要的作用。對e-應(yīng)用，電池壽命、熱耗散和小體積尺寸是主要的設(shè)
關(guān)鍵字： FPGA 低功耗

基于DM648+FPGA的圖像處理模塊設(shè)計與實現(xiàn)

摘要：介紹了一種基于DM648和FPGA構(gòu)架的圖像處理方案，闡述了圖像處理模塊的組成原理和結(jié)構(gòu)，并對模塊內(nèi)部電路設(shè)計和FPGA內(nèi)部圖像處理邏輯進(jìn)行了重點(diǎn)介紹。木文設(shè)計的圖像處理模塊能夠支持對高清視頻圖像的切割、縮放
關(guān)鍵字： DM648 FPGA 視頻圖像處理

基于FPGA的北斗QPSK調(diào)制實現(xiàn)與解調(diào)驗證

摘要為研制北斗衛(wèi)星導(dǎo)航模擬信號源，設(shè)計實現(xiàn)了北斗QPSK信號調(diào)制器。文中在分析了北斗衛(wèi)星導(dǎo)航系統(tǒng)B1頻段信號的正交相移鍵控調(diào)制信號的基礎(chǔ)上，基于軟件無線電的思想，在FPGA硬件平臺上實現(xiàn)了QPSK信號調(diào)制器，通過
關(guān)鍵字：北斗 QPSK 調(diào)制解調(diào) FPGA StratixⅡ

基于FPGA的大圍數(shù)QC_LDPC碼的譯碼器

摘要針對QC_LDPC碼的短環(huán)對碼性能的重要影響，采用了1種圍數(shù)為8的QC_LDPC碼設(shè)計。算法首先分別對3個不同的子矩陣進(jìn)行移位運(yùn)算，每個子矩陣分別與它們移位后生成的子矩陣共同組合形成1個新的子矩陣，然后再將新生成
關(guān)鍵字： QC_LDPC碼校驗矩陣分層迭代譯碼算法 FPGA

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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細(xì) ]