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意法半導(dǎo)體(ST)與米蘭理工大學(xué)通過(guò)PFGA合作開(kāi)發(fā)FASTER 3D圖形應(yīng)用系統(tǒng)

　　橫跨多重電子應(yīng)用領(lǐng)域、全球領(lǐng)先的半導(dǎo)體供應(yīng)商意法半導(dǎo)體(STMicroelectronics，簡(jiǎn)稱ST)宣布對(duì)基于射線跟蹤 (ray-tracing) 技術(shù)的實(shí)驗(yàn)性3D圖形應(yīng)用系統(tǒng)進(jìn)行測(cè)試驗(yàn)證。該解決方案采用一顆與現(xiàn)場(chǎng)可編程門陣列 (FPGA, Field-Programmable Gate Array) 相連、基于ARM®處理器的測(cè)試芯片。FASTER 研發(fā)項(xiàng)目以“簡(jiǎn)化分析合成技術(shù)，實(shí)現(xiàn)有效配置”為目標(biāo)，是意法半導(dǎo)體與米蘭理工大學(xué) (Politecnico di Mi
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【從零開(kāi)始走進(jìn)FPGA】創(chuàng)造平臺(tái)——Quartus II 11.0 套件安裝指南

　　一、Altera Quartus II 11.0套件介紹　　所謂巧婦難為無(wú)米之炊，再?gòu)?qiáng)的軟硬件功底，再多的思維創(chuàng)造力，沒(méi)有軟件的平臺(tái)，也只是徒勞。因此，一切創(chuàng)造的平臺(tái)——Quartus II 軟件安裝，由零開(kāi)啟的世界，便從此開(kāi)始。　　自從Bingo 2009年開(kāi)始接觸FPGA，Quartus II 版本的軟件從n年前的5.1版本到今天的最新發(fā)布的11.0，都使用過(guò);當(dāng)然對(duì)于軟件核心構(gòu)架而言，萬(wàn)變不離其宗。雖然多多少少有點(diǎn)bug，但這10多個(gè)版本發(fā)展到了現(xiàn)在，能看到Alt
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零基礎(chǔ)學(xué)FPGA（七）淺談狀態(tài)機(jī)

　　今天我們來(lái)寫(xiě)狀態(tài)機(jī)。　　關(guān)于狀態(tài)機(jī)呢，想必大家應(yīng)該都接觸過(guò)，通俗的講就是數(shù)電里我們學(xué)的狀態(tài)轉(zhuǎn)換圖。狀態(tài)機(jī)分為兩中類型，一種叫Mealy型，一種叫Moore型。前者就是說(shuō)時(shí)序邏輯的輸出不僅取決于當(dāng)前的狀態(tài)，還取決于輸入，而后者就是時(shí)序邏輯的輸出僅僅取決于當(dāng)前的狀態(tài)。下面兩個(gè)圖分別表示兩種不同的狀態(tài)機(jī)。　　 ? 　　 ? 　　下面我們就通過(guò)代碼來(lái)寫(xiě)一下?tīng)顟B(tài)機(jī)，以下面的狀態(tài)轉(zhuǎn)換圖為例　　 ? 　　首先，是一種典型的狀態(tài)機(jī)寫(xiě)法，這種寫(xiě)法我們稱為
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零基礎(chǔ)學(xué)FPGA（六）今天講習(xí)題

　　習(xí)題呢，來(lái)自夏雨聞老師的那本教材，就挑幾個(gè)感覺(jué)自己做著有點(diǎn)難度的寫(xiě)寫(xiě)吧　　 ? 　　這個(gè)題呢剛開(kāi)始我是沒(méi)看明白，記得書(shū)上只講了我們習(xí)慣上的用法，這種用法我是沒(méi)見(jiàn)過(guò)，問(wèn)了下別人才知道，Verilog中一般是左高右低。第一個(gè)沒(méi)問(wèn)題，第二個(gè)，input [0:2] IP,習(xí)慣上我們這樣寫(xiě) input [2:0] IP，這里兩個(gè)是等價(jià)的，即表示第0 .1 .2 三位。第三個(gè)，wire [16:23] A,也是，左高右低，表示第16.17.....22. 23位，左高右低就這樣記就好了。
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基于MicroBlaze軟核的FPGA片上系統(tǒng)設(shè)計(jì)

　　Xilinx公司的MicroBlaze 32位軟處理器核是支持CoreConnect總線的標(biāo)準(zhǔn)外設(shè)集合。MicroBlaze處理器運(yùn)行在150MHz時(shí)鐘下，可提供125 D-MIPS的性能，非常適合設(shè)計(jì)針對(duì)網(wǎng)絡(luò)、電信、數(shù)據(jù)通信和消費(fèi)市場(chǎng)的復(fù)雜嵌入式系統(tǒng)。　　1 MicroBlaze的體系結(jié)構(gòu) 　　MicroBlaze 是基于Xilinx公司FPGA的微處理器IP核，和其它外設(shè)IP核一起，可以完成可編程系統(tǒng)芯片(SOPC)的設(shè)計(jì)。MicroBlaze 處理器采用RISC架構(gòu)和哈佛結(jié)構(gòu)的32位指令和
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基于MicroBlaze嵌入式Web服務(wù)器設(shè)計(jì)

　　1 引言　　由于Internet技術(shù)的滲透，嵌入式系統(tǒng)正變得越來(lái)越智能化并具有越來(lái)越多的網(wǎng)絡(luò)友好特性。Web技術(shù)的飛速發(fā)展，給嵌入式系統(tǒng)進(jìn)入Internet提供絕佳的途徑。在現(xiàn)場(chǎng)儀表和企業(yè)設(shè)備層應(yīng)用嵌入式技術(shù)是企業(yè)監(jiān)控系統(tǒng)的發(fā)展趨勢(shì)。與現(xiàn)場(chǎng)總線技術(shù)相比，嵌入式技術(shù)不僅為開(kāi)發(fā)者提供了大量的工具和函數(shù)庫(kù)，而且減少了傳統(tǒng)的客戶端，減少了二次開(kāi)發(fā)的工作量;而把嵌入式技術(shù)和Internet技術(shù)結(jié)合起來(lái)，使得整個(gè)工控網(wǎng)絡(luò)易于和Internet實(shí)現(xiàn)無(wú)縫連接;現(xiàn)在多數(shù)企業(yè)控制網(wǎng)絡(luò)是通過(guò)專用線路進(jìn)行數(shù)據(jù)通信，其通信
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基于MicroBlaze軟核的液晶驅(qū)動(dòng)程序設(shè)計(jì)

　　1 MicroBlaze的體系結(jié)構(gòu) 　　MicroBlaze采用功能強(qiáng)大的32位流水線結(jié)構(gòu)，包含32個(gè)32位通用寄存器和1個(gè)可選的32位移位器，時(shí)鐘頻率可達(dá)150 MHz;在Virrex一4 FPGA上運(yùn)行速率高達(dá)120 DMIPS，僅占用Virtex—II Pro FPGA中的950個(gè)邏輯單元。MicroBlaze軟核的結(jié)構(gòu)框圖如圖1所示。它具有以下基本特征：　?、?2個(gè)32位通用寄存器和2個(gè)專用寄存器(程序計(jì)數(shù)器和狀態(tài)標(biāo)志寄存器)。　?、?2位指令系統(tǒng)，支持3個(gè)操作數(shù)和2種尋
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Microblaze在RFID閱讀器的軟硬件設(shè)計(jì)中的應(yīng)用

　　引言　　RFID 技術(shù)是從 20 世紀(jì) 80 年代走向成熟的一項(xiàng)自動(dòng)識(shí)別技術(shù)，近年來(lái)發(fā)展十分迅速。目前，在全世界，基于 RFID 技術(shù)的電子標(biāo)簽，使用已經(jīng) 非常廣泛了，這主要取決于它的特性，RFID 標(biāo)簽可以使用在幾乎所有的物理對(duì)象上。RFID 技術(shù)在工業(yè)自動(dòng)化，物體跟蹤，交通運(yùn)輸控制管理，防偽校園卡，電子錢包，行李標(biāo)簽，收費(fèi)系統(tǒng)，醫(yī)用裝置，電子物品的監(jiān)控和軍事用途等方面已經(jīng)得到了廣泛的應(yīng)用。例如第二代居民身份證，使用基于 ISO/IEC4443-B 標(biāo)準(zhǔn)的 13.56 MHz 電子標(biāo)簽，
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基于MicroBlaze的16點(diǎn)fft的設(shè)計(jì)實(shí)現(xiàn)

　　一、MicroBlaze的體系結(jié)構(gòu) 　　MicroBlaze是基于Xilinx 公司FPGA 的微處理器IP 核和其它外設(shè)IP 核一起可以完成可編程系統(tǒng)芯片(SOPC)的設(shè)計(jì)MicroBlaze 處理器采用RISC 架構(gòu)和哈佛結(jié)構(gòu)的32位指令和數(shù)據(jù)總線可以全速執(zhí)行存儲(chǔ)在片上存儲(chǔ)器和外部存儲(chǔ)器中的程序并訪問(wèn)其中的數(shù)據(jù)。　　(1)內(nèi)部結(jié)構(gòu)。MicroBlaze 內(nèi)部有32個(gè)32位通用寄存器和2 個(gè)32位特殊寄存器——PC指針和MSR狀態(tài)標(biāo)志寄存器。為了提高性能，MicroBl
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基于SOPC的通用型JTAG調(diào)試器的設(shè)計(jì)

　　SOPC技術(shù)的發(fā)展，給仿真器指出了新的發(fā)展方向。所謂SOPC技術(shù)，就是指用可編程技術(shù)將整個(gè)系統(tǒng)放在一塊硅片上。在傳統(tǒng)設(shè)計(jì)中電路級(jí)相互獨(dú)立的各個(gè)系統(tǒng)被集成到一塊FPGA芯片中。　　SOPC的可重用性是一種先進(jìn)的設(shè)計(jì)思想。為了降低用戶的負(fù)擔(dān)，避免重復(fù)勞動(dòng)，將一些在數(shù)字電路中常用但比較復(fù)雜的功能模塊，比如SDRAM控制器等，設(shè)計(jì)成可修改參數(shù)的模塊，用戶在設(shè)計(jì)系統(tǒng)時(shí)可以直接調(diào)用這些模塊。這些特定的功能模塊被稱為IPcore(知識(shí)產(chǎn)權(quán)核)。由于IPcore通常是很成熟的，因此降低了開(kāi)發(fā)風(fēng)險(xiǎn)。　　本文利用
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基于Flash和JTAG接口的FPGA多配置系統(tǒng)

　　引言　　針對(duì)需要切換多個(gè)FPGA配置碼流的場(chǎng)合， Xilinx公司提出了一種名為System ACE的解決方案，它利用CF(Compact Flash)存儲(chǔ)卡來(lái)替代配置用PROM，用專門的ACE控制芯片完成CF卡的讀寫(xiě)，上位機(jī)軟件生成專用的ACE文件并下載到CF存儲(chǔ)卡中，上電后通過(guò)ACE控制芯片實(shí)現(xiàn)不同配置碼流間的切換[1]。　　System ACE的解決方案需要購(gòu)買CF存儲(chǔ)卡和專用的ACE控制芯片，增加了系統(tǒng)搭建成本和耗費(fèi)了更多空間，而且該方案只能實(shí)現(xiàn)最多8個(gè)配置文件的切換，在面對(duì)更多個(gè)配置
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【從零開(kāi)始走進(jìn)FPGA】前言：哪些人適合做FPGA開(kāi)發(fā)?

　　“FPGA目前非?；?，各個(gè)高校也開(kāi)了FPGA的課程，但是FPGA并不是每個(gè)人都適合，F(xiàn)PGA講究的是一個(gè)入道，入什么道，入電子設(shè)計(jì)的道，就是說(shuō)，這個(gè)過(guò)程，你得從電子設(shè)計(jì)開(kāi)始，然后再學(xué)FPGA，而不是先從VHDL/Verilog開(kāi)始，直接跳過(guò)數(shù)電模電。這一點(diǎn)非常重要，這涉及到你以后的發(fā)展高度的問(wèn)題。我是過(guò)來(lái)人，我深刻體會(huì)到FPGA與數(shù)電模電的基礎(chǔ)的深層次聯(lián)系。對(duì)于本科生而言，你可以把FPGA當(dāng)作業(yè)余興趣，但不要把它當(dāng)成今后的飯碗，你可以保持這個(gè)興趣直到研究生讀完。從我招聘的情況來(lái)看，做FPG
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奧迪在量產(chǎn)車中選用Altera SoC FPGA，實(shí)現(xiàn)“導(dǎo)航駕駛”功能

　　Altera公司今天宣布，奧迪的高級(jí)輔助駕駛系統(tǒng)(ADAS)選用其SoC現(xiàn)場(chǎng)可編程門陣列(FPGA)，實(shí)現(xiàn)量產(chǎn)。奧迪是自動(dòng)駕駛汽車技術(shù)的領(lǐng)先者，奧地利高科技公司TTTech則是奧迪中央輔助駕駛控制單元zFAS的核心開(kāi)發(fā)合作伙伴，他們選擇了Altera® Cyclone® V SoC FPGA幫助提高其系統(tǒng)性能，突出奧迪在導(dǎo)航駕駛和駐車方面的優(yōu)勢(shì)，而這些是專用標(biāo)準(zhǔn)產(chǎn)品(ASSP)解決方案無(wú)法實(shí)現(xiàn)的。　　Altera的Cyclone V SoC FPGA結(jié)合了可編程邏輯和雙核ARM C
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基于FPGA的FIR濾波器的誤差分析

　　數(shù)字濾波器作為數(shù)字信號(hào)處理技術(shù)的重要組成部分之一,已廣泛應(yīng)用于信號(hào)分離、恢復(fù)、整形等重要場(chǎng)合。在工程實(shí)踐中,往往要求對(duì)信號(hào)處理要有實(shí)時(shí)性和靈活性,而基于FPGA的FIR濾波器因其嚴(yán)格的線性相位和簡(jiǎn)單的設(shè)計(jì)步驟而應(yīng)用廣泛。本文不僅對(duì)基于FPGA設(shè)計(jì)的FIR濾波器進(jìn)行了簡(jiǎn)單的誤差分析,包括絕對(duì)誤差與相對(duì)誤差分析;而且還做出了該濾波器的頻譜,通過(guò)與MATLAB中仿真出的頻譜進(jìn)行比較分析,驗(yàn)證了該濾波器在工程應(yīng)用中是適應(yīng)的,滿足了設(shè)計(jì)的要求。　　基于FPGA的FIR濾波器的誤差分析.pdf
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基于FPGA的FIR數(shù)字濾波器設(shè)計(jì)與仿真

　　實(shí)現(xiàn)數(shù)字化是控制系統(tǒng)的重要發(fā)展方向，而數(shù)字信號(hào)處理已在通信、語(yǔ)音、圖像、自動(dòng)控制、雷達(dá)、軍事、航空航天等領(lǐng)域廣泛應(yīng)用。數(shù)字信號(hào)處理方法通常涉及變換、濾波、頻譜分析、編碼解碼等處理。數(shù)字濾波是重要環(huán)節(jié)，它能滿足濾波器對(duì)幅度和相位特性的嚴(yán)格要求，克服模擬濾波器所無(wú)法解決的電壓和溫度漂移以及噪聲等問(wèn)題。而有限沖激響應(yīng)FIR濾波器在設(shè)計(jì)任意幅頻特性的同時(shí)能夠保證嚴(yán)格的線性相位特性。利用FPGA可以重復(fù)配置高精度的FIR濾波器，使用VHDL硬件描述語(yǔ)言改變?yōu)V波器的系數(shù)和階數(shù)，并能實(shí)現(xiàn)大量的卷積運(yùn)算算法。結(jié)合MA
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