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基于FPGA的電控單元噴油脈寬處理

  • 由于電控汽油機在燃用不同比例甲醇汽油時受空燃比自適應(yīng)調(diào)整的限制而不能正常運轉(zhuǎn)的問題，提出利用FPGA技術(shù)將電控單元輸出的噴油脈寬信號進行擴展處理，使得電控汽油機在燃用不同比例甲醇汽油時，空燃比能夠維持在理論空燃比附近，從而使得電控汽油機能夠正常運轉(zhuǎn)。本系統(tǒng)采用Altera公司的Cyclone系列FPGA芯片EP1C12Q240C8N，在Quatus II開發(fā)環(huán)境中給出硬件設(shè)計和功能仿真。經(jīng)過測試，系統(tǒng)滿足對噴油脈寬信號的擴展處理要求且系統(tǒng)性能穩(wěn)定。
  • 關(guān)鍵字： 空燃比  噴油脈寬  FPGA  

基于FPGA和ADS7890的高速AD轉(zhuǎn)換

  • 在雷達設(shè)計中，需要對接收到的信號首先進行模數(shù)轉(zhuǎn)換，其轉(zhuǎn)換速度和準確性直接決定了之后FFT等運算的準確性，最終影響雷達測量精度。介紹了一種基于FPGA，利用芯片ADS7890實現(xiàn)一種快速14位串行AD轉(zhuǎn)換，對系統(tǒng)的軟件和硬件做了說明。硬件部分主要為ADS7890的基本外圍電路以及芯片EP2C35F672C與其的控制連接，軟件部分利用Quartus II 8．0編程。
  • 關(guān)鍵字： AD轉(zhuǎn)換  毫米波雷達測距  FPGA  

基于FPGA步進電機驅(qū)動控制系統(tǒng)的設(shè)計

  • 通過對步進電機的驅(qū)動控制原理的分析，利用Verilog語言進行層次化設(shè)計，最后實現(xiàn)了基于FPGA步進電機的驅(qū)動控制系統(tǒng)。該系統(tǒng)可以實現(xiàn)步進電機按既定角度和方向轉(zhuǎn)動及定位控制等功能。仿真和綜合的結(jié)果表明，該系統(tǒng)不但可以達到對步進電機的驅(qū)動控制，同時也優(yōu)化了傳統(tǒng)的系統(tǒng)結(jié)構(gòu)，提高了系統(tǒng)的抗干擾能力和穩(wěn)定性，可用于工業(yè)自動化、辦公自動化等應(yīng)用場合。
  • 關(guān)鍵字： 步進電機  Verilog  FPGA  

基于FPGA的水聲信號高速采集存儲系統(tǒng)設(shè)計

  • 介紹了一種基于FPGA的水聲信號數(shù)據(jù)采集與存儲系統(tǒng)的設(shè)計與實現(xiàn)，給出了系統(tǒng)的總體方案，并對各部分硬件和軟件的設(shè)計進行了詳細描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心，以存儲容量達2GB的大容量NAND型Flash作為存儲介質(zhì)。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊和RS～232串行通信模塊組成，具有穩(wěn)定可靠、體積小、功耗低、存儲容量大等特點，實驗證明該系統(tǒng)滿足設(shè)計要求。
  • 關(guān)鍵字： 水聲信號數(shù)據(jù)采集  NANDFlash  FPGA  

基于FPGA的實時數(shù)字化光纖傳輸系統(tǒng)的設(shè)計與實現(xiàn)

  • 提出一種實時數(shù)字化光纖傳輸系統(tǒng)，該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A／D轉(zhuǎn)換器將輸入的模擬信號數(shù)字化，再用FPGA對數(shù)據(jù)進行處理，并通過光纖傳輸。同時，F(xiàn)PGA還控制A／D轉(zhuǎn)換器的工作。接收端用串行收發(fā)器TLK1501對接收數(shù)據(jù)進行解碼處理，還原有效信號。實驗表明，該系統(tǒng)實時性好、信號傳輸誤碼率低、工作性能穩(wěn)定、抗干擾性強，系統(tǒng)具有可行性和有效性。
  • 關(guān)鍵字： 光纖通訊  高速數(shù)字信號傳輸  FPGA  

基于FPGA的固定倍率圖像縮放的實現(xiàn)

  • 基于FPGA硬件實現(xiàn)固定倍率的圖像縮放，將2維卷積運算分解成2次1維卷積運算，對輸入原始圖像像素先進行行方向的卷積，再進行列方向的卷積，從而得到輸出圖像像素。把圖像縮放過程設(shè)計為一個單元體的循環(huán)過程，在單元體內(nèi)部，事先計算出卷積系數(shù)。降低了FPGA設(shè)計的復(fù)雜性，提高了圖像縮放算法的運算速度，增強了系統(tǒng)的實時性，已經(jīng)應(yīng)用于某款航空電子產(chǎn)品中，應(yīng)用效果良好。
  • 關(guān)鍵字： 圖像縮放  卷積運算  FPGA  

基于FPGA的同步FIFO在大幅面高速彩色噴繪機噴頭數(shù)據(jù)傳輸中的應(yīng)用

  • 研究了基于FPGA的同步FIFO和移位寄存器，利用同步FIFO作為大幅面高速彩色噴繪機噴頭與上位機之間數(shù)據(jù)傳輸以及接口數(shù)據(jù)傳輸?shù)木彺婺K。該設(shè)計在保證數(shù)據(jù)傳輸實時性的前提下，解決了噴頭和上位機像素數(shù)據(jù)格式方向不一致的問題，并消除了部分數(shù)據(jù)冗余。
  • 關(guān)鍵字： 同步FIFO  彩色噴繪機  FPGA  

基于FPGA的電梯控制器的設(shè)計與實現(xiàn)

  • 介紹了基于Altera公司EP1K30TC144芯片的電梯控制器設(shè)計過程，描述了該控制系統(tǒng)的功能。該設(shè)計采用VHDL語言進行編程，以QUARTUSⅡ軟件為開發(fā)平臺，對本設(shè)計進行了仿真，并使用JTAG將程序代碼下載到實驗板上進行了硬件驗證。
  • 關(guān)鍵字： JTAG  電梯控制器  FPGA  

基于FPGA的水聲信號高速采集存儲系統(tǒng)的設(shè)計與實現(xiàn)

  • 介紹了一種基于FPGA的水聲信號數(shù)據(jù)采集與存儲系統(tǒng)的設(shè)計與實現(xiàn),給出了系統(tǒng)的總體方案,并對各部分硬件和軟件的設(shè)計進行了詳細描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心,以存儲容量達2 GB的大容量NAND型Flash作為存儲介質(zhì)。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊和RS-232串行通信模塊組成,具有穩(wěn)定可靠、體積小、功耗低、存儲容量大等特點,實驗證明該系統(tǒng)滿足設(shè)計要求。
  • 關(guān)鍵字： 數(shù)據(jù)采集  Flash  FPGA  

用FPGA內(nèi)部集成的DSP實現(xiàn)圖像處理的實例分析

  • intevac是商用和軍用市場光學(xué)產(chǎn)品的前沿開發(fā)商。本文介紹該公司nightvista嵌入式電子系統(tǒng)的開發(fā)，該產(chǎn)品是高性能超低亮度緊湊型攝像機。該攝像機最初采用了流行的數(shù)字信號處理器、幾個assp和外部存儲器件。系統(tǒng)對性能的需求越來越高，工程師團隊決定試驗一種替代方案——在可編程邏輯中實現(xiàn)可配置軟核處理器。
  • 關(guān)鍵字： 圖像處理  NIOS  FPGA  

FPGA系統(tǒng)調(diào)試問題及提高調(diào)試效率的方法

  • 本文就調(diào)試FPGA系統(tǒng)時遇到的問題及有助于提高調(diào)試效率的方法，針對Altera和Xilinx的FPGA調(diào)試提供了最新的方法和工具。
  • 關(guān)鍵字： 邏輯分析儀  測試內(nèi)核  FPGA  

基于FPGA的線陣CCD器件驅(qū)動器及其系統(tǒng)控制邏輯時序的設(shè)計

  • 介紹一種基于FPGA設(shè)計線陣CCD器件TCDl208AP復(fù)雜驅(qū)動電路和整個CCD的電子系統(tǒng)控制邏輯時序的方法，并給出時序仿真波形。工程實踐結(jié)果表明，該驅(qū)動電路結(jié)構(gòu)簡單、功耗小、成本低、抗干擾能力強，適應(yīng)工程小型化的要求。
  • 關(guān)鍵字： 時序綜合分析  CCD  FPGA  

FPGA低功耗設(shè)計小貼士

  • 采用FPGA進行低功耗設(shè)計并不是一件容易的事，盡管有許多方法可以降低功耗。FPGA的類型、IP核、系統(tǒng)設(shè)計、軟件算法、功耗分析工具及個人設(shè)計方法都會對產(chǎn)品功耗產(chǎn)生影響。值得注意的是，如果使用不當(dāng)，有些方法反而會增加功耗，因此必須根據(jù)實際情況選擇適當(dāng)?shù)脑O(shè)計方法。
  • 關(guān)鍵字： 功率估算  結(jié)構(gòu)設(shè)計  FPGA  

基于NIOS Ⅱ處理器的數(shù)字信號解碼器設(shè)計

  • 介紹了一種基于NIOS Ⅱ?qū)崿F(xiàn)數(shù)字信號解碼器的方法，該系統(tǒng)由FPGA 和相應(yīng)接口電路組成，將NIOS Ⅱ嵌入式軟核CPU 集成到FPGA 中構(gòu)成片上系統(tǒng)( SOC) ，可以將串行輸入的不歸零PCM 碼轉(zhuǎn)換為可分析的8 位并行碼，并通過上位機軟件顯示解碼結(jié)果。
  • 關(guān)鍵字： 數(shù)字信號解碼器  嵌入式軟核CPU  FPGA  

基于FPGA的GSM系統(tǒng)直放站數(shù)字選頻器設(shè)計

  • 提出了一種基于FPGA的數(shù)字選頻器設(shè)計方案，該數(shù)字選頻器應(yīng)用于八通道的GSM系統(tǒng)直放站，采用低成本的FPGA芯片Xilink Spartan-3A DSP XC3SD3400A進行數(shù)字信號處理。給出了較詳細的硬件設(shè)計方案，并通過Agilent Technologies N5230A網(wǎng)絡(luò)分析儀對數(shù)字選頻器進行了測量，被選出的有效相鄰信道之間的最小間隔能達到1MHz，能夠?qū)崿F(xiàn)較好的選頻功能，可滿足實際應(yīng)用的要求。
  • 關(guān)鍵字： 數(shù)字選頻器  MSP430  FPGA  
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