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Altera公開業(yè)界第一款集成了HBM2 DRAM和FPGA的異構(gòu)SiP器件

  • 　　Altera公司(Nasdaq)公開業(yè)界第一款異構(gòu)系統(tǒng)級封裝(SiP，System-in-Package)器件，集成了來自SK Hynix的堆疊寬帶存儲器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一類器件，其特殊的體系結(jié)構(gòu)設(shè)計滿足了高性能系統(tǒng)對存儲器帶寬最嚴格的要求。 　　數(shù)據(jù)中心、廣播、固網(wǎng)和高性能計算等系統(tǒng)要處理的數(shù)據(jù)量不斷攀升，需要的帶寬非常高。相對于目前的分立DRAM解決方案，Stratix 10 DRAM SiP的
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Altera公開業(yè)界第一款集成了HBM2 DRAM和FPGA的異構(gòu)SiP器件

  • 　　Altera公司今天公開業(yè)界第一款異構(gòu)系統(tǒng)級封裝(SiP，System-in-Package)器件，集成了來自SK Hynix的堆疊寬帶存儲器(HBM2)以及高性能Stratix® 10 FPGA和SoC。Stratix 10 DRAM SiP代表了新一類器件，其特殊的體系結(jié)構(gòu)設(shè)計滿足了高性能系統(tǒng)對存儲器帶寬最嚴格的要求。 　　數(shù)據(jù)中心、廣播、固網(wǎng)和高性能計算等系統(tǒng)要處理的數(shù)據(jù)量不斷攀升，需要的帶寬非常高。相對于目前的分立DRAM解決方案，Stratix 10 DRAM SiP的存儲器帶寬提
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小梅哥和你一起深入學(xué)習(xí)FPGA之串口調(diào)試（一）（下）

  • 　　以上為小梅哥為了對特權(quán)同學(xué)的串口收發(fā)模塊進行測試所展開的部分工作，到這里，仿真測試所需要的準(zhǔn)備工作我們就做好了，接下來將實際進行仿真，通過仿真來分析該模塊的性能?！　∵@里極力推薦大家使用modelsim進行仿真，因為quartusII自帶的仿真工具靈活性和功能都趕modelsim相差甚遠。Modelsim作為一款強大的仿真軟件，在業(yè)界被廣泛使用。同時，modelsim針對不同的EDA廠家，也推出了OEM版本，modelsim-altera就是為Altera公司開發(fā)的OEM版本，此版本針對Altera公
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小梅哥和你一起深入學(xué)習(xí)FPGA之串口調(diào)試（一）(上)

  • 　　大家好，這幾天在各個論壇上，經(jīng)常就有人在向我咨詢基于FPGA的串口通信代碼，大部分都是在網(wǎng)上下載一個現(xiàn)成的代碼，但是在使用中就遇到了各種問題，于是就發(fā)到了論壇上來求助。在閱讀了他們的代碼之后，我發(fā)現(xiàn)幾乎出自同一個版本(目前確定為特權(quán)同學(xué)的基于EPM240入門實驗的代碼)。他們在調(diào)試這個代碼的時候，經(jīng)常存在這樣幾個問題：1、部分人對該串口通訊模塊完全不理解，對每句話，甚至每個模塊的功能都不理解;2、部分人采用最原始的畫波形的方式來對該模塊進行仿真，結(jié)果無法得到仿真結(jié)果;3、部分人不會使用modelsim
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ASDF：精細粒度異構(gòu)助力創(chuàng)新， Altera將進入大FPGA時代

  • 　　“數(shù)十個合作伙伴，數(shù)百家客戶，數(shù)千計的工程師，這三股強大的力量構(gòu)成了Altera SoC大的生態(tài)系統(tǒng)，也是Altera在SoC領(lǐng)域投入5年所獲得的成就。”Altera公司嵌入式處理營銷資深總監(jiān)Chris Balough在一年一度的Altera SoC開發(fā)者大會上自豪地表示。 　　
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歐洲半導(dǎo)體第三季度銷量逆勢增長17.9％

  • 　　半導(dǎo)體銷售額通過產(chǎn)業(yè)分銷渠道在2015年第三季度達到了18.6億歐元，比2014年同季上升17.9%。據(jù)總部位于倫敦的歐洲半導(dǎo)體制造與分銷聯(lián)盟(DMASS)近日表示，這個銷售業(yè)績水平“令人驚訝”，因為夏季的銷量通常會有所下降。歐元對美元匯率起到了推動作用，DMASS聲稱該增長的絕大部分是有機增長，以兩位數(shù)遞增。 　　DMASS的董事長GeorgSteinberger指出：“今年肯定能突破70億，創(chuàng)造紀錄。盡管匯率的影響將很快消失，歐洲半導(dǎo)體的分銷商將繼續(xù)增長，盡管
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Altera榮獲Frost & Sullivan全球FPGA技術(shù)創(chuàng)新領(lǐng)先獎

  • 　　Altera公司榮獲分析公司Frost & Sullivan的全球FPGA技術(shù)創(chuàng)新領(lǐng)先獎，表彰Altera在技術(shù)特性和未來業(yè)務(wù)價值方面更勝一籌。該獎項彰顯Altera在其Arria® 10 FPGA中實現(xiàn)IEEE 754單精度硬核浮點DSP (數(shù)字信號處理)模塊——處理速率高達1.5 TFLOPS (每秒萬億次浮點運算)，進一步提高了數(shù)字系統(tǒng)設(shè)計的能效和生產(chǎn)效率。Altera的可編程器件幫助客戶針對大數(shù)據(jù)和搜索應(yīng)用、數(shù)據(jù)中心加速、軍事通信和高性能計算等需要高精度
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使用面向FPGA的OpenCL設(shè)計兩百萬點頻域濾波器

  • 快速傅里葉變換(FFT)是信號處理應(yīng)用的基礎(chǔ)。FPGA供應(yīng)商一直以來提供了運行良好的FFT庫，處理適配到FPGA片內(nèi)存儲器中的大量數(shù)據(jù)。但是，如果數(shù)據(jù)規(guī)模太大，應(yīng)該如何應(yīng)對? 為解決這一問題，F(xiàn)PGA設(shè)計人員現(xiàn)在必須要做出設(shè)計決定，這些決定互相糾纏在一起，例如，片內(nèi)FFT內(nèi)核的配置選擇，其數(shù)量，它們怎樣連接并訪問外部存儲器，多個內(nèi)核之間的同步等。分析所有這類設(shè)計決定就是要能夠很好的結(jié)合現(xiàn)有產(chǎn)品，在HDL中編程，這會非常耗時，而且?guī)砹诵阅軉栴}。采用OpenCL等高級編程語言，能夠很快的完成系統(tǒng)設(shè)計分析。本
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OpenPOWER+CAPI實現(xiàn)第二代分布計算

  • 本文介紹了CAPI技術(shù)，并給出基于CAPI應(yīng)用的三個案例。
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睿致科技選擇CEVA圖像和視覺DSP內(nèi)核 用于監(jiān)控和智能攝像機SoC

  • 　　全球領(lǐng)先的蜂窩通信、多媒體和無線連接DSP IP平臺授權(quán)廠商CEVA公司宣布臺灣領(lǐng)先的多媒體系統(tǒng)級芯片(system-on-chip, SoC)解決方案供應(yīng)商睿致科技(Vatics Inc.)已經(jīng)獲得了CEVA圖像和視覺 DSP 的授權(quán)許可，用于其針對安防監(jiān)控和智能網(wǎng)絡(luò)攝像機應(yīng)用的下一代SoC器件中。睿致科技將通過這款DSP內(nèi)核強大的計算機視覺和場景分析功能，大幅地提升圖像質(zhì)量并實現(xiàn)全新的智能監(jiān)控功能。 　　睿致科技副總裁Sor Shen表示：“在終端設(shè)備中增添智能視覺處理功能，可實現(xiàn)強
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在Xilinx FPGA上快速實現(xiàn)JESD204B

  • 　　簡介 　　JESD204是一種連接數(shù)據(jù)轉(zhuǎn)換器(ADC和DAC)和邏輯器件的高速串行接口，該標(biāo)準(zhǔn)的 B 修訂版支持高達 12.5 Gbps串行數(shù)據(jù)速率，并可確保 JESD204 鏈路具有可重復(fù)的確定性延遲。隨著轉(zhuǎn)換器的速度和分辨率不斷提升，JESD204B接口在ADI高速轉(zhuǎn)換器和集成RF收發(fā)器中也變得更為常見。此外，F(xiàn)PGA和ASIC中靈活的串行器/解串器(SERDES)設(shè)計正逐步取代連接轉(zhuǎn)換器的傳統(tǒng)并行LVDS/CMOS接口，并用來實現(xiàn) JESD204B物理層。本文介紹如何快速在Xilinx?
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Altera：通信領(lǐng)域，我們做得更好

  • 　　EEPW：我想了解一下Patrick Dorsey先生對英特爾收購了Altera的一些看法，其次就是Altera也是OpenPower的一個成員，因為加入了Intel之后，Altera這邊會不會繼續(xù)跟OpenPower合作。 　　Patrick Dorsey：就像您所說的，我們也是OpenPower機構(gòu)的一個成員。關(guān)于我們的看法，我們FPGA會繼續(xù)支持不同的架構(gòu)，包括ARM架構(gòu)，Power架構(gòu)還有Intel自己的架構(gòu)。 　　6月份我看我們的新聞發(fā)布宣布我們的OpenCL這個工具可以支持普通的架構(gòu)，
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基于DSP的自適應(yīng)濾波器的設(shè)計方案

  • 　　簡介：　根據(jù)自適應(yīng)濾波的原理，主要論述和分析了易于實現(xiàn)的最小均方差算法，通過比較IIR結(jié)構(gòu)和FIR結(jié)構(gòu)濾波器的優(yōu)缺點，采用橫向FIR結(jié)構(gòu)的自適應(yīng)濾波器來實現(xiàn)。為了滿足自適應(yīng)濾波的實時性要求，采用TMS320F28234芯片的系統(tǒng)設(shè)計，并設(shè)計了其硬件最小系統(tǒng)和軟件系統(tǒng)，最后用TMS320F28234實現(xiàn)自適應(yīng)濾波器。仿真結(jié)果表明，本方案的自適應(yīng)濾波器濾波效果優(yōu)越，具有較強的實用性。 　　0 引言 　　濾波是信號處理領(lǐng)域的一種最基本而又極其重要的技術(shù)。利用濾波技術(shù)可以從復(fù)雜的信號中提取所需要的信號，同
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Xilinx跨界擴張，五年預(yù)增5倍用戶

  • 編者按：五年來，Xilinx正經(jīng)歷轉(zhuǎn)型: 從FPGA供應(yīng)商到可以支持系統(tǒng)和軟件工程師的全可編程技術(shù)(All Programmable technology )公司，致力于未來五年內(nèi)增長5倍的潛在用戶，并為此推出了多處理器SoC和一系列軟件定義的設(shè)計環(huán)境。近日該公司的戰(zhàn)略規(guī)劃師Steve Glaser來華，向我們解釋了其構(gòu)想。
  • 關(guān)鍵字： xilinx  FPGA  全可編程  201510  

基于DSP的吉他音效器的設(shè)計與實現(xiàn)

  • 為使吉他在非聲學(xué)標(biāo)準(zhǔn)建筑內(nèi)達到較為完美的音質(zhì)和效果而設(shè)計一套基于數(shù)字信號處理器(Digital Signal Processer, DSP)的音效器。使用拾音器獲取吉他模擬音頻信號，經(jīng)轉(zhuǎn)換芯片成為數(shù)字信號后分幀輸入到DSP芯片的多通道緩沖同步串口，使用芯片完成最后音頻信號的數(shù)模轉(zhuǎn)換并輸出到音響。軟件方面主要使用內(nèi)存中定義的環(huán)形緩沖區(qū)從而以DSP的零消耗循環(huán)控制實現(xiàn)高效的延時，并使用嵌套的全通濾波器實現(xiàn)較好的混響功能。使用音頻硬件測試軟件RMAA(Right Mark Audio Analyzer)的測試結(jié)
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