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利用FPGA和新技術(shù)，使LCD進入HDTV市場

  • 高清晰TV（HDTV）是液晶顯示（LCD）技術(shù)的最新應(yīng)用領(lǐng)域，它比標(biāo)準LCD技術(shù)需要更高的分辨率，而數(shù)據(jù)速率和功耗也增加了。由于提高了數(shù)據(jù)速率，因此高速運動視頻需要專門的圖像處理算法。這些算法可以在現(xiàn)場可編程門陣列（FPGA）中實現(xiàn)，將數(shù)字視頻信號正確的轉(zhuǎn)換、映射在顯示面板上。 LCD設(shè)計人員采用FPGA，可以靈活的重新配置圖像處理算法，在相同硬件平臺上，使所有產(chǎn)品中不同尺寸的LCD能夠適應(yīng)不斷增加的數(shù)據(jù)速率。特別是在數(shù)字消費類市場上，F(xiàn)PGA能夠為數(shù)字電視和顯示提供最有效的成本、性能和靈活性均衡方案。
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在汽車娛樂電子中采用FPGA推動的參考設(shè)計

  • 汽車娛樂電子推動了功能和容量的快速發(fā)展，促使設(shè)計人員在性能、成本和靈活性上做出綜合考慮。與其他汽車電子領(lǐng)域不同，多媒體圖形應(yīng)用高度可視化，其需求多變，在許多情況下甚至還沒有建立標(biāo)準。汽車設(shè)計人員需要一個能夠提供最靈活、性能最佳而成本可控的解決方案?？删幊踢壿?，特別是現(xiàn)場可編程門陣列（FPGA）便是這樣的解決方案。 在以前，專用集成電路（ASIC）能夠為制造商提供成本效益較好的芯片方案，因此，汽車圖形應(yīng)用在半導(dǎo)體方面一般選用ASIC。但是，ASIC開發(fā)成本不斷攀升，降低批量價格、快速面市的要求以及功能復(fù)雜
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原型驗證過程中的ASIC到FPGA的代碼轉(zhuǎn)換

  • 在對ASIC設(shè)計進行FPGA原型驗證時，由于物理結(jié)構(gòu)不同，ASIC的代碼必須進行一定的轉(zhuǎn)換后才能作為FPGA的輸入 現(xiàn)代集成電路設(shè)計中，芯片的規(guī)模和復(fù)雜度正呈指數(shù)增加。尤其在ASIC設(shè)計流程中，驗證和調(diào)試所花的時間約占總工期的70%。為了縮短驗證周期,在傳統(tǒng)的仿真驗證的基礎(chǔ)上，涌現(xiàn)了許多新的驗證手段，如斷言驗證、覆蓋率驅(qū)動的驗證，以及廣泛應(yīng)用的基于現(xiàn)場可編程器件(FPGA)的原型驗證技術(shù)。 采用FPGA原型技術(shù)驗證ASIC設(shè)計，首先需要把ASIC設(shè)計轉(zhuǎn)化為FPGA設(shè)計。但ASIC是基于標(biāo)準單元庫，F(xiàn)P
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ADPCM語音編解碼電路設(shè)計及FPGA實現(xiàn)

  • 近年來，多媒體技術(shù)逐漸深入到人們的生活中。MP3播放器已經(jīng)成為流行的便攜式音頻播放設(shè)備，由于MP3編碼算法非常復(fù)雜，目前，一部分MP3播放器的錄音功能主要基于ADPCM算法和DSP來實現(xiàn)。本文闡述了ADPCM語音編解碼VLSI芯片的設(shè)計方法以及利用FPGA的硬件實現(xiàn)。 ADPCM算法及其編解碼器原理 ADPCM（Adaptive Differential Pulse Code Modulation，自適應(yīng)差分脈沖編碼調(diào)制）綜合了APCM的自適應(yīng)特性和DPCM系統(tǒng)的差分特性，是一種性能較好的波形編碼。它
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基于FPGA的前向糾錯算法

  • 研究數(shù)字音頻無線傳輸中的前向糾錯(FEC)算法的設(shè)計及實現(xiàn)，對前向糾錯中的主要功能模塊，如RS編解碼、交織器與解交織器等給出基本算法及基于現(xiàn)場可編程門陣列(FPGA)和硬件描述語言的解決方案。
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基于XC2V1000型FPGA的FIR抽取濾波器的設(shè)計

  • 介紹XC2V1000型現(xiàn)場可編程門陣列(FPGA)的主要特性和FIR抽取濾波器的工作原理，重點闡述用XC2V1000實現(xiàn)FIR抽取濾波器的方法，并給出仿真波形和設(shè)計特點。
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2006年，SEED成為美國賽靈思(Xilinx)的合作伙伴

  • 　　2006年，成為美國賽靈思(Xilinx)的合作伙伴，代理Xilinx FPGA的軟、硬件業(yè)務(wù)，積極推廣FPGA大學(xué)計劃。
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基于FPGA的生物芯片掃描儀的位置檢測

  • 詳細闡述了FPGA中辨向細分、可逆計數(shù)器，接口電路的設(shè)計實現(xiàn)，并給出了仿真波形。
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DSP和CPU在PMP方案中的比較

  • 　　芯片方案開發(fā)商如何選擇客戶？我認為主要從技術(shù)支持上來考慮，一些自身技術(shù)消化能力有限的客戶對技術(shù)服務(wù)要求多，方案設(shè)計公司要考慮有沒有人力去配套支持。所以中小規(guī)模的方案設(shè)計公司最好是選擇大廠做為目標(biāo)客戶。  　　對目前主流的PMP處理芯片解碼方式而言，象TI這類DSP軟核解碼以及Sigma Designs這樣的硬解碼的方案功能比較固定，缺乏靈活性。Intel的方案則強調(diào)平臺的概念，通過定制化來實現(xiàn)產(chǎn)品差異化，不過對技術(shù)支持的要求就相當(dāng)高。雖然從播放質(zhì)量看，硬解碼的效果優(yōu)于軟解碼，但PM
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降低FPGA設(shè)計的功耗是一種協(xié)調(diào)和平衡藝術(shù)

  • 目前許多終端市場對可編程邏輯器件設(shè)計的低功耗要求越來越苛刻。工程師們在設(shè)計如路由器、交換機、基站及存...
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Actel低功耗的FPGA系列靜態(tài)功耗僅為5µW

  • 　　Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場可編程門陣列 (FPGA) -- IGLOO™ 系列。這個以 Flash 為基礎(chǔ)的產(chǎn)品系列的靜態(tài)功耗為5µW，是最接近競爭產(chǎn)品功耗的四分之一；與目前領(lǐng)先的PLD產(chǎn)品比較，更可延長便攜式應(yīng)用的電池壽命達5倍，因而奠定了低功耗的新標(biāo)準。 　　   　　由于便攜式產(chǎn)品的生命周期短及市場競爭激烈，設(shè)計人員必需不斷增加新的功能和復(fù)雜性，但卻不能耗用
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XILINX宣布推出PLANAHEAD 8.2設(shè)計套件

  • 進一步擴展 65-NM VIRTEX-5 FPGA性能優(yōu)勢 新版軟件可提高性能、加快設(shè)計收斂速度并提供了更好的信號完整性分析能力  賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)宣布即日起推出PlanAhead™ 分層設(shè)計和分析軟件8.2版。新版軟件支持賽靈思公司最新的Virtex™-5 LX系列65nm FPGA器件。配合賽靈思公司的集成軟件環(huán)境（ISE͐
  • 關(guān)鍵字： 65nm  FPGA  ISE  PlanAhead  Virtex-5  Xilinx  單片機  嵌入式系統(tǒng)  賽靈思  通訊  網(wǎng)絡(luò)  無線  

基于FPGA的樂曲發(fā)生器設(shè)計

  • 本設(shè)計在美國ALTERA公司MAX + plusⅡ的EDA軟件平臺上，使用層次化設(shè)計方法，實現(xiàn)了樂曲發(fā)生器的設(shè)計。
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基于FPGA的誤碼率測試儀的設(shè)計與實現(xiàn)

基于DSP的蓄電池充放電裝置的設(shè)計

  • 介紹了一種利用TMS320LF2407來進行全數(shù)字控制，采用Buck―Boost雙象限電路作為充放電主電路的蓄電池充放電裝置。
  • 關(guān)鍵字： 裝置  設(shè)計  放電  蓄電池  DSP  基于  
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