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萊迪思發(fā)布一系列異構(gòu)網(wǎng)絡(luò)解決方案

  • 2013年11月6日，萊迪思半導(dǎo)體公司(NASDAQ: LSCC)發(fā)布了一系列可編程解決方案用以構(gòu)建智能、低功耗的移動設(shè)備，支持異構(gòu)網(wǎng)絡(luò)(HetNet)的全球性推廣。與Azcom Technology合作，萊迪思的HetNet解決方案系列使系統(tǒng)設(shè)計(jì)人員能夠?qū)崿F(xiàn)一流的互連、控制路徑和電源管理解決方案，同時使用多模式LTE小型蜂窩的系統(tǒng)級參考設(shè)計(jì)加快設(shè)計(jì)開發(fā)。
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Altera Quartus II軟件v13.1編譯時間縮短70%

  • Altera公司 (NASDAQ: ALTR)日前宣布發(fā)布Quartus? II軟件13.1版，通過大幅度優(yōu)化算法以及增強(qiáng)并行處理，與前一版本相比，編譯時間平均縮短了30%，最大達(dá)到70%，進(jìn)一步擴(kuò)展了在軟件效能方面的業(yè)界領(lǐng)先優(yōu)勢。軟件還包括最新的快速重新編譯特性，適用于客戶對Altera Stratix? V FPGA設(shè)計(jì)進(jìn)行少量源代碼改動的情形。
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基于FPGA和DSP的機(jī)載高清視頻圖像系統(tǒng)

  • 引言無人機(jī)廣泛應(yīng)用于軍事偵察以及民用測繪等領(lǐng)域，其中的機(jī)載視頻圖像系統(tǒng)是機(jī)載電子系統(tǒng)中的重要環(huán)節(jié)之一。...
  • 關(guān)鍵字： FPGA  DSP  

Altera Quartus II軟件v13.1編譯時間縮短70%

  • 　　Altera公司 (NASDAQ: ALTR)今天宣布發(fā)布Quartus? II軟件13.1版，通過大幅度優(yōu)化算法以及增強(qiáng)并行處理，與前一版本相比，編譯時間平均縮短了30%，最大達(dá)到70%，進(jìn)一步擴(kuò)展了在軟件效能方面的業(yè)界領(lǐng)先優(yōu)勢。軟件還包括最新的快速重新編譯特性，適用于客戶對Altera Stratix? V FPGA設(shè)計(jì)進(jìn)行少量源代碼改動的情形。采用快速重新編譯特性，客戶可以重新使用以前的編譯結(jié)果，從而保持性能，不需要前端設(shè)計(jì)劃分，進(jìn)一步將編譯時間縮短了50%。
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自動化升級戰(zhàn) FPGA/MCU你選誰

  • 隨著科學(xué)技術(shù)的不斷發(fā)展，工業(yè)生產(chǎn)線逐步走向自動化和智能化。自動化作為工廠生產(chǎn)的利器，未來有三大發(fā)展方向：性 ...
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Xilinx Spartan-3系列FPGA的配置電路

  • 這里要談的是Xilinx的spartan-3系列FPGA的配置電路。當(dāng)然了，其它系列的FPGA配置電路都是大同小異的，讀者可以 ...
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FPGA攻城拔寨，引領(lǐng)視頻監(jiān)控應(yīng)用潮流

  • 通信領(lǐng)域歷來是FPGA應(yīng)用的傳統(tǒng)主流市場，也是業(yè)界領(lǐng)先FPGA廠商傾力爭奪的大市場。FPGA產(chǎn)業(yè)發(fā)展方興未艾，已經(jīng)由 ...
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高清視頻監(jiān)控走向主流 FPGA迎來廣闊市場空間

  • 我們知道，通信領(lǐng)域歷來是FPGA應(yīng)用的傳統(tǒng)主流市場，也是業(yè)界領(lǐng)先FPGA廠商傾力爭奪的大市場。但是從2009年開始，隨 ...
  • 關(guān)鍵字： 高清視頻  監(jiān)控  FPGA  

強(qiáng)化協(xié)作生態(tài) SoC FPGA成攻城利器

  • Altera公司意欲通過更先進(jìn)的制程工藝和更緊密的產(chǎn)業(yè)合作，正逐步強(qiáng)化FPGA協(xié)同處理器，大幅提升SoC FPGA的整體性 ...
  • 關(guān)鍵字： SoC  FPGA  

基于FPGA的通用位同步器設(shè)計(jì)方案（二）

  • 2.2.2 定時誤差檢測設(shè)計(jì)　　定時誤差檢測程序采用獨(dú)立于載波相位偏差的GA-TED算法。該算法每個符號周期只 ...
  • 關(guān)鍵字： FPGA  通用位  同步器  

基于FPGA的通用位同步器設(shè)計(jì)方案(一)

  • 本文主要是先闡述傳統(tǒng)Gardner算法的原理，然后給出改進(jìn)后的設(shè)計(jì)和FPGA實(shí)現(xiàn)方法，最后對結(jié)果進(jìn)行仿真和分析，證明 ...
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基于FPGA的基帶64×64數(shù)據(jù)分配矩陣設(shè)計(jì)方案

  • 本文采用FPGA作為實(shí)現(xiàn)控制邏輯的核心部件，提出了基于FPGA的基帶64×64 數(shù)據(jù)分配矩陣設(shè)計(jì)方案，并介紹了上位機(jī) ...
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基于FPGA的多普勒測振計(jì)信號采集與處理系統(tǒng)設(shè)計(jì)方案

  • 0 引言　　傳統(tǒng)的淺海地形測量以船只為平臺，采用聲納技術(shù)進(jìn)行，這種測量方法對于一些船只難以駛?cè)氲膮^(qū)域便形 ...
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高效能64位SoC FPGA問世 大舉進(jìn)攻通信等市場

  • 業(yè)界首顆64位系統(tǒng)單芯片（SoC）現(xiàn)場可編程門陣列（FPGA）搶先亮相。Altera宣布將以英特爾（Intel）14納米（nm）三門極 （Tri-g ...
  • 關(guān)鍵字： 高效能  SoC  FPGA  

基于FPGA的TDICCD8091 驅(qū)動時序電路設(shè)計(jì)

  • 0引言時間延時積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實(shí)現(xiàn)實(shí)...
  • 關(guān)鍵字： FPGA  TDICCD8091  驅(qū)動時序  
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