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京微雅格金山力作問世

  • 　　京微雅格經(jīng)過在FPGA領(lǐng)域的十年技術(shù)積累，繼推出CME-M0和CME-M1之后，新一力作CME-M5近日也閃亮登場(chǎng)。
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采用低功耗28-nm FPGA降低系統(tǒng)總成本

  • 在針對(duì)大批量應(yīng)用開發(fā)系統(tǒng)時(shí)，要考慮的一個(gè)重要因素是成本。有多個(gè)方面會(huì)影響總體擁有成本，而不僅僅是每個(gè)元器件的價(jià)格。這包括硅片的功耗要求、材料(BOM)總成本、設(shè)計(jì)和測(cè)試系統(tǒng)的工程師的效能等。選擇FPGA供應(yīng)商很重要，要考慮影響系統(tǒng)成本的方方面面，這體現(xiàn)在整個(gè)產(chǎn)品設(shè)計(jì)周期中。
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Altera關(guān)于SoC FPGA方案的問答

  • Q1:驅(qū)動(dòng)FPGA朝向SoC FPGA或可編程SoC發(fā)展的主要因素為何?此一發(fā)展所面臨的技術(shù)與市場(chǎng)挑戰(zhàn)為何?又該如何因應(yīng)或解決?
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滿足28 nm迫切的低功耗需求

  • 降低電子產(chǎn)品的功耗是很現(xiàn)實(shí)的問題;在這種越來越強(qiáng)的能源意識(shí)以及迫切需要降低功耗的環(huán)境下，很多產(chǎn)品開發(fā)人員和生產(chǎn)商都制定了發(fā)展戰(zhàn)略來贏得競(jìng)爭(zhēng)優(yōu)勢(shì)。降低功耗為設(shè)計(jì)人員和最終用戶帶來了以下優(yōu)勢(shì)：
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基于FPGA的三線制同步串行通信控制器設(shè)計(jì)

  • 摘 要： 為了簡(jiǎn)化應(yīng)用系統(tǒng)中的三線制同步串行通信擴(kuò)展接口，減小系統(tǒng)體積，降低系統(tǒng)功耗，通過研究三線制同步串行通信的原理，利用FPGA，結(jié)合硬件描述語言VHDL，設(shè)計(jì)了三線制同步串行通信控制器功能框架結(jié)構(gòu)，介紹了
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基于FPGA的洗衣機(jī)控制系統(tǒng)設(shè)計(jì)

  • 摘要：為提高家用雙缸洗衣機(jī)控制系統(tǒng)的性能，改善定時(shí)精確度和洗滌效果，基于可編程性強(qiáng)的FPGA設(shè)計(jì)了一種用于洗衣機(jī)的控制系統(tǒng)，并進(jìn)行了時(shí)序仿真。通過實(shí)驗(yàn)時(shí)設(shè)計(jì)方案進(jìn)行了完善，得到了可進(jìn)行數(shù)字化控制和顯示的洗
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使用新型 Virtex FPGA 開發(fā)小型軟件無線電平臺(tái)：S

  • SFF SDR(小型軟件定義無線電)開發(fā)平臺(tái)是一種模塊化的 RF/IF/基帶平臺(tái)(圖 1 和圖 2)。該平臺(tái)展示了 Xilinx 和德州儀器 (Texas Instruments, TI) 的最新芯片產(chǎn)品以及最新高級(jí)設(shè)計(jì)流程和軟件架構(gòu)。 這個(gè)平臺(tái)還為手持設(shè)備
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賽靈思:異構(gòu)3D FPGA面向下一代線路卡

  • 賽靈思公司(Xilinx)宣布正式發(fā)貨 Virtex-7 H580T FPGA —全球首款3D異構(gòu)All Programmable產(chǎn)品。Virtex-7 HT采用賽靈思的堆疊硅片互聯(lián) (SSI)技術(shù)，是提供業(yè)界帶寬最高的 FPGA，可提供多達(dá)16個(gè)28 Gbps收發(fā)器和72個(gè)13.1 Gbps收發(fā)器，也是唯一能滿足關(guān)鍵Nx100G和400G線路卡應(yīng)用功能要求的單芯片解決方案。
  • 關(guān)鍵字： 賽靈思  FPGA  201208  

賽靈思開源硬件與嵌入式大賽越辦越火

  • 由中國電子學(xué)會(huì)主辦，美國賽靈思公司和北京工業(yè)大學(xué)共同承辦的“FPGA助力中國智造，擁抱嵌入式計(jì)算新時(shí)代 — 第三屆OpenHW開源硬件與嵌入式大賽”總決賽前不久在北京工業(yè)大學(xué)舉行。來自中國大陸、中國臺(tái)灣和新加坡的26支進(jìn)入決賽的精英團(tuán)隊(duì)會(huì)聚北京，現(xiàn)場(chǎng)進(jìn)行演示及答辯，為在場(chǎng)的專家和評(píng)委們奉上了一場(chǎng)創(chuàng)新與創(chuàng)意的盛宴。
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基于DSP+FPGA的磁鐵電源控制器的設(shè)計(jì)

  • 基于DSP+FPGA的磁鐵電源控制器的設(shè)計(jì),摘要：介紹了一種基于DSP和FPGA的磁鐵電源控制器的設(shè)計(jì)方案，闡述了該控制器硬件系統(tǒng)的組成，包括信號(hào)調(diào)理電路、中間數(shù)據(jù)處理部分、后端的驅(qū)動(dòng)電路。同時(shí)給出了DSP和FPGA之間通過SPI接口通信的具體流程和輸出PWM波形
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基于FPGA的高速多路視頻數(shù)據(jù)采集系統(tǒng)

  • 摘要：針對(duì)同時(shí)處理高速多路視頻數(shù)據(jù)的需求，以NiosIl軟核CPU為核心，通過在FPGA上構(gòu)建可編程片上系統(tǒng)(System On Programmable Chip，SOPC)，利用SOPC系統(tǒng)自定義外設(shè)接口，配合DMA技術(shù)，完成對(duì)A／D轉(zhuǎn)換后的多路視頻數(shù)
  • 關(guān)鍵字： FPGA  多路  采集系統(tǒng)  視頻數(shù)據(jù)    

無功功率計(jì)量中移相法的FPGA實(shí)現(xiàn)

  • 摘要：無功功率計(jì)量方法中的移相法有兩種實(shí)現(xiàn)方法，一種是基于采樣點(diǎn)平移，另一種是利用希爾伯特濾波器。在Matlab 上對(duì)這兩種方法進(jìn)行了設(shè)計(jì)、仿真，并采用EP2C50 型號(hào)的FPGA 實(shí)現(xiàn)了希爾伯特濾波器。數(shù)據(jù)表明基于采樣
  • 關(guān)鍵字： FPGA  無功功率  計(jì)量  移相法    

基于VHDL +FPGA 的自動(dòng)售貨機(jī)控制模塊的設(shè)計(jì)與實(shí)現(xiàn)

  • EDA技術(shù)是以計(jì)算機(jī)為工具完成數(shù)字系統(tǒng)的邏輯綜合、布局布線和設(shè)計(jì)仿真等工作。電路設(shè)計(jì)者只需要完成對(duì)系統(tǒng)功能的描述,就可以由計(jì)算機(jī)軟件進(jìn)行系統(tǒng)處理,最后得到設(shè)計(jì)結(jié)果,并且修改設(shè)計(jì)方案如同修改軟件一樣方便。利用
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CC2530和FPGA的新型無線網(wǎng)絡(luò)節(jié)點(diǎn)設(shè)計(jì)

  • 摘要：采用ZigBee協(xié)議組成無線網(wǎng)絡(luò)，設(shè)計(jì)出可以自動(dòng)接入該無線網(wǎng)絡(luò)的節(jié)點(diǎn)，使用了基于ZigBec技術(shù)的CC2530芯片和FPGA。摒棄了以往采用MCU控制CC2530的方式，對(duì)本身具有8051內(nèi)核的CC2530芯片進(jìn)行更大限度地利用。詳細(xì)地
  • 關(guān)鍵字： 2530  FPGA  CC  無線網(wǎng)絡(luò)    

基于FPGA的寬帶數(shù)字信道化接收機(jī)的設(shè)計(jì)

  • 現(xiàn)代電磁信號(hào)環(huán)境越來越復(fù)雜密集，要求電子戰(zhàn)接收機(jī)必須具有很寬的處理帶寬、高靈敏度、大動(dòng)態(tài)范圍、多信號(hào)并行處理和大量信息實(shí)時(shí)處理的能力。而數(shù)字信道化接收機(jī)不僅可以較好地滿足上述要求，還可實(shí)現(xiàn)監(jiān)視信道內(nèi)信
  • 關(guān)鍵字： FPGA  寬帶  接收機(jī)  數(shù)字信道化    
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