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Altera發(fā)售可量產(chǎn)的Stratix II GX FPGA

  •     Altera公司(NASDAQ:ALTR)今天宣布開(kāi)始發(fā)售其可量產(chǎn)的Stratix® II GX FPGA。高密度Stratix II GX系列提供20個(gè)工作范圍在600Mbps至6.375Gbps的低功耗收發(fā)器,串行鏈路總鏈接能力達(dá)到前所未有的127Gbps。用戶現(xiàn)在可以使用Stratix II GX FPGA來(lái)設(shè)計(jì)生產(chǎn)多吉比特互聯(lián)系統(tǒng),滿足甚至超越其性能和信號(hào)完整性規(guī)范。隨著E
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LambdaPRO 3支持XILINX Virtex-4 FX FPGA

  • 2006年11月,LambdaPRO 3成功實(shí)現(xiàn)了對(duì)XILINX公司內(nèi)嵌PowerPC405硬核的Virtex-4 FX FPGA的支持,用戶可以在Virtex-4 FX FPGA上開(kāi)發(fā)基于DeltaOS的嵌入式系統(tǒng)。 Virtex-4 FX FPGA是XILINX公司推出的高性能FPGA,設(shè)備具有如下特點(diǎn):     高性能;    &
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FPGA給汽車電子帶來(lái)新機(jī)遇

  • 今天,汽車電子領(lǐng)域在好幾個(gè)方面呈現(xiàn)出持續(xù)增長(zhǎng)的勢(shì)頭;其中包括汽車型款的推陳出新、車型的平均壽命逐漸縮短,以及換車的原因并非出于性能下降,而是因?yàn)橄M(fèi)者的喜好。 其它加促了汽車電子發(fā)展的原因,還有:技術(shù) - 隨著半導(dǎo)體技術(shù)進(jìn)步,元件的成本得以下降;市場(chǎng)競(jìng)爭(zhēng)-汽車制造商越來(lái)越多地將電子器件作為其競(jìng)爭(zhēng)的優(yōu)勢(shì)或武器;性能-電子產(chǎn)品可用來(lái)優(yōu)化汽油消耗和提高引擎性能;法規(guī)要求–法例規(guī)定在點(diǎn)火器和引擎控制系統(tǒng)中使用的電子器件必須有助于減少排放;安全性-安全功能如氣囊、ABS系統(tǒng)及應(yīng)急呼叫系統(tǒng)等現(xiàn)已成為開(kāi)拓市場(chǎng)的工具
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賽靈思在華首發(fā)成本最低的I/O優(yōu)化FPGA SPARTAN-3A平臺(tái)

  •   賽靈思推出Spartan™-3A系列I/O優(yōu)化現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)平臺(tái)。這一平臺(tái)是對(duì)低成本、大規(guī)模應(yīng)用的新一代Spartan-3系列產(chǎn)品的擴(kuò)展。SPARTAN-3A平臺(tái)為相對(duì)于邏輯密度而言更注重I/O數(shù)量與功能的應(yīng)用提供了一個(gè)成本更低的解決方案。Spartan-3A FPGA支持業(yè)界最廣泛的I/O標(biāo)準(zhǔn)(26種),具備獨(dú)特的電源管理、配置功能以及防克?。╝nti-cloning)安全優(yōu)勢(shì),可以為消費(fèi)和工業(yè)領(lǐng)域中的新型大規(guī)模應(yīng)用,如顯示屏接口、視頻/調(diào)諧器板接口和視頻交換,提
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[DSP/FPGA]DSP學(xué)習(xí)進(jìn)階

  • 學(xué)習(xí)TI的各種DSP,本著循序漸進(jìn)的原則,可以分為多個(gè)層次。根據(jù)我多年開(kāi)發(fā)DSP的經(jīng)驗(yàn),在這里總結(jié)一下各個(gè)層次的進(jìn)階:1、DSP2000(除了2812):進(jìn)階:標(biāo)準(zhǔn)C -> C和匯編混合編程說(shuō)明:把DSP2000當(dāng)作單片機(jī)來(lái)玩就可以了,非常簡(jiǎn)單。2、DSP5000(包括DSP2812)主要:標(biāo)準(zhǔn)C -> C和匯編混合編程 -> DSP/BIOS -> RF3說(shuō)明:DSP5000是個(gè)中等產(chǎn)品,性能不高不低
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FPGA協(xié)同處理的優(yōu)勢(shì)

  • 摘要: 本文介紹的ESL技術(shù)為傳統(tǒng)的DSP系統(tǒng)設(shè)計(jì)人員提供了有效的FPGA的設(shè)計(jì)實(shí)現(xiàn)方法。關(guān)鍵詞: DSP;FPGA;ESL 傳統(tǒng)的、基于通用DSP處理器并運(yùn)行由C語(yǔ)言開(kāi)發(fā)的算法的高性能DSP平臺(tái),正在朝著使用FPGA預(yù)處理器和/或協(xié)處理器的方向發(fā)展。這一最新發(fā)展能夠?yàn)楫a(chǎn)品提供巨大的性能、功耗和成本優(yōu)勢(shì)。盡管優(yōu)勢(shì)如此明顯,但習(xí)慣于使用基于處理器的系統(tǒng)進(jìn)行設(shè)計(jì)的團(tuán)隊(duì),仍會(huì)避免使用FPGA,因?yàn)樗麄內(nèi)狈Ρ匾挠布寄埽瑏?lái)將FPGA用作協(xié)處理器(圖1)。不熟悉像VHDL和Verilog這樣
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FPGA進(jìn)入嵌入式領(lǐng)域,處理器內(nèi)核成關(guān)鍵

  • 全球FPGA整體市場(chǎng)最近幾年迅速擴(kuò)大,其中與嵌入式FPGA處理器相關(guān)的Design Win數(shù)量正在迅速增長(zhǎng),潛力巨大。就像打開(kāi)潘多拉的盒子,有了可以運(yùn)行操作系統(tǒng)或?qū)崟r(shí)操作系統(tǒng)的處理器內(nèi)核,相信FPGA正在真正意義上大規(guī)模進(jìn)入嵌入式設(shè)計(jì)領(lǐng)域。 從Xilinx、Altera到Actel、Lattice,F(xiàn)PGA提供商都已經(jīng)有可在FPGA邏輯模塊旁實(shí)現(xiàn)的“硬”核,或者可以直接在FPGA結(jié)構(gòu)中運(yùn)行的“軟” 核處理器。硬核的好處是能夠提供更快的數(shù)據(jù)處理能力,所謂軟核需要FPGA廠商提供的PLD軟件進(jìn)行配置,然后固
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賽靈思90nm FPGA平臺(tái)出貨量達(dá)2600萬(wàn)片

  •  再創(chuàng)可編程邏輯器件行業(yè)新紀(jì)錄 賽靈思公司( Xilinx, Inc. (NASDAQ: XLNX))在北京宣布:該公司90nm FPGA平臺(tái)出貨量達(dá)2600萬(wàn)片,再一次刷新了可編程邏輯行業(yè)(PLD)新記錄。賽靈思包括Spartan™-3 和Virtex™-4 FPGA兩大旗艦產(chǎn)品系列在內(nèi)的90nm FPGA平臺(tái)廣受市場(chǎng)歡迎,以累計(jì)營(yíng)收計(jì)算,在全球90nm FPGA市場(chǎng)上贏得了約70
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基于FPGA的DDS調(diào)頻信號(hào)的研究與實(shí)現(xiàn)

  • 1 引言 直接數(shù)字頻率合成器(DDS)技術(shù),具有頻率切換速度快,很容易提高頻率分辨率、對(duì)硬件要求低、可編程全數(shù)字化便于單片集成、有利于降低成本、提高可靠性并便于生產(chǎn)等優(yōu)點(diǎn)。目前各大芯片制造廠商都相繼推出采用先進(jìn)CMOS工藝生產(chǎn)的高性能和多功能的DDS芯片,專用DDS芯片采用了特定工藝,內(nèi)部數(shù)字信號(hào)抖動(dòng)很小,輸出信號(hào)的質(zhì)量高。然而在某些場(chǎng)合,由于專用的DDS芯片的控制方式是固定的,故在工作方式、頻率控制等方面與系統(tǒng)的要求差距很大,這時(shí)如果用高性能的FPGA器件設(shè)計(jì)符合自己需要的DDS電路就是一個(gè)很好的解
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遠(yuǎn)程測(cè)控中嵌入式Web服務(wù)器的FPGA實(shí)現(xiàn)

  • 引 言    嵌入式系統(tǒng)是指被嵌入到各種產(chǎn)品或工程應(yīng)用中以微處理器或微控制器為核心的軟硬件系統(tǒng)。嵌入式系統(tǒng)與Internet技術(shù)相結(jié)合,形成的嵌入式Internet技術(shù)是近幾年隨著計(jì)算機(jī)網(wǎng)絡(luò)技術(shù)的普及而發(fā)展起來(lái)的一項(xiàng)新興技術(shù)。工程技術(shù)人員、管理人員或調(diào)試人員通過(guò)Web而不用親臨現(xiàn)場(chǎng)就可以得到遠(yuǎn)程數(shù)據(jù),并對(duì)測(cè)控儀器進(jìn)行控制、校準(zhǔn)等工作。這里介紹利用嵌入式軟核處理器Nios II及廣泛應(yīng)用的嵌入式操作系統(tǒng)uClinux來(lái)實(shí)現(xiàn)電網(wǎng)參數(shù)的遠(yuǎn)程測(cè)控服務(wù)器的功能。 &
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基于DSP+FPGA的便攜數(shù)字存儲(chǔ)示波表設(shè)計(jì)

  • 本文提出了一種基于DSP+FPGA的嵌入式便攜數(shù)字存儲(chǔ)示波表的設(shè)計(jì)方案,充分利用微控制器技術(shù)和ASIC技術(shù)實(shí)現(xiàn)了嵌入式實(shí)時(shí)處理,很好地達(dá)到了體積小、重量輕、功能強(qiáng)、可靠性高的要求。
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使用FPGA和IP Core實(shí)現(xiàn)定制緩沖管理

  • 在通信網(wǎng)絡(luò)系統(tǒng)中,流量管理的核心是緩存管理、隊(duì)列管理和調(diào)度程序。本文結(jié)合使用FPGA及IP Core闡述緩存管理的結(jié)構(gòu)、工作原理及設(shè)計(jì)方法 目前硬件高速轉(zhuǎn)發(fā)技術(shù)的趨勢(shì)是將整個(gè)轉(zhuǎn)發(fā)分成兩個(gè)部分:PE(Protocol Engine,協(xié)議引擎)和TM(Traffic Management,流量管理)。其中PE完成協(xié)議處理,TM負(fù)責(zé)完成隊(duì)列調(diào)度、緩存管理、流量整形、QOS等功能,TM與轉(zhuǎn)發(fā)協(xié)議無(wú)關(guān)。 隨著通信協(xié)議的發(fā)展及多樣化,協(xié)議處理部分PE在硬件轉(zhuǎn)發(fā)實(shí)現(xiàn)方面,普遍采用現(xiàn)有的商用芯片NP(Network
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Nios II系統(tǒng)在數(shù)字式心電診監(jiān)測(cè)設(shè)備中的應(yīng)用

  • 引言心電檢測(cè)儀是醫(yī)學(xué)界運(yùn)用廣泛的一種心電監(jiān)測(cè)設(shè)備,他主要由12導(dǎo)聯(lián)心電傳感器和心電信號(hào)處理設(shè)備兩部分組成,目前運(yùn)用廣泛的數(shù)字式心電檢測(cè)儀大都是由DSP處理器外加一個(gè)單片機(jī)(MCU),通過(guò)編寫(xiě)復(fù)雜的并行通訊協(xié)議來(lái)完成的,這種結(jié)構(gòu)雖然有較高的精度,但硬件設(shè)計(jì)復(fù)雜,軟件編寫(xiě)煩瑣,相應(yīng)的開(kāi)發(fā)周期長(zhǎng),研制成本高。本設(shè)計(jì)采用Altera公司先進(jìn)的SOPC(可編程片上系統(tǒng))解決方案--以32位Nios II軟核CPU系統(tǒng)取代目前數(shù)字式心電儀的DSP和MCU的雙CPU結(jié)構(gòu),通過(guò)靈活的Avalon總線,控制心電信號(hào)的采集、
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使用一個(gè)FPGA便可實(shí)現(xiàn)的64通道下變頻器

  • RF Engines公司的ChannelCore64使設(shè)計(jì)者能夠用一個(gè)可對(duì)FPGA編程的IP核來(lái)替代多達(dá)16個(gè)DDC(直接下變頻器)ASIC,可顯著減少PCB面積,降低功耗而且增加靈活性。和原來(lái)的方法相比,新方法是降低成本的典型代表,隨著通道數(shù)目的增加,降低成本的需求愈加突出。在提供靈活性和簡(jiǎn)化設(shè)計(jì)的同時(shí),這種方法也能降低功耗。ChannelCore64的應(yīng)用包括無(wú)線基站,衛(wèi)星地面站和其它多通道無(wú)線電接收器等。在這些系統(tǒng)應(yīng)用中,需要從一個(gè)頻帶非常寬的信號(hào)中提取很多具有不同帶寬的通道(或者信號(hào)),然后將整個(gè)
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基于單片機(jī)的FPGA并行配置方法

  • 在當(dāng)今變化的市場(chǎng)環(huán)境中,產(chǎn)品是否便于現(xiàn)場(chǎng)升級(jí)、是否便于靈活使用,已成為產(chǎn)品能否進(jìn)入市場(chǎng)的關(guān)鍵因素。在這種背景下,altera公司的基于SRAM LUT結(jié)構(gòu)的FPGA器件得到了廣泛的應(yīng)用。這類器件的配置數(shù)據(jù)存儲(chǔ)在SRAM中。由于SRAM的掉電易失性,系統(tǒng)每次上電時(shí),必須重新配置數(shù)據(jù),只有在數(shù)據(jù)配置正確的情況下系統(tǒng)才能正常工作。這種器件的優(yōu)點(diǎn)是可在線重新配置ICR(In-Circuit Reconfigurability),在線配置方式一般有兩類:一是通過(guò)下載電費(fèi)由計(jì)算機(jī)直接對(duì)其進(jìn)行配置;二是通過(guò)微處理器對(duì)其
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fpga-nios介紹

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