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FPGA/CPLD 的設(shè)計(jì)思想與技巧
- FPGA/CPLD 的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題,由于篇幅所限,本文僅介紹一些常用的設(shè)計(jì)思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意,如果能有意識地利用這些原則指導(dǎo)日后的設(shè)計(jì)工作,將取得事半功倍的效果!
- 關(guān)鍵字: 設(shè)計(jì)思想 FPGA CPLD
CPLD/FPGA技術(shù)及電子設(shè)計(jì)自動化
- 電子設(shè)計(jì)自動化(EDA)的實(shí)現(xiàn)是與CPLD/FPGA技術(shù)的迅速發(fā)展息息相關(guān)的。CPLD/FPGA是80年代中后期出現(xiàn)的,其特點(diǎn)是具有用戶可編程的特性。利用PLD/FPGA,電子系統(tǒng)設(shè)計(jì)工程師可以在實(shí)驗(yàn)室中設(shè)計(jì)出專用IC,實(shí)現(xiàn)系統(tǒng)的集成,從而大大縮短了產(chǎn)品開發(fā)、上市的時(shí)間,降低了開發(fā)成本。此外,CPLD/FPGA還具有靜態(tài)可重復(fù)編程或在線動態(tài)重構(gòu)特性,使硬件的功能可象軟件一樣通過編程來修改,不僅使設(shè)計(jì)修改和產(chǎn)品升級變得十分方便,而且極大地提高了電子系統(tǒng)的靈活性和通用能力。
- 關(guān)鍵字: 可編程邏輯器件 FPGA CPLD 電子設(shè)計(jì) 靈活性
FPGA管腳分配需要考慮的因素
- 在芯片的研發(fā)環(huán)節(jié),F(xiàn)PGA 驗(yàn)證是其中的重要的組成部分,如何有效的利用 FPGA 的資源,管腳分配也是必須考慮的一個(gè)重要問題。一般較好的方法是在綜合過程中通過時(shí)序的一些約束讓對應(yīng)的工具自動分配,但是從研發(fā)的時(shí)間段上來考慮這種方法往往是不可取的,RTL驗(yàn)證與驗(yàn)證板設(shè)計(jì)必須是同步進(jìn)行的,在驗(yàn)證代碼出來時(shí)驗(yàn)證的單板也必須設(shè)計(jì)完畢,也就是管腳的分配也必須在設(shè)計(jì)代碼出來之前完成。
- 關(guān)鍵字: 可編程邏輯器件 管腳分配 FPGA
基于FPGA的鍵盤掃描模塊的設(shè)計(jì)
- 在嵌入式計(jì)算機(jī)系統(tǒng)中,鍵盤是最基本的人機(jī)交互輸入設(shè)備。除了使用通用的標(biāo)準(zhǔn)鍵盤外,實(shí)際工程應(yīng)用中更需要進(jìn)行單獨(dú)設(shè)計(jì)并購程專用的各種小鍵盤。隨著EDA(電子設(shè)計(jì)自動化)技術(shù)的迅速發(fā)展,利用FPGA來實(shí)現(xiàn)各種數(shù)字電路將是非常經(jīng)濟(jì)和便利的。文中介紹鍵盤掃描模塊地實(shí)現(xiàn)原理,闡迷了一種基于FPGA的鍵盤掃描模塊的實(shí)現(xiàn)方法。
- 關(guān)鍵字: 健盤掃描 嵌入式系統(tǒng) 抖動 FPGA EDA
基于FPGA的TFTLCD快檢信號源的設(shè)計(jì)
- 目前TFT模塊的生產(chǎn)過程中常伴有模塊的線缺陷和點(diǎn)缺陷,依據(jù)TFT模塊的驅(qū)動和測試原理,設(shè)計(jì)了一種由FPGA和模擬開關(guān)組成的集成測試信號源,該信號源可提供源極信號、柵極信號、柵極控制信號和公共地信號四路測試信號。
- 關(guān)鍵字: TFTLCD 快檢信號源的設(shè)計(jì) FPGA
一種基于FPGA的語音密碼鎖設(shè)計(jì)
- 電子密碼鎖系統(tǒng)主要由電子鎖體、電子密匙等部分組成,一把電子密匙里能存放多組開鎖密碼,用戶在使用過程中能夠隨時(shí)修改開鎖密碼,更新或配制鑰匙里開鎖密碼。一把電子鎖可配制多把鑰匙。語音方面的廣泛應(yīng)用,使得具有語音播放的電子密碼鎖使用起來更加方便。語音密碼鎖的體積小、保密性能好、使用方便,是用在保險(xiǎn)箱、電話或是房門上不可少的部分。
- 關(guān)鍵字: FPGA
將片外調(diào)試的優(yōu)點(diǎn)融入FPGA片上調(diào)試之中
- FPGA片上調(diào)試已出現(xiàn)了很多年,成為傳統(tǒng)復(fù)雜FPGA設(shè)計(jì)調(diào)試方法的一種常用替代方式,將虛擬測試夾具放于FPGA設(shè)計(jì)任何地方而不是采用昂貴的通用I/O引腳是可編程邏輯器件才有的性能。但片上調(diào)試也有一些不足之處,本文將討論片上調(diào)試的局限,并介紹如何把片上調(diào)試與片外深采樣存儲特性結(jié)合起來。
- 關(guān)鍵字: FPGA
用FPGA在數(shù)字電視系統(tǒng)中進(jìn)行級聯(lián)編碼
- 本文介紹了串型級聯(lián)編碼的原理,以及它在數(shù)字電視地面?zhèn)鬏斚到y(tǒng)中的應(yīng)用,通過FPGA設(shè)計(jì)電路實(shí)現(xiàn)編碼過程,最后說明串型級聯(lián)編碼的應(yīng)用優(yōu)越性。
- 關(guān)鍵字: FPGA;編碼;串型級聯(lián)編碼;數(shù)字電視地面?zhèn)鬏斚到y(tǒng)
多種EDA工具的FPGA協(xié)同設(shè)計(jì)
- 在FPGA開發(fā)的各個(gè)階段,市場為我們提供了很多優(yōu)秀的EDA工具。面對眼花繚亂的EDA工具,如何充分利用各種工具的特點(diǎn),并規(guī)劃好各種工具的協(xié)同使用,對FPGA開發(fā)極其重要。本文將通過開發(fā)實(shí)例“帶順序選擇和奇偶檢驗(yàn)的串并數(shù)據(jù)轉(zhuǎn)換接口”來介紹基于多種EDA工具——QuartusII、FPGA CompilerII、Modelsim——的FPGA協(xié)同設(shè)計(jì)。
- 關(guān)鍵字: FPGA;EDA;協(xié)同設(shè)計(jì)
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