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生物電阻抗測(cè)量系統(tǒng)中弱信號(hào)檢測(cè)技術(shù)研究--PCB制作

  • 隨著科學(xué)和醫(yī)療技術(shù)的發(fā)展，生物電阻抗成像技術(shù)（Electrical ImpedanceTomography, EIT）已成為當(dāng)今生物醫(yī)學(xué)工程重大研究課題之一。根據(jù)生物組織與器官的電特性（電阻率、電容率等），通過(guò)表面電極陣列施加激勵(lì)微弱電流或者電壓，測(cè)量邊界電壓或電流來(lái)獲取生物內(nèi)部電特性參數(shù)分布。
  • 關(guān)鍵字： 生物電阻抗測(cè)量系統(tǒng)  PCB  弱信號(hào)檢測(cè)  

數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：系統(tǒng)硬件配置方案

  • FPGA作可編程器件，可以根據(jù)用戶的需要進(jìn)行現(xiàn)場(chǎng)可編程。系統(tǒng)可采用了JTAG模式和AS模式進(jìn)行FPGA編程配置。
  • 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng)  JTAG  FPGA  EPC1441PC8  

數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：系統(tǒng)原理框圖

數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：系統(tǒng)工作原理分析

  • 如前所述，本系統(tǒng)主要完成對(duì)輸入視頻圖像的兩倍放大。圖像的放大主要是通過(guò)插值算法來(lái)實(shí)現(xiàn)的，下面詳細(xì)分析如何應(yīng)用雙線性插值算法來(lái)實(shí)現(xiàn)倍焦功能。
  • 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng)  乘法器  FPGA  

數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：設(shè)計(jì)需求分析與芯片選型

  • 在數(shù)字圖像處理和通信、遙感圖像分析、醫(yī)學(xué)成像診斷等應(yīng)用領(lǐng)域，為了便于顯示、觀察或進(jìn)行進(jìn)一步的處理，常常需要對(duì)原始的數(shù)字圖像進(jìn)行特征提取(如邊緣檢測(cè)、邊緣銳化)、噪聲平滑濾波、幾何校正、尺寸縮放等處理，這類圖像處理技術(shù)稱為圖像的預(yù)處理。在實(shí)際應(yīng)用中，圖像的預(yù)處理功能很多可以通過(guò)FPGA來(lái)實(shí)現(xiàn)。
  • 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng)  視頻解碼器  FPGA  視頻編碼器  乒乓緩沖區(qū)  

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之：典型實(shí)例-整數(shù)DCT變換的設(shè)計(jì)與實(shí)現(xiàn)

  • 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了視頻壓縮標(biāo)準(zhǔn)H.264算法中的整數(shù)DCT變換部分，幫助讀者了解并行流水設(shè)計(jì)技巧在算法優(yōu)化中的作用。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  整數(shù)DCT變換  H.264  

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之：典型實(shí)例-FPGA片上硬件乘法器的使用

  • 在FPGA+DSP系統(tǒng)設(shè)計(jì)系統(tǒng)中，F(xiàn)PGA經(jīng)常作為DSP的協(xié)處理器來(lái)輔助完成一些計(jì)算任務(wù)。而這些計(jì)算工作中最消耗時(shí)間的就是乘法運(yùn)算，因此本實(shí)例的主要內(nèi)容就是幫助讀者學(xué)會(huì)調(diào)用硬件乘法IP核。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  硬件乘法器  

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之：FPGA+DSP協(xié)同平臺(tái)的調(diào)試技巧和注意事項(xiàng)

  • 作為雙芯片的協(xié)同系統(tǒng)，調(diào)試的開(kāi)始階段需要對(duì)每個(gè)芯片進(jìn)行單獨(dú)測(cè)試。這種情況下就需要避免另外一個(gè)芯片對(duì)調(diào)試產(chǎn)生影響，比較好的辦法就是讓它停止工作。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  內(nèi)部邏輯分析儀  隔離調(diào)試  

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之： FPGA與DSP的通信接口設(shè)計(jì)

  • 以上的接口中，比較常用的接口是EMIF和HPI。其中總線接口需要協(xié)議支持，開(kāi)發(fā)難度較大，串行接口開(kāi)發(fā)簡(jiǎn)單，但是速率較慢。VPORT等特殊接口一般是在特定的場(chǎng)合下應(yīng)用，不具備通用性，而且需要修改DSP驅(qū)動(dòng)，開(kāi)發(fā)周期較長(zhǎng)。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  通信接口  EMIF  HPI  BlockRAM  

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之： 基于FPGA+DSP協(xié)同處理平臺(tái)的優(yōu)勢(shì)和適用領(lǐng)域

  • FPGA的一個(gè)重要的應(yīng)用領(lǐng)域就是數(shù)字信號(hào)處理，隨著FPGA密度和速度的提高，現(xiàn)在FPGA已經(jīng)可以勝任一些原來(lái)只有專用芯片或者多DSP才能完成的計(jì)算任務(wù)。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  

利用FPGA實(shí)現(xiàn)外設(shè)通信接口之： 典型實(shí)例-VGA接口的設(shè)計(jì)與實(shí)現(xiàn)

  • 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了FPGA與VGA顯示器的接口，幫助讀者進(jìn)一步了解VGA接口的時(shí)序和設(shè)計(jì)方法。
  • 關(guān)鍵字： VGA接口  ModelSim  FPGA  

利用FPGA實(shí)現(xiàn)外設(shè)通信接口之： 典型實(shí)例-字符LCD接口的設(shè)計(jì)與實(shí)現(xiàn)

  • 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)FPGA與字符LCD的接口，幫助讀者進(jìn)一步了解字符液晶的工作原理和設(shè)計(jì)方法。
  • 關(guān)鍵字： 字符LCD接口  char_ram模塊  FPGA  ModelSim  

利用FPGA實(shí)現(xiàn)外設(shè)通信接口之： 典型實(shí)例-USB 2.0接口的設(shè)計(jì)與實(shí)現(xiàn)

  • 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了FPGA通過(guò)FX2 USB 2.0接口芯片與PC機(jī)進(jìn)行高速數(shù)據(jù)通信，分為讀數(shù)據(jù)、寫數(shù)據(jù)和讀寫數(shù)據(jù)3部分內(nèi)容。幫助讀者進(jìn)一步了解USB接口芯片的工作原理和設(shè)計(jì)方法。
  • 關(guān)鍵字： USB2.0  FX2  FPGA  高速數(shù)據(jù)傳輸  

利用FPGA實(shí)現(xiàn)外設(shè)通信接口之： 典型實(shí)例-RS-232C（UART）接口的設(shè)計(jì)與實(shí)現(xiàn)

  • 本節(jié)旨在通過(guò)分析UART控制器，設(shè)計(jì)實(shí)現(xiàn)了FPGA通過(guò)RS-232C接口與PC機(jī)的通信。設(shè)計(jì)過(guò)程中用Modelsim對(duì)UART控制器進(jìn)行仿真，幫助讀者進(jìn)一步了解UART協(xié)議的具體時(shí)序。
  • 關(guān)鍵字： RS-232C接口  UART  FPGA  BlockRAM  

利用FPGA實(shí)現(xiàn)外設(shè)通信接口之： 利用FPGA實(shí)現(xiàn)A/D、D/A轉(zhuǎn)換器接口

  • A/D、D/A轉(zhuǎn)換器是FPGA系統(tǒng)設(shè)計(jì)中的常用器件，經(jīng)常用來(lái)實(shí)現(xiàn)模擬信號(hào)和數(shù)字信號(hào)的相互轉(zhuǎn)換。根據(jù)應(yīng)用場(chǎng)合的不同，A/D、D/A轉(zhuǎn)換芯片的性能指標(biāo)參數(shù)差別比較大，因此接口格式也無(wú)法統(tǒng)一。
  • 關(guān)鍵字： 轉(zhuǎn)換器接口  外同步模式  FPGA  內(nèi)同步模式  環(huán)形緩存區(qū)  
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