xilinx fpga 文章進(jìn)入xilinx fpga技術(shù)社區(qū)

小梅哥和你一起深入學(xué)習(xí)FPGA之串口調(diào)試（一）（下）

　　以上為小梅哥為了對特權(quán)同學(xué)的串口收發(fā)模塊進(jìn)行測試所展開的部分工作，到這里，仿真測試所需要的準(zhǔn)備工作我們就做好了，接下來將實(shí)際進(jìn)行仿真，通過仿真來分析該模塊的性能?！　∵@里極力推薦大家使用modelsim進(jìn)行仿真，因?yàn)閝uartusII自帶的仿真工具靈活性和功能都趕modelsim相差甚遠(yuǎn)。Modelsim作為一款強(qiáng)大的仿真軟件，在業(yè)界被廣泛使用。同時，modelsim針對不同的EDA廠家，也推出了OEM版本，modelsim-altera就是為Altera公司開發(fā)的OEM版本，此版本針對Altera公
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小梅哥和你一起深入學(xué)習(xí)FPGA之串口調(diào)試（一）(上)

　　大家好，這幾天在各個論壇上，經(jīng)常就有人在向我咨詢基于FPGA的串口通信代碼，大部分都是在網(wǎng)上下載一個現(xiàn)成的代碼，但是在使用中就遇到了各種問題，于是就發(fā)到了論壇上來求助。在閱讀了他們的代碼之后，我發(fā)現(xiàn)幾乎出自同一個版本(目前確定為特權(quán)同學(xué)的基于EPM240入門實(shí)驗(yàn)的代碼)。他們在調(diào)試這個代碼的時候，經(jīng)常存在這樣幾個問題：1、部分人對該串口通訊模塊完全不理解，對每句話，甚至每個模塊的功能都不理解;2、部分人采用最原始的畫波形的方式來對該模塊進(jìn)行仿真，結(jié)果無法得到仿真結(jié)果;3、部分人不會使用modelsim
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ASDF：精細(xì)粒度異構(gòu)助力創(chuàng)新， Altera將進(jìn)入大FPGA時代

　　“數(shù)十個合作伙伴，數(shù)百家客戶，數(shù)千計(jì)的工程師，這三股強(qiáng)大的力量構(gòu)成了Altera SoC大的生態(tài)系統(tǒng)，也是Altera在SoC領(lǐng)域投入5年所獲得的成就。”Altera公司嵌入式處理營銷資深總監(jiān)Chris Balough在一年一度的Altera SoC開發(fā)者大會上自豪地表示。　　
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Altera榮獲Frost & Sullivan全球FPGA技術(shù)創(chuàng)新領(lǐng)先獎

　　Altera公司榮獲分析公司Frost & Sullivan的全球FPGA技術(shù)創(chuàng)新領(lǐng)先獎，表彰Altera在技術(shù)特性和未來業(yè)務(wù)價值方面更勝一籌。該獎項(xiàng)彰顯Altera在其Arria® 10 FPGA中實(shí)現(xiàn)IEEE 754單精度硬核浮點(diǎn)DSP (數(shù)字信號處理)模塊——處理速率高達(dá)1.5 TFLOPS (每秒萬億次浮點(diǎn)運(yùn)算)，進(jìn)一步提高了數(shù)字系統(tǒng)設(shè)計(jì)的能效和生產(chǎn)效率。Altera的可編程器件幫助客戶針對大數(shù)據(jù)和搜索應(yīng)用、數(shù)據(jù)中心加速、軍事通信和高性能計(jì)算等需要高精度
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使用面向FPGA的OpenCL設(shè)計(jì)兩百萬點(diǎn)頻域?yàn)V波器

快速傅里葉變換(FFT)是信號處理應(yīng)用的基礎(chǔ)。FPGA供應(yīng)商一直以來提供了運(yùn)行良好的FFT庫，處理適配到FPGA片內(nèi)存儲器中的大量數(shù)據(jù)。但是，如果數(shù)據(jù)規(guī)模太大，應(yīng)該如何應(yīng)對? 為解決這一問題，F(xiàn)PGA設(shè)計(jì)人員現(xiàn)在必須要做出設(shè)計(jì)決定，這些決定互相糾纏在一起，例如，片內(nèi)FFT內(nèi)核的配置選擇，其數(shù)量，它們怎樣連接并訪問外部存儲器，多個內(nèi)核之間的同步等。分析所有這類設(shè)計(jì)決定就是要能夠很好的結(jié)合現(xiàn)有產(chǎn)品，在HDL中編程，這會非常耗時，而且?guī)砹诵阅軉栴}。采用OpenCL等高級編程語言，能夠很快的完成系統(tǒng)設(shè)計(jì)分析。本
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OpenPOWER+CAPI實(shí)現(xiàn)第二代分布計(jì)算

本文介紹了CAPI技術(shù)，并給出基于CAPI應(yīng)用的三個案例。
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在Xilinx FPGA上快速實(shí)現(xiàn)JESD204B

　　簡介　　JESD204是一種連接數(shù)據(jù)轉(zhuǎn)換器(ADC和DAC)和邏輯器件的高速串行接口，該標(biāo)準(zhǔn)的 B 修訂版支持高達(dá) 12.5 Gbps串行數(shù)據(jù)速率，并可確保 JESD204 鏈路具有可重復(fù)的確定性延遲。隨著轉(zhuǎn)換器的速度和分辨率不斷提升，JESD204B接口在ADI高速轉(zhuǎn)換器和集成RF收發(fā)器中也變得更為常見。此外，F(xiàn)PGA和ASIC中靈活的串行器/解串器(SERDES)設(shè)計(jì)正逐步取代連接轉(zhuǎn)換器的傳統(tǒng)并行LVDS/CMOS接口，并用來實(shí)現(xiàn) JESD204B物理層。本文介紹如何快速在Xilinx?
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Altera：通信領(lǐng)域，我們做得更好

　　EEPW：我想了解一下Patrick Dorsey先生對英特爾收購了Altera的一些看法，其次就是Altera也是OpenPower的一個成員，因?yàn)榧尤肓薎ntel之后，Altera這邊會不會繼續(xù)跟OpenPower合作。　　Patrick Dorsey：就像您所說的，我們也是OpenPower機(jī)構(gòu)的一個成員。關(guān)于我們的看法，我們FPGA會繼續(xù)支持不同的架構(gòu)，包括ARM架構(gòu)，Power架構(gòu)還有Intel自己的架構(gòu)。　　6月份我看我們的新聞發(fā)布宣布我們的OpenCL這個工具可以支持普通的架構(gòu)，
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Xilinx宣布業(yè)界首款 16nm All Programmable MPSoC提前發(fā)貨

　　賽靈思上周(美國時間9月30日)宣布比原定計(jì)劃提前一個季度向客戶提前交付業(yè)界首款 16nm 多處理器 SoC(MPSoC)。早期版本的 Zynq® UltraScale+™ MPSoC 能幫助賽靈思客戶立即開始設(shè)計(jì)并提供基于 MPSoC 的系統(tǒng)。Zynq® UltraScale+™ MPSoC 采用臺積公司 (TSMC) 的 16FF+ 工藝打造，支持新一代嵌入式視覺、ADAS、工業(yè)物聯(lián)網(wǎng) (I-IoT) 和通信系統(tǒng)的開發(fā)，并可為新一代系統(tǒng)提供 5 倍的系統(tǒng)級性
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Xilinx多重處理系統(tǒng)芯片提前出貨

　　賽靈思(Xilinx)宣布提早一季為首位客戶出貨業(yè)界首款16nm多重處理系統(tǒng)晶片(MPSoC)。早期版本的Zynq UltraScale+ MPSoC讓賽靈思客戶能夠開始設(shè)計(jì)及提供基于MPSoC的系統(tǒng)。　　Zynq UltraScale+ MPSoC采用臺積電16FF+制程，實(shí)現(xiàn)新一代嵌入式視覺、先進(jìn)駕駛輔助系統(tǒng)(ADAS)、工業(yè)物聯(lián)網(wǎng)(IIoT)以及通訊系統(tǒng)，提供五倍系統(tǒng)級功耗效能比與所有形式連結(jié)功能，并擁有新一代系統(tǒng)運(yùn)用所需保密性及安全性。　　Zynq UltraScale+ MPSoC為
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Xilinx跨界擴(kuò)張，五年預(yù)增5倍用戶

編者按：五年來，Xilinx正經(jīng)歷轉(zhuǎn)型: 從FPGA供應(yīng)商到可以支持系統(tǒng)和軟件工程師的全可編程技術(shù)(All Programmable technology )公司，致力于未來五年內(nèi)增長5倍的潛在用戶，并為此推出了多處理器SoC和一系列軟件定義的設(shè)計(jì)環(huán)境。近日該公司的戰(zhàn)略規(guī)劃師Steve Glaser來華，向我們解釋了其構(gòu)想。
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Synopsys的全新HAPS-80基于FPGA的原型解決方案提供高達(dá)100MHz的系統(tǒng)性能

　　新思科技(Synopsys, Inc.)日前宣布：推出全新HAPS®-80基于FPGA的原型系統(tǒng)，該系統(tǒng)為Synopsys的端到端原型解決方案的一部分。HAPS-80系統(tǒng)提供了高達(dá)100MHz的多FPGA性能，以及全新的專用高速時分復(fù)用(HSTDM)技術(shù)。HAPS-80采用Xilinx最新的Virtex UltraScale VU440 FPGA器件，每顆FPGA可容納2600萬個ASIC門，結(jié)合ProtoCompiler設(shè)計(jì)自動化和調(diào)試軟件，可支持高達(dá)16億個ASIC門的設(shè)計(jì)。HAPS硬件與
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IBM和Xilinx聯(lián)手，CAPI FPGA爭奪大數(shù)據(jù)市場

　　IBM和Xilinx走到了一起，IBM大中華區(qū)科技合作部業(yè)務(wù)發(fā)展總監(jiān)張思民與Xilinx公司亞太區(qū)通信業(yè)務(wù)拓展高級經(jīng)理梁曉明坐到一起。當(dāng)今計(jì)算遇到了瓶頸，技術(shù)障礙包括硬件編程和大數(shù)據(jù)編程;還有生態(tài)障礙。CAPI(一致性加速器處理器接口)把兩家公司的開發(fā)人員聯(lián)系起來，包括中國FPGA開發(fā)人員5萬人(來源：Xilinx數(shù)據(jù)),Java,C++的開發(fā)人員4、5百萬。　　兩大陣營在華博弈的結(jié)晶　　筆者認(rèn)為，這次合作的主要催化劑之一，當(dāng)屬服務(wù)器CPU供應(yīng)商Intel收購FPGA廠商Altera，與C
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第一屆5G算法創(chuàng)新大賽公布復(fù)賽入圍名單

　　Altera公司宣布，由Altera、西安電子科技大學(xué)、友晶科技主辦，華為、英特爾、展訊通信贊助的第一屆5G算法創(chuàng)新大賽公布進(jìn)入復(fù)賽的團(tuán)隊(duì)名單。第一屆5G算法創(chuàng)新大賽是業(yè)界首個面向未來無線通信技術(shù)的高校大賽，旨在促進(jìn)創(chuàng)新。大賽共有184支隊(duì)伍報(bào)名參賽，462名參賽學(xué)生，覆蓋全國31個城市、76所高校，其中包括28所985高校和47所211高校。初賽角逐后進(jìn)入復(fù)賽共49支隊(duì)伍。由于初賽交付的高質(zhì)量作品較多并不乏創(chuàng)新性，大賽組委會宣布在原定一、二、三等獎基礎(chǔ)上，增設(shè)優(yōu)秀獎——&ld
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OpenPOWER基金會推第二代分布式計(jì)算為企業(yè)“互聯(lián)網(wǎng)+”轉(zhuǎn)型加速

　　今天，OpenPOWER基金會在京召開主題為“開放力量?引領(lǐng)新一代計(jì)算技術(shù)”的第二代分布式計(jì)算技術(shù)峰會。來自IBM公司、賽靈思公司、深圳市恒揚(yáng)科技股份有限公司、聯(lián)科集團(tuán)(中國)有限公司、無錫中太服務(wù)器有限公司、新浪網(wǎng)、清華大學(xué)等機(jī)構(gòu)的領(lǐng)導(dǎo)、專家，以及ISV、FPGA技術(shù)人員和行業(yè)用戶200余人共同出席了峰會。峰會期間，OpenPOWER基金會宣布成立第二代分布式計(jì)算聯(lián)盟，以推動新一代計(jì)算技術(shù)和應(yīng)用的發(fā)展。同時，構(gòu)建于SuperVessel云平臺上的CAPI FPGA應(yīng)
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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計(jì)要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實(shí)際應(yīng)用要求進(jìn)行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開發(fā)產(chǎn)品的時間 [ 查看詳細(xì) ]