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xilinx fpga 文章 進(jìn)入xilinx fpga技術(shù)社區(qū)
頻分分路中高速FFT的實(shí)現(xiàn)
- 摘 要:本文介紹了多相陣列FFT在星上多載波數(shù)字化分路中的應(yīng)用,并針對(duì)星上處理的實(shí)時(shí)高速處理要求,提出了一種FFT的實(shí)現(xiàn)方案,并用一片F(xiàn)PGA芯片驗(yàn)證了其正確性和可行性。關(guān)鍵詞:FFT;FPGA;頻分分路 多載波信號(hào)的數(shù)字化分路是衛(wèi)星通信星上處理技術(shù)的關(guān)鍵技術(shù)之一,數(shù)字化分路技術(shù)主要有并行濾波器組分路、樹(shù)形濾波器組分路和多相陣列FFT分路三種。在通道數(shù)較多時(shí),多相陣列FFT有效地使用了抽取技術(shù),且FFT算法具有很高的計(jì)算效率,本文所討論的就是該方法中FFT的實(shí)現(xiàn)。
- 關(guān)鍵字: FFT FPGA 頻分分路
基于FPGA的可編程定時(shí)器/計(jì)數(shù)器8253的設(shè)計(jì)與實(shí)現(xiàn)
- 摘 要:本文介紹了可編程定時(shí)器/計(jì)數(shù)器8253的基本功能,以及一種用VHDL語(yǔ)言設(shè)計(jì)可編程定時(shí)器/計(jì)數(shù)器8253的方法,詳述了其原理和設(shè)計(jì)思想,并利用Altera公司的FPGA器件ACEX 1K予以實(shí)現(xiàn)。關(guān)鍵詞:FPGA;IP;VHDL 引言在工程上及控制系統(tǒng)中,常常要求有一些實(shí)時(shí)時(shí)鐘,以實(shí)現(xiàn)定時(shí)或延時(shí)控制,如定時(shí)中斷,定時(shí)檢測(cè),定時(shí)掃描等,還要求有計(jì)數(shù)器能對(duì)外部事件計(jì)數(shù)。要實(shí)現(xiàn)定時(shí)或延時(shí)控制,有三種主要方法:軟件定時(shí)、不可編程的硬件定時(shí)、可編程的硬件定時(shí)器。其中可編
- 關(guān)鍵字: FPGA IP VHDL
256級(jí)灰度LED點(diǎn)陣屏顯示原理及基于FPGA的電路設(shè)計(jì)
- 摘 要:本文提出了一種LED點(diǎn)陣屏實(shí)現(xiàn)256級(jí)灰度顯示的新方法。詳細(xì)分析了其工作原理。并依據(jù)其原理,設(shè)計(jì)出了基于FPGA 的控制電路。關(guān)鍵詞:256級(jí)灰度;LED點(diǎn)陣屏;FPGA;電路設(shè)計(jì) 引言256級(jí)灰度LED點(diǎn)陣屏在很多領(lǐng)域越來(lái)越顯示出其廣闊的應(yīng)用前景,本文提出一種新的控制方式,即逐位分時(shí)控制方式。隨著大規(guī)模可編程邏輯器件的出現(xiàn),由純硬件完成的高速、復(fù)雜控制成為可能。 逐位分時(shí)點(diǎn)亮工作原理所謂逐位分時(shí)點(diǎn)亮,即從一個(gè)字節(jié)數(shù)據(jù)中依次提取出一位數(shù)據(jù),分8次點(diǎn)亮對(duì)應(yīng)的像
- 關(guān)鍵字: 256級(jí)灰度 FPGA LED點(diǎn)陣屏 電路設(shè)計(jì) 發(fā)光二極管 LED
一種高效的復(fù)信號(hào)處理芯片設(shè)計(jì)
- 摘 要:本文提出了一種高效的復(fù)信號(hào)處理芯片的設(shè)計(jì)方法。本芯片是某雷達(dá)信號(hào)處理機(jī)的一部分,接收3組ADC的輸出復(fù)數(shù)據(jù),依次完成去直流、加窗、512點(diǎn)FFT、求功率譜和累加3組信號(hào)的功率譜等功能。在這5種功能中,加窗、512點(diǎn)FFT和求功率譜復(fù)用一個(gè)蝶形單元。本芯片由單片F(xiàn)PGA實(shí)現(xiàn),計(jì)算精度高、速度較快,滿足雷達(dá)系統(tǒng)的實(shí)時(shí)處理要求。關(guān)鍵詞: FFT;蝶形單元;塊浮點(diǎn);功率譜; FPGA 引言復(fù)信號(hào)處理芯片是某雷達(dá)系統(tǒng)的一部分。雷達(dá)系統(tǒng)的實(shí)時(shí)處理特點(diǎn)要求芯片運(yùn)
- 關(guān)鍵字: FFT FPGA 蝶形單元 功率譜 塊浮點(diǎn)
從ASIC 到PLD:半導(dǎo)體技術(shù)市場(chǎng)趨勢(shì)展望
- 根據(jù)Dataquest的統(tǒng)計(jì)數(shù)據(jù),PLD是半導(dǎo)體行業(yè)中增長(zhǎng)最快的細(xì)分市場(chǎng),復(fù)合年度增長(zhǎng)率(CAGR)達(dá)19.5%。這一數(shù)字是ASIC市場(chǎng)預(yù)計(jì)9%復(fù)合年度增長(zhǎng)率的兩倍多。過(guò)去,可編程芯片在半導(dǎo)體行業(yè)中一直是很重要的外圍器件,由于其靈活性而被廣泛用于ASIC仿真、膠合邏輯,或者作為適應(yīng)標(biāo)準(zhǔn)變化的一種解決方案。今天,在與ASIC和ASSP的市場(chǎng)份額競(jìng)爭(zhēng)中,PLD取得了很大進(jìn)步。目前,該技術(shù)正逐漸成為主要設(shè)計(jì)技術(shù),而且業(yè)界也在普遍向可編程芯片轉(zhuǎn)移。作為重要的ASIC替代解決方案,PLD現(xiàn)在已成為大勢(shì)所趨。促進(jìn)這種
- 關(guān)鍵字: Xilinx
XILINX解決方案支持未來(lái)可編程無(wú)線基站
- 可編程解決方案全球領(lǐng)導(dǎo)供應(yīng)商賽靈思公司(Xilinx, Inc. (NASDAQ: XLNX) )今天公布了專(zhuān)門(mén)為支持"適應(yīng)未來(lái)"的可編程無(wú)線基站而設(shè)計(jì)的一整套芯片、軟件和IP解決方案。賽靈思靈活經(jīng)濟(jì)的解決方案可以替代傳統(tǒng)的ASIC(專(zhuān)用集成電路)解決方案,通過(guò)加快產(chǎn)品上市速度、實(shí)現(xiàn)零沉沒(méi)工程成本(NRE)以及提供現(xiàn)場(chǎng)可升級(jí)能力,它可以大大降低資本支出(CAPEX)和運(yùn)營(yíng)費(fèi)用(OPEX)。 通過(guò)遠(yuǎn)程升級(jí),服務(wù)供應(yīng)商可大大延長(zhǎng)基站壽命,同時(shí)避免高昂的運(yùn)輸費(fèi)用和硬件開(kāi)發(fā)費(fèi)用。例如,通過(guò)遠(yuǎn)程下載軟件對(duì)賽靈思器件
- 關(guān)鍵字: XILINX
XILINX SPARTAN-3 FPGA用于微軟車(chē)載信息系統(tǒng)解決方案
- 全球領(lǐng)先的可編程邏輯供應(yīng)商賽靈思公司(Xilinx, Inc.)今天宣布其Spartan-3現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)器件被用來(lái)成功開(kāi)發(fā)和生產(chǎn)出了一款靈活和低成本的車(chē)載信息系統(tǒng)。該系統(tǒng)將被集成應(yīng)用于每一輛菲亞特汽車(chē)中。根據(jù)與菲亞特汽車(chē)公司共同確定的一款參考設(shè)計(jì),微軟公司的汽車(chē)業(yè)務(wù)部與賽靈思、三星、ScanSoft、西門(mén)子、SiRF和Magneti-Marelli公司合作共同開(kāi)發(fā)解決方案,每家企業(yè)都分別提供了系統(tǒng)的主要部分,包括芯片組、處理器、通信模塊、語(yǔ)音引擎和硬件開(kāi)發(fā)等。 賽靈思Spartan-3 F
- 關(guān)鍵字: XILINX
基于AD9430的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 摘 要:本文介紹了高速ADC AD9430的功能,詳細(xì)說(shuō)明了使用高速FPGA來(lái)控制AD9430構(gòu)成高速(140MSPS)、高精度(12位)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法,并給出了具體實(shí)現(xiàn)的系統(tǒng)框圖和測(cè)試結(jié)果。關(guān)鍵詞:數(shù)據(jù)采集;FPGA;AD9430引言結(jié)合實(shí)際任務(wù)的要求,本文提出了一種基于AD9430的高速數(shù)據(jù)采集系統(tǒng),主要用于采集雷達(dá)回波。在這個(gè)系統(tǒng)中,選用高速邏輯器件控制A/D轉(zhuǎn)換和FIFO存儲(chǔ),同時(shí)通過(guò)FPDP(Front Panel Data Port)總線將采集的數(shù)據(jù)發(fā)送出去。由
- 關(guān)鍵字: AD9430 FPGA 數(shù)據(jù)采集
基于FPGA的非對(duì)稱(chēng)同步FIFO設(shè)計(jì)
- 摘 要:本文在分析了非對(duì)稱(chēng)同步FIFO的結(jié)構(gòu)特點(diǎn)及其設(shè)計(jì)難點(diǎn)的基礎(chǔ)上,采用VHDL描述語(yǔ)言,并結(jié)合FPGA,實(shí)現(xiàn)了一種非對(duì)稱(chēng)同步FIFO的設(shè)計(jì)。關(guān)鍵詞:非對(duì)稱(chēng)同步FIFO;VHDL;FPGA;DLL;BlockRAM引言FIFO是一種常用于數(shù)據(jù)緩存的電路器件,可應(yīng)用于包括高速數(shù)據(jù)采集、多處理器接口和通信中的高速緩沖等各種領(lǐng)域。然而在某些應(yīng)用,例如在某數(shù)據(jù)采集和處理系統(tǒng)中,需要通過(guò)同步FIFO來(lái)連接8位A/D和16位數(shù)據(jù)總線的MCU,但是由于目前同步FIFO器件的輸入與輸
- 關(guān)鍵字: BlockRAM DLL FPGA VHDL 非對(duì)稱(chēng)同步FIFO 存儲(chǔ)器
基于FPGA的高速數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)
- 摘 要:本文提出了一種利用邊沿觸發(fā)鑒相縮短鎖相環(huán)捕獲時(shí)間的方案,并詳細(xì)介紹了該方案基于FPGA的實(shí)現(xiàn)方法。通過(guò)對(duì)所設(shè)計(jì)的鎖相環(huán)進(jìn)行計(jì)算機(jī)仿真和硬件測(cè)試,表明該方案確實(shí)可以提高鎖相環(huán)的捕獲性能。關(guān)鍵詞:數(shù)字鎖相環(huán)(DPLL);捕獲時(shí)間;FPGA;VHDL引言捕獲時(shí)間是鎖相環(huán)的一個(gè)重要參數(shù),指的是鎖相環(huán)從起始狀態(tài)到達(dá)鎖定狀態(tài)所需時(shí)間。在一些系統(tǒng)中,如跳頻通信系統(tǒng),由于系統(tǒng)工作頻率不斷地發(fā)生快速變化(每秒幾百次到幾千次,甚至高達(dá)上萬(wàn)次),要求鎖相環(huán)能夠?qū)π盘?hào)相位快速捕獲。因此
- 關(guān)鍵字: FPGA VHDL 捕獲時(shí)間 數(shù)字鎖相環(huán)(DPLL)
XILINX公司CPLD市場(chǎng)份額繼續(xù)增長(zhǎng)
- 賽靈思公司(Xilinx, Inc.)今天確認(rèn)在12月結(jié)束的財(cái)政季度里,其CPLD市場(chǎng)份額繼續(xù)保持增長(zhǎng)。CPLD的發(fā)展勢(shì)頭明顯有利于賽靈思。在2004公歷年第四季度中,賽靈思CPLD的銷(xiāo)售收入約占其總收入的10%。此外,這也是賽靈思在CPLD市場(chǎng)中的份額連續(xù)第16個(gè)季度保持增長(zhǎng)。隨著公司在個(gè)人消費(fèi)、通信、存儲(chǔ)和服務(wù)器市場(chǎng)不斷贏得設(shè)計(jì)客戶,賽靈思相信已經(jīng)成為目前全球第二大CPLD供應(yīng)商。 XC9500 和 CoolRunner系列的聯(lián)合增長(zhǎng)推動(dòng)市場(chǎng)擴(kuò)展采用由XC9500XL 和 CoolRunner-II器
- 關(guān)鍵字: XILINX
XILINX在亞太地區(qū)擴(kuò)展其曾獲殊榮客戶支持服務(wù)
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)供應(yīng)商賽靈思公司(Xilinx, Inc.)今天宣布在亞太地區(qū)擴(kuò)展其曾獲殊榮的客戶支持服務(wù),以配合該公司在亞太區(qū)和中國(guó)積極發(fā)展的計(jì)劃。這些服務(wù)將設(shè)在賽靈思公司上海辦事處,主要服務(wù)項(xiàng)目包括:
- 關(guān)鍵字: XILINX
xilinx fpga介紹
Xilinx FPGA
Xilinx FPGA主要分為兩大類(lèi),一種側(cè)重低成本應(yīng)用,容量中等,性能可以滿足一般的邏輯設(shè)計(jì)要求,如Spartan系列;還有一種側(cè)重于高性能應(yīng)用,容量大,性能能滿足各類(lèi)高端應(yīng)用,如Virtex系列,用戶可以根據(jù)自己實(shí)際應(yīng)用要求進(jìn)行選擇。 在性能可以滿足的情況下,優(yōu)先選擇低成本器件。
Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細(xì) ]
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