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詳解基于蜜罐技術(shù)的FPGA實現(xiàn)技術(shù)

詳解基于蜜罐技術(shù)的FPGA實現(xiàn)技術(shù)-　蜜罐技術(shù)由來已久，蜜罐（Honeypot）是一種在互聯(lián)網(wǎng)上運行的計算機系統(tǒng)。它是專門為吸引并誘騙那些試圖非法闖入他人計算機系統(tǒng)的人（如電腦黑客）而設(shè)計的，蜜罐系統(tǒng)是一個包含漏洞的誘騙系統(tǒng)，它通過模擬一個或多個易受攻擊的主機，給攻擊者提供一個容易攻擊的目標。
關(guān)鍵字： FPGA 蜜罐技術(shù)

FPGA可測性設(shè)計的“大數(shù)據(jù)”原理

FPGA可測性設(shè)計的“大數(shù)據(jù)”原理-當下，最火的學(xué)問莫過于“大數(shù)據(jù)”，大數(shù)據(jù)的核心思想就是通過科學(xué)統(tǒng)計，實現(xiàn)對于社會、企業(yè)、個人的看似無規(guī)律可循的行為進行更深入和直觀的了解。FPGA的可測性也可以對FPGA內(nèi)部“小數(shù)據(jù)”的統(tǒng)計查詢，來實現(xiàn)對FPGA內(nèi)部BUG的探查。
關(guān)鍵字：大數(shù)據(jù) FPGA FIFO

使用FPGA構(gòu)建的數(shù)字濾波器設(shè)計方案

使用FPGA構(gòu)建的數(shù)字濾波器設(shè)計方案-本文簡要介紹了FIR數(shù)字濾波器的結(jié)構(gòu)特點和基本原理，提出基于FPGA和DSP Builder的FIR數(shù)字濾波器的基本設(shè)計流程和實現(xiàn)方案。##FIR 數(shù)字濾波器的詳細設(shè)計。
關(guān)鍵字：數(shù)字濾波器 fpga fir數(shù)字濾波器

創(chuàng)意耳紋識別系統(tǒng)的研究與實現(xiàn)方案

創(chuàng)意耳紋識別系統(tǒng)的研究與實現(xiàn)方案-基于FPGA與傳感技術(shù)的耳紋識別系統(tǒng)的研究與實現(xiàn)。
關(guān)鍵字： FPGA 傳感器技術(shù)

利用可編程器件設(shè)計車用顯示系統(tǒng)的方案

利用可編程器件設(shè)計車用顯示系統(tǒng)的方案-電子設(shè)備正在迅速發(fā)展，尤其是車用顯示系統(tǒng)，視頻和視頻處理正成為汽車應(yīng)用中增長較快的技術(shù)。像車道保持、駕駛監(jiān)控、夜視以及車載娛樂設(shè)備等都是典型的應(yīng)用需求。
關(guān)鍵字：可編程器件 FPGA

ASIC、ASSP、SoC和FPGA之間到底有何區(qū)別？

ASIC、ASSP、SoC和FPGA之間到底有何區(qū)別？-我經(jīng)常收到關(guān)于各類設(shè)備之間的差異的問題，諸如ASIC、ASSP、SoC和FPGA之間的區(qū)別問題。例如是SoC是ASIC嗎？或ASIC是SoC嗎？ASIC和ASSP之間的區(qū)別是什么？以及高端FPGA應(yīng)該歸類為SoC嗎？
關(guān)鍵字： FPGA SoC ASSP ASIC

基于FPGA的數(shù)字核脈沖分析器硬件設(shè)計解析

基于FPGA的數(shù)字核脈沖分析器硬件設(shè)計解析-多道脈沖幅度分析儀和射線能譜儀是核監(jiān)測與和技術(shù)應(yīng)用中常用的儀器。
關(guān)鍵字：硬件設(shè)計脈沖分析器 FPGA

利用可編程振蕩器增強FPGA應(yīng)用

利用可編程振蕩器增強FPGA應(yīng)用-可編程時鐘振蕩器用作FPGA系統(tǒng)的時序參考，可提供一系列優(yōu)勢。其中首要優(yōu)勢是為了實現(xiàn)時鐘樹優(yōu)化而進行高分辨率頻率選擇時所帶來的設(shè)計靈活性，另一個巨大優(yōu)勢是具有可以減少電磁干擾（EMI）的擴頻調(diào)制功能。
關(guān)鍵字： DLL PLL FPGA

基于FPGA多路冗余視覺信號的處理

基于FPGA多路冗余視覺信號的處理-采用以FPGA作為核心處理器實現(xiàn)了對多路DVI視頻冗余信號的解碼、編碼實時處理以及輸出顯示，并且信號通道增加冗余設(shè)計，因而加強了系統(tǒng)的穩(wěn)定性和可靠性。電路設(shè)計簡潔，具有較強的靈活性和擴展性。通過實際測試結(jié)果表明，系統(tǒng)能夠流暢地對1600×1200分辨率，60 Hz刷新率，24位真彩色的高清視頻進行實時處理，其系統(tǒng)可靠、穩(wěn)定，實用性強。
關(guān)鍵字： FPGA 圖像處理 DVI

基于FPGA的軟硬件協(xié)同仿真加速技術(shù)

基于FPGA的軟硬件協(xié)同仿真加速技術(shù)-在系統(tǒng)設(shè)計中，硬件復(fù)雜電路設(shè)計的調(diào)試與仿真工作對于設(shè)計者來說十分困難。為了降低仿真復(fù)雜度，加快仿真速度，本文提出利用FPGA加速的思想，實現(xiàn)軟硬件協(xié)同加速仿真。經(jīng)過實驗，相對于純軟件仿真，利用軟硬件協(xié)同加速仿真技術(shù)，仿真速度提高近30倍，大大縮短了仿真時間。
關(guān)鍵字： FPGA 軟硬件協(xié)同仿真仿真加速

基于FPGA實現(xiàn)VGA的彩色圖片顯示

基于FPGA實現(xiàn)VGA的彩色圖片顯示-VGA作為一種標準顯示接口，廣泛應(yīng)用于各種智能控制的顯示終端。伴隨著電子產(chǎn)業(yè)的不斷發(fā)展，尤其是高速圖像處理的發(fā)展對可以將實時圖像進行高速處理有了更高的要求。這里根據(jù)VGA接口的原理，通過FPGA對VGA進行控制，實現(xiàn)任一彩色圖像的顯示。通過采用FPGA設(shè)計VGA接口可以將要顯示的數(shù)據(jù)直接送到液晶顯示器，節(jié)省了計算機的處理過程，加快了數(shù)據(jù)的處理速度，節(jié)約了硬件成本。
關(guān)鍵字： VGA MATLAB FPGA

基于FPGA的超寬帶數(shù)字下變頻設(shè)計

基于FPGA的超寬帶數(shù)字下變頻設(shè)計-本文介紹了基于FPGA、以并行多相濾波結(jié)構(gòu)為算法基礎(chǔ)的超寬帶數(shù)字下變頻技術(shù)。設(shè)計過程包括高速AD信號降速預(yù)處理，應(yīng)用SysGen開發(fā)環(huán)境完成的數(shù)字混頻、多相濾波和數(shù)據(jù)抽取，并通過仿真驗證了算法的可行性。
關(guān)鍵字： FPGA 變頻技術(shù)

如何調(diào)試數(shù)字硬件設(shè)計？

如何調(diào)試數(shù)字硬件設(shè)計？-工程設(shè)計項目中最令人振奮的時刻之一就是第一次將硬件移到實驗室準備開始集成測試的時候。開發(fā)過程中的這個階段通常需要很長時間，也會對所有的項目工程師造成很大的壓力。不過，現(xiàn)有的工具和方法能減輕壓力，幫助推進項目進展。
關(guān)鍵字：硬件調(diào)試 FPGA

FPGA工程師不得不知的FPGA設(shè)計經(jīng)驗

FPGA工程師不得不知的FPGA設(shè)計經(jīng)驗-在IC工業(yè)中有許多不同的領(lǐng)域，IC設(shè)計者的特征也會有些不同。在A領(lǐng)域的一個好的IC設(shè)計者也許會花很長時間去熟悉B領(lǐng)域的知識。在我們職業(yè)生涯的開始，我們應(yīng)該問我們自己一些問題，我們想要成為怎樣的IC設(shè)計者？消費？PC外圍？通信？微處理器或DSP？等等。
關(guān)鍵字： FPGA

透過設(shè)計實例揭秘FPGA電源的N個考慮事項

透過設(shè)計實例揭秘FPGA電源的N個考慮事項-本文分析了針對FPGA的電源要求，提供了關(guān)于如何將其放在PCB上和放在什么位置的指導(dǎo)，并通過一個設(shè)計示例讓讀者熟悉設(shè)計步驟，設(shè)計當中FPGA所在的系統(tǒng)由12 V總線供電，這是來自市電供電SMPS的主輸出。
關(guān)鍵字： FPGA電源 PCB Altera Xilinx FPGA

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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實際應(yīng)用要求進行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開發(fā)產(chǎn)品的時間 [ 查看詳細 ]