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多路同步串口的FPGA傳輸實現

作者: 時間:2009-05-21 來源:詹必勝 吳斌方 楊光友 湖北工業(yè)大學 收藏

  結語

本文引用地址:http://butianyuan.cn/article/94602.htm

  利用的實時數據處理能力與優(yōu)越的硬線邏輯設計相結合,保證了多通道數據采集系統(tǒng)的實時性和精度要求,實現高速數據傳輸,同時簡化系統(tǒng)硬件設計,縮小系統(tǒng)體積,具有極高的性價比。系統(tǒng)的數字部分硬件采用Verilog硬件描述語言實現,便于修改和升級,可根據實際測試應用需求作靈活的改進。本數據采集傳輸模塊已成功實現,并取得了良好的應用效果。

  參考文獻:

  [1]吳繼華,王誠. Altera /CPLD設計(基礎篇)[M]. 人民郵電出版社 2005:64-65

  [2]www.altera.com

  [3]A-2126x SHARC Peripherals Manual. 2004

  [4]夏宇聞.Verilog數字系統(tǒng)設計[M].北京:北京航空航天出版社,2003

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