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可產(chǎn)生正弦波等波形的8位雙極性D-A轉(zhuǎn)換器

  • 電路的功能8位雙極性DAC的功能是用數(shù)字來產(chǎn)生波形。它形成的波形頻率可達(dá)1MHZ左右。本電路除可用作普通中速D-A轉(zhuǎn)換外，還可用作數(shù)字合成電路的振蕩輸出電路。DAC08本身只能輸出電流，為了進(jìn)行電流-電壓轉(zhuǎn)換，加了調(diào)整
  • 關(guān)鍵字： D-A  正弦波  波形  8位    

調(diào)節(jié)方便的高精度PWM（脈沖寬度調(diào)制）式12位D-A轉(zhuǎn)

  • 電路的功能脈沖寬度調(diào)制式D-A轉(zhuǎn)換器多用于慢速響應(yīng)的電源控制電路。因?yàn)檩敵鲭妷喝Q于占空比，所以只要調(diào)準(zhǔn)滿量程電壓，就可成為高精度DAC。電路的選用普通器件，能以12位分辨率選定0~+10V電壓。電路工作原理輸入PW
  • 關(guān)鍵字： PWM  D-A  調(diào)節(jié)  高精度    

基于利用單片機(jī)構(gòu)成高精度PWM式12位D/A方法

  • 　在用單片機(jī)制作的變送器類和控制器類的儀表中，需要輸出1―5V或4―20mA的直流信號的時(shí)候，通常采用專用的D/A芯片，一般是每路一片。當(dāng)輸出信號的精度較高時(shí)，D/A芯片的位數(shù)也將隨之增加?！　≡诠I(yè)儀表中，通常增
  • 關(guān)鍵字： 12位  D/A  方法  PWM  高精度  利用  單片機(jī)  構(gòu)成  基于  

把1NA~100UA的電流轉(zhuǎn)換成0.1HZ~10KHZ的電流-頻率轉(zhuǎn)

  • IIN/C1（V/S），1UA電流為10的負(fù)6次方/800*10的負(fù)12次方=1.25*10的6次方V/S，穿越-5.6~+5.6V的時(shí)間林約是9MS，頻率為111HZ。實(shí)際上必須加上上升時(shí)間，所以振蕩頻率大約為100HZ。因?yàn)镃1的微調(diào)很困難，所以允許A2的正反
  • 關(guān)鍵字： 100  0.1  KHZ  電流    

可在1.6K~1.6M范圍內(nèi)變化的電壓控制可變電阻電路

  • 電路的功能與可變電阻起相同作用的器件有FET漏-源電阻、模擬乘法器等，但它們都不能浮地。本電路采用CDS光耦合器反饋，使線性得到改善。兩個(gè)可變電阻阻值可在1.6K~1.6M之間變化，并且完全被隔離，所以本電路的應(yīng)用范
  • 關(guān)鍵字： 1.6  變化  電壓控制  電路    

數(shù)字式設(shè)置，基準(zhǔn)電壓為0.1~9.9V的比較器

  • 電路的功能比較電路的基準(zhǔn)電壓大多是用電阻把電源電壓分壓后得到，這種方法適用于基準(zhǔn)電壓一旦選定就無須調(diào)整的情況。如果基準(zhǔn)電壓能從外部通過數(shù)字信號來改變，應(yīng)用起來將會(huì)更方便。本電路是基準(zhǔn)電壓從同相輸入端輸
  • 關(guān)鍵字： 0.1  9.9  數(shù)字式  基準(zhǔn)電壓    

采用乘法D-A轉(zhuǎn)換器的電子衰減器

  • 電路的功能信號的大小調(diào)整通常采用電阻衰減器或用可變電阻分壓電路等，如果無須連續(xù)調(diào)整使用電子衰減器則更方便。其衰減度可變，采用8個(gè)數(shù)據(jù)位，以1/256為一級，可從無窮大變到255/256≈0DB。電路工作原理AD7523是8位
  • 關(guān)鍵字： D-A  乘法  轉(zhuǎn)換器  電子    

從一個(gè)D-A轉(zhuǎn)換器上獲得4路輸出的譯碼多路切換電路

  • 電路的功能在輸入端連接多路模擬切換器，進(jìn)行多路A-D轉(zhuǎn)換時(shí)，如通道掃描速度比較慢，大多采用多個(gè)A-D轉(zhuǎn)換電路。本電路與此相反，是把一個(gè)D-A轉(zhuǎn)換器變成4路輸出，構(gòu)成4個(gè)等效的D-A轉(zhuǎn)換器，它用于允許D-A輸出轉(zhuǎn)換速度慢
  • 關(guān)鍵字： D-A  轉(zhuǎn)換器  多路  切換電路    

一種基于FPGA的新型數(shù)字電壓表研究與設(shè)計(jì)

  • 數(shù)字電壓表是大學(xué)物理教學(xué)和實(shí)驗(yàn)中的重要儀表，其數(shù)字化是指將連續(xù)的模擬電壓量轉(zhuǎn)換成不連續(xù)、離散的數(shù)字...
  • 關(guān)鍵字： FPGA  數(shù)字電壓表  A/D  

基于CPLD的IEEE1149.1 USB下載電纜設(shè)計(jì)

  • 引言隨著片上系統(tǒng)(SoC，SystemonChip)時(shí)代的到來，包括復(fù)雜可編程邏輯器件(CPLD，ComplexProgrammab...
  • 關(guān)鍵字： FPGA  CPLD  USB下載電纜  IEEE1149.1  

基于FPGA的高速A/D轉(zhuǎn)換芯片ADC08D1000應(yīng)用

  • 0引言美國國家半導(dǎo)體公司的超高速ADC-ADC08D1000是一款高性能的模／數(shù)轉(zhuǎn)換芯片。它具有雙通道結(jié)構(gòu)...
  • 關(guān)鍵字： FPGA  A/D轉(zhuǎn)換  ADC08D1000  

G.723.1算法在DSP上的優(yōu)化

  • G.723.1算法在DSP上的優(yōu)化,1 引言　　G.723.1是刪組織于1996年推出的一種低碼率的語音編碼算法標(biāo)準(zhǔn)，也是目前該組織頒布的語音壓縮標(biāo)準(zhǔn)中碼率最低的一種標(biāo)準(zhǔn)。G.723.1主要用于對語音及其它多媒體聲音信號的壓縮，目前在一些數(shù)字音視頻傳輸、高
  • 關(guān)鍵字： 優(yōu)化  DSP  算法  G.723.1  

用DSP優(yōu)化G.723.1算法

  • 用DSP優(yōu)化G.723.1算法,　本文詳緇分紹了G.723.1標(biāo)準(zhǔn)的DSP代碼優(yōu)化工作，重點(diǎn)描述了代碼優(yōu)化的方法和本課題的創(chuàng)新點(diǎn)．對于算法中的一些函數(shù)提出了獨(dú)創(chuàng)性改寫方法。基于線性匯編的優(yōu)化以及Cache的有效利用使本課題的工作取得了顯著成果，在沒有降低音質(zhì)的情況下，實(shí)現(xiàn)了DSP的語音實(shí)時(shí)編解碼。
  • 關(guān)鍵字： 算法  G.723.1  優(yōu)化  DSP  

AD6645型A/D轉(zhuǎn)換器在軟件無線電中的設(shè)計(jì)原理及應(yīng)用

  • 1 引言 A/D轉(zhuǎn)換器在系統(tǒng)中所處的位置是很關(guān)鍵的，因?yàn)樗苯臃从耻浖某潭?對理想的軟件無線電而言,A/D轉(zhuǎn)換器的動(dòng)態(tài)范圍必須為100dB~120dB,最大信號輸入頻率在1GHz~5GHz之間，目前器件發(fā)展水平很難實(shí)現(xiàn)這些技術(shù)
  • 關(guān)鍵字： 設(shè)計(jì)  原理  應(yīng)用  無線電  軟件  A/D  轉(zhuǎn)換器  AD6645  
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