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EEPW首頁 >> 主題列表 >> asic-to-fpga

低成本人機交互設(shè)計：基于FPGA的體感游戲

  • 體感游戲是視覺與本體感覺和動作控制的集合，伴隨著虛擬現(xiàn)實技術(shù)的迅猛發(fā)展，正逐步走入市場。為了達到視覺、運動相結(jié)合的目的，采用加速度傳感器與VGA顯示器相結(jié)合的方法，通過戴有速度手套的手的運動來完成對游戲
  • 關(guān)鍵字： 加速度傳感器    FPGA    VGA    體感游戲  

關(guān)于可編程邏輯，你可能已經(jīng)遺忘的8件事

  • 曾幾何時，原理圖就是工程師們的一切，一張羊皮圖紙，一支自動鉛筆，一把直尺，一個綠色邏輯模版，一塊橡皮擦，一塊金屬擦除模板，直到上世紀80年代，計算機的出現(xiàn)，使原理圖的制作技術(shù)得到了一個大的飛躍。到上世紀
  • 關(guān)鍵字： 可編程邏輯    FPGA    FPLA  

基于FPGA的水聲信號采集與存儲系統(tǒng)設(shè)計

  • 摘要：為實現(xiàn)對水聲信號的多通道同步采集并存儲，提出了一種基于FPGA的多通道信號同步采集、高速大容量實時存儲的系統(tǒng)設(shè)計方案，并完成系統(tǒng)的軟硬件設(shè)計。該系統(tǒng)的硬件部分采用模塊化設(shè)計，通過FPGA豐富的外圍接口實
  • 關(guān)鍵字： FPGA  水聲信號  同步采集  高速存儲  

便攜式邏輯分析儀的設(shè)計與實現(xiàn)

  • 摘要 介紹一種16通道便攜式邏輯分析儀，通過FPGA將高速數(shù)據(jù)采樣并緩存，采用USB控制芯片和FPCA協(xié)同控制將數(shù)據(jù)通過USB接口發(fā)送到電腦的上位機上顯示，簡化了以往邏輯分析儀硬件電路部分，降低了邏輯分析儀的成本且便
  • 關(guān)鍵字： 邏輯分析儀  USB接口  FPGA  FIFO傳輸  

利用信號平均技術(shù)，消除噪聲干擾，提升重復(fù)信號采樣的精準(zhǔn)度

  • 許多高速數(shù)據(jù)采集應(yīng)用，如激光雷達或光纖測試等，都需要從嘈雜的環(huán)境中采集小的重復(fù)信號，因此對于數(shù)據(jù)采集系統(tǒng)的設(shè)計來說，最大的挑戰(zhàn)就是如何最大限度地減少噪聲的影響。利用信號平均技術(shù)，可以讓您的測量測試系統(tǒng)
  • 關(guān)鍵字： FPGA  DSP  PCIe-9852  網(wǎng)絡(luò)通信  多媒體處理  

通過FPGA設(shè)計安全的高級輔助駕駛系統(tǒng)

  • 隨著道路上汽車數(shù)量的增加，我們需要更多的技術(shù)來進一步減少交通事故。過去幾年，基于雷達和攝像機的新系統(tǒng)功能的出現(xiàn)使駕駛更加安全。很多高級輔助駕駛系統(tǒng)(ADAS)應(yīng)用，如自動巡航控制、道路偏離報警、交通信號標(biāo)志
  • 關(guān)鍵字： FPGA  駕駛系統(tǒng)  汽車電子  

基于DSP Builder的CIC梳狀濾波器的設(shè)計

  • 摘要：CIC梳狀濾波器具有結(jié)構(gòu)簡單、規(guī)整，占用存儲量小，不需要乘法器，實現(xiàn)簡單且速度高等特點，在高速抽取或插值系統(tǒng)應(yīng)用廣泛。采用DSP Builder軟件工具，在Simulink平臺上構(gòu)建了一級4階CIC梳狀濾波器仿真模型，通
  • 關(guān)鍵字： DSP Builder  FPGA  CIC梳狀濾波器  仿真模型  

FPGA 101：計算復(fù)雜數(shù)學(xué)函數(shù)

  • 由于其靈活性與高性能，F(xiàn)PGA已經(jīng)在眾多需要計算復(fù)雜數(shù)學(xué)題或傳遞函數(shù)的工業(yè)、科研、軍事及其它應(yīng)用中找到用武之地?？量痰木纫笈c計算時延在更關(guān)鍵的應(yīng)用中并不少見。在采用FPGA實現(xiàn)數(shù)學(xué)函數(shù)時，工程師一般選擇定
  • 關(guān)鍵字： FPGA  函數(shù)  

關(guān)于Spartan-3E的低成本顯示器解決方案

  • 曾幾何時，高清晰度平板顯示電視機對普通消費者來說價格高昂。如今，它們已能夠被經(jīng)濟地大量生產(chǎn)，而且價格能為大多數(shù)家庭所接受。顯示板制造商正在擴大生產(chǎn)能力，以滿足需求并促進更高的消費量。根據(jù) iSuppli 公司
  • 關(guān)鍵字： Spartan-3E  FPGA  

基于MSP430與FPGA的多功能數(shù)字頻率儀設(shè)計*

  • 本文采用以FPGA為主，MSP430為輔的框架系統(tǒng)處理方式設(shè)計了多功能數(shù)字頻率儀。該裝置采用低頻直接測周期，高頻等精度多周期同步測量的方法，通過進一步優(yōu)化標(biāo)準(zhǔn)時鐘頻率的設(shè)置，克服了傳統(tǒng)測頻方法在高精度要求方面的缺陷。將MSP430作為控制處理核心、FPGA作為信號處理單元，將高效控制與快速運算能力相結(jié)合，實現(xiàn)正弦波頻率、兩路方波信號時間間隔以及矩形脈沖占空比的測量。測試表明，該裝置具有高精度、高穩(wěn)定性、裝配簡易和操作便利的特點。
  • 關(guān)鍵字： 多周期同步測量  標(biāo)準(zhǔn)時鐘頻率  占空比  FPGA  MSP430  201611  

基于Cortex-M3的北斗二代基帶芯片設(shè)計

  • 我國自主研制的北斗衛(wèi)星導(dǎo)航系統(tǒng)，日益在經(jīng)濟、軍事和民用領(lǐng)域得到越來越廣的應(yīng)用。本文提出并設(shè)計了基于Cortex-M3處理器的北斗接收機基帶處理芯片，設(shè)計了時域頻域二維并行捕獲模塊，同時闡述了基于Cortex-M3處理器的控制流程，包括對捕獲引擎、跟蹤引擎的調(diào)度，電文解調(diào)和定位解算等。本設(shè)計最后在FPGA上完成原型驗證，定位結(jié)果符合算法預(yù)期。
  • 關(guān)鍵字： 北斗衛(wèi)星導(dǎo)航系統(tǒng)  Cortex-M3  FPGA  201611  

基于Zynq平臺硬件加速的體感游戲

  • 隨著嵌入式系統(tǒng)的發(fā)展，我們已經(jīng)越來越離不開它們。本文設(shè)計了一個基于Xilinx ZYNQ平臺硬件加速的體感游戲。首先，我們完成了手勢方向控制貪食蛇游戲，該游戲通過進行膚色檢測、手勢跟蹤并分析軌跡，來控制貪食蛇的位置。然后，我們實現(xiàn)了用verilog語言編寫的運行在FPGA上的膚色學(xué)習(xí)和識別算法。最后，軟件游戲調(diào)用基于AXI總線的協(xié)議與硬件加速單元通信，膚色識別算法運行時間減少了43.2713%，達到了加速的效果。
  • 關(guān)鍵字： 圖像處理  FPGA  Zynq芯片  201611  

工業(yè)驅(qū)動控制SoC與MCU+FPGA架構(gòu)淺析

  • 本文分析了將一個FPGA引入到驅(qū)動架構(gòu)時所面臨的挑戰(zhàn)，以及這些架構(gòu)的發(fā)展歷史和工業(yè)驅(qū)動控制SoC(COTS MCU)的新功能如何改變在工業(yè)驅(qū)動中使用FPGA的成本效益模式。
  • 關(guān)鍵字： FPGA  COTS  MCU   201611  

ARM7與FPGA相結(jié)合的應(yīng)用

  • 　　工業(yè)控制中往往需要完成多通道故障檢測及多通道命令控制(這種多任務(wù)設(shè)置非常普遍)，單獨的CPU芯片由于其外部控制接口數(shù)量有限而難以直接完成多路檢控任務(wù)，故利用ARM芯片與FPGA相結(jié)合來擴展檢控通道是一個非常好的選擇。這里介紹用Atmel公司ARM7處理器(AT91FR40162)和ALTERA公司的低成本FPGA芯片(cyclone2)結(jié)合使用完成多通道檢控任務(wù)的一種實現(xiàn)方法。 　　各部分功能簡介 　　圖1為此系統(tǒng)的結(jié)構(gòu)連接框圖。如圖所示，ARM芯片與FPGA芯片之間通過數(shù)據(jù)總線、地址總線及讀寫控
  • 關(guān)鍵字： ARM7  FPGA  

基于ARM的便攜式1553B總線測試系統(tǒng)的設(shè)計與實現(xiàn)

  • 摘要：為了方便對1553B設(shè)備進行測試，介紹了一種基于ARM9平臺和FPGA的1553B總線測試系統(tǒng)的設(shè)計與實現(xiàn)方法。該系統(tǒng)以LPC3250作為微處理器，以CYCLONE I系列的EP1C6Q240C8芯片實現(xiàn)ARM與1553B協(xié)議芯片的接口邏輯。在Li
  • 關(guān)鍵字： ARM  MIL-STD-1553B協(xié)議  FPGA  Linux 2．6  Linux設(shè)備驅(qū)動  
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