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基于FPGA控制的IDE磁盤陣列設(shè)計
- 設(shè)計了一種基于FPGA控制的高速數(shù)據(jù)存儲系統(tǒng)。該系統(tǒng)采用FPGA實現(xiàn)了對四個符合ATA-6規(guī)范的、RAID 0配置的IDE磁盤陣列的管理,并配合四個SDRAM實現(xiàn)對數(shù)據(jù)的高速穩(wěn)定存儲。該磁盤陣列同時掛四個IDE硬盤,平均數(shù)據(jù)流達(dá)到200MB/s,峰值傳輸速率達(dá)到800MB/s,也可以擴展更多硬盤,構(gòu)成大容量的磁盤陣列。
- 關(guān)鍵字: 高速數(shù)據(jù)存儲 IDE磁盤陣列 FPGA
基于FPGA的實時數(shù)字化光纖傳輸系統(tǒng)的設(shè)計與實現(xiàn)
- 提出一種實時數(shù)字化光纖傳輸系統(tǒng),該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A/D轉(zhuǎn)換器將輸入的模擬信號數(shù)字化,再用FPGA對數(shù)據(jù)進行處理,并通過光纖傳輸。同時,F(xiàn)PGA還控制A/D轉(zhuǎn)換器的工作。接收端用串行收發(fā)器TLK1501對接收數(shù)據(jù)進行解碼處理,還原有效信號。實驗表明,該系統(tǒng)實時性好、信號傳輸誤碼率低、工作性能穩(wěn)定、抗干擾性強,系統(tǒng)具有可行性和有效性。
- 關(guān)鍵字: 光纖通訊 高速數(shù)字信號傳輸 FPGA
基于FPGA的雙路可移相任意波形發(fā)生器
- 本文論述了利用用FPGA來開發(fā)DDS函數(shù)發(fā)生器的總體設(shè)計思路,詳細(xì)討論了任意波形產(chǎn)生、頻率精確調(diào)整、雙路移相輸出、PWM調(diào)制波產(chǎn)生、D/A轉(zhuǎn)換與濾波電路、鍵盤與顯示等諸方面軟硬件實現(xiàn)方法。 整個設(shè)計
- 關(guān)鍵字: DDS 任意波形發(fā)生器 FPGA
基于FPGA的水聲信號高速采集存儲系統(tǒng)的設(shè)計與實現(xiàn)
- 介紹了一種基于FPGA的水聲信號數(shù)據(jù)采集與存儲系統(tǒng)的設(shè)計與實現(xiàn),給出了系統(tǒng)的總體方案,并對各部分硬件和軟件的設(shè)計進行了詳細(xì)描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心,以存儲容量達(dá)2 GB的大容量NAND型Flash作為存儲介質(zhì)。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊和RS-232串行通信模塊組成,具有穩(wěn)定可靠、體積小、功耗低、存儲容量大等特點,實驗證明該系統(tǒng)滿足設(shè)計要求。
- 關(guān)鍵字: 數(shù)據(jù)采集 Flash FPGA
基于FPGA的全數(shù)字交流伺服系統(tǒng)信號處理
- 在交流伺服驅(qū)動系統(tǒng)概念的基礎(chǔ)上,提出了基于ACTEL現(xiàn)場可編程邏輯器件APA300的光電編碼器與光柵尺信號處理電路設(shè)計原理,該電路由4倍頻細(xì)分、辨向電路、計數(shù)電路組成,信號處理模塊通過VHDL語言實現(xiàn)。
- 關(guān)鍵字: 交流伺服系統(tǒng) VHDL FPGA 光柵尺信號處理
一種并行存儲器系統(tǒng)的FPGA實現(xiàn)
- 圍繞小衛(wèi)星體積小、重量輕和價格低廉的特點,一個多CPU共享內(nèi)存的系統(tǒng)(CPU仍然采用有相應(yīng)宇航級器件的8086)將是比較合適的選擇。同時為了提高共享內(nèi)存的數(shù)據(jù)通信帶寬,使其不成為整個系統(tǒng)的瓶頸,本文提出了一個用ASIC設(shè)計一個共享總線開關(guān)網(wǎng)絡(luò)(簡稱SBSN,下同),組合成Omega網(wǎng)絡(luò)的方案,以消除對某一組內(nèi)存的總線競爭,實現(xiàn)多CPU對共享分組存儲系統(tǒng)的低位交叉并行訪問。
- 關(guān)鍵字: 并行存儲器 多CPU共享內(nèi)存 FPGA
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