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EEPW首頁 >> 主題列表 >> avant fpga

基于FPGA的卷積編譯碼器的設(shè)計與實現(xiàn)

  • 摘要：為了解決傳統(tǒng)的維特比譯碼器結(jié)構(gòu)復(fù)雜、譯碼速度慢、消耗資源大的問題，提出一種新型的適用于FPGA特點，路徑存儲與譯碼輸出并行工作，同步存儲路徑矢量和狀態(tài)矢量的譯碼器設(shè)計方案。該設(shè)計方案通過在ISE9.2i中仿
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賽靈思28Gbps收發(fā)器滿足對帶寬的爆炸性需求

  • 　　賽靈思公司(Xilinx Inc., )宣布推出具有28Gbps 串行收發(fā)器，支持下一代 100 - 400Gbps 應(yīng)用的 Virtex-7 HT FPGA。該系列28nm FPGA 使得通信設(shè)備商可以開發(fā)更高集成以及帶寬效率的系統(tǒng)，以滿足全球有線基礎(chǔ)設(shè)施和數(shù)據(jù)中心對帶寬的爆炸性需求。該系列器件集成了業(yè)內(nèi)最高速度和最低的收發(fā)器時鐘抖動性能，同時還支持最嚴(yán)苛的光學(xué)及背板協(xié)議。 　　
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Lattice的另類生存模式

  • 　　在FPGA行業(yè)，Lattice等中小公司為了避免和大型FPGA公司直接競爭，通常推出一些具有差異化的產(chǎn)品，例如在可編程混合信號芯片，使FPGA涉足傳統(tǒng)模擬領(lǐng)地。 　　為改善電路板的電源與數(shù)字化管理，Lattice于10月12日發(fā)布了Platfrom Manager。該產(chǎn)品已是Lattice電源管理產(chǎn)品的第三代了—Lattice早在2003年推出了第一代產(chǎn)品—Power Manager，主要功能是排序和監(jiān)控;2006年推出Power Manager II，增加了熱插拔、電壓測量、微調(diào)閾度。
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抗SEU存儲器的設(shè)計的FPGA實現(xiàn)

  • 抗SEU存儲器的設(shè)計的FPGA實現(xiàn),　　O 引言　　隨著我國航空航天事業(yè)的迅猛發(fā)展，衛(wèi)星的應(yīng)用越來越廣泛。然而，太空環(huán)境復(fù)雜多變，其中存在著各種宇宙射線與高能帶電粒子，它們對運行于其中的電子器件會產(chǎn)生各種輻射效應(yīng)。輻射效應(yīng)對電子器件的影響
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數(shù)字電路設(shè)計方案中DSP與FPGA的比較與選擇

  • 數(shù)字電路設(shè)計方案中DSP與FPGA的比較與選擇,數(shù)字信號處理技術(shù)和大規(guī)模集成電路技術(shù)的迅猛發(fā)展,為我們設(shè)計數(shù)字電路提供了新思路和新方法。當(dāng)前數(shù)字系統(tǒng)設(shè)計正朝著速度快、容量大、體積小、重量輕的方向發(fā)展。DSP和FPGA技術(shù)的發(fā)展使這一趨勢成為可能和必然。和計
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正交相干檢波方法及FPGA的實現(xiàn)

  • 正交相干檢波方法及FPGA的實現(xiàn),引言
    現(xiàn)代雷達(dá)普遍采用相參信號來進(jìn)行處理，而如何獲得高精度基帶數(shù)字正交(I，Q)信號是整個系統(tǒng)信號處理成敗的關(guān)鍵。傳統(tǒng)的做法是采用模擬相位檢波器來得到I、Q信號，其正交性能一般為：幅度平衡在2％左右，相位
  • 關(guān)鍵字： 實現(xiàn)  FPGA  方法  相干  正交  

基于Virtex-5 FPGA的音視頻監(jiān)視系統(tǒng)設(shè)計

  • 基于Virtex-5 FPGA的音視頻監(jiān)視系統(tǒng)設(shè)計,引言
    本文探討在Virtex-5 FPGA中實現(xiàn)設(shè)計的一些難題，然后用一個項目作為示范來詳解充分利用其功能集的技法。設(shè)計過程包括幾個步驟，從針對應(yīng)用選擇適合的Virtex-5開始。為便于本文敘述，我們假定IP模塊已經(jīng)過匯編
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一種基于FPGA的太陽跟蹤器的設(shè)計及實現(xiàn)

  • 0引言太陽能是一種清潔無污染的能源，取之不盡，用之不竭，發(fā)展前景廣闊。但是太陽能具有間歇性及強度...
  • 關(guān)鍵字： FPGA  太陽跟蹤器  

基于單片機和FPGA 的人機交互系統(tǒng)的設(shè)計

  • 摘要： 在儀器儀表電路中，人機交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機制作的系統(tǒng)功耗高、速度慢、電路結(jié)構(gòu)繁瑣的問題，同時為了發(fā)揮出單片機的靈活性和FPGA 的高速性，系統(tǒng)采用C8051F020 單片機和Cycl
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FPGA的DDS調(diào)頻信號研究與實現(xiàn)

  • 1 引言　　直接數(shù)字頻率合成器（DDS）技術(shù)，具有頻率切換速度快，很容易提高頻率分辨率、對硬件要求低、可編程全數(shù)字化便于單片集成、有利于降低成本、提高可靠性并便于生產(chǎn)等優(yōu)點。目前各大芯片制造廠商都相繼
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基于FPGA的高速寬帶跳頻發(fā)射機的中頻設(shè)計

  • 摘要：結(jié)合軟件無線電思想和架構(gòu)，利用Altera EP3C16F4 84C6作為中頻信號處理器，設(shè)計了一種基于統(tǒng)一硬件架構(gòu)的數(shù)字化高速寬帶跳頻發(fā)射機，實現(xiàn)跳頻速率125kHops/s，跳頻帶寬320MHz?！　∫浴　√l通信是在惡劣
  • 關(guān)鍵字： FPGA  高速寬帶  發(fā)射機  跳頻    

基于FPGA 的低成本長距離高速傳輸系統(tǒng)的設(shè)計與實現(xiàn)

  • 摘要：為解決目前高速信號處理中的數(shù)據(jù)傳輸速度瓶頸以及傳輸距離的問題，設(shè)計并實現(xiàn)了一種基于FPGA 的高速數(shù)據(jù)傳輸系統(tǒng)，本系統(tǒng)借助Altera Cyclone III FPGA 的LVDS I/O 通道產(chǎn)生LVDS 信號，穩(wěn)定地完成了數(shù)據(jù)的
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基于FPGA技術(shù)的GPS數(shù)據(jù)加密系統(tǒng)設(shè)計研究

  • 摘 要： 針對GPS測量系統(tǒng)數(shù)據(jù)傳輸過程中的安全問題，采用FPGA技術(shù)設(shè)計了GPS數(shù)據(jù)加密系統(tǒng)。系統(tǒng)移植MD5算法到NIOS中對系統(tǒng)口令加密，并設(shè)計DES IP對GPS數(shù)據(jù)加密。實驗表明，該設(shè)計可有效防止GPS數(shù)據(jù)被非法竊取，具
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基于FPGA的小型星載非制冷紅外成像系統(tǒng)

賽靈思 Virtex-6 HXT FPGA為光通信提供卓越的收發(fā)器性能

  • 　　全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc.  )宣布推出支持 40Gbps 和 100Gbps 線路卡的Virtex®-6 HXT FPGA，并可靈活配置各種網(wǎng)絡(luò)速率包括40Gbps、4x10Gbps、100Gbps 和 10x10Gbps 等。此外，憑借其市場領(lǐng)先的收發(fā)器時鐘抖動性能，Virtex-6 HXT FPGA還能滿足新一代通信設(shè)備長距離光纖網(wǎng)絡(luò)傳輸?shù)男枰?，且無需昂貴的外部重定時器電路。 　　賽靈思已經(jīng)和Avago Technologies(安華高科技)
  • 關(guān)鍵字： Xilinx  FPGA  Virtex-6  
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