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FPGA設(shè)計流程及其布線資源解析

  • 電路設(shè)計與輸入是指通過某些規(guī)范的描述方式，將工程師電路構(gòu)思輸入給EDA工具。常用的設(shè)計方法有硬件描述語言（HDL）和原理圖設(shè)計輸入方法等。原理圖設(shè)計輸入法在早期應(yīng)用得比較廣泛，它根據(jù)設(shè)計要求，選用器件、繪制原理圖、完成輸入過程。這種方法的有點(diǎn)是直觀、便于理解、元器件庫資源豐富。但是在大型設(shè)計中，這種方法的可維護(hù)性較差，不利于模塊構(gòu)造與重用
  • 關(guān)鍵字： 布線資源  功能仿真  FPGA  

基于FPGA的海量數(shù)據(jù)采集系統(tǒng)設(shè)計

  • 最近幾年，F(xiàn)PGA以其應(yīng)用的靈活方便蓬勃發(fā)展，在通信、航空航天、醫(yī)療設(shè)備、消費(fèi)類電子產(chǎn)品等領(lǐng)域一展身手。使用FPGA控制CF的技術(shù)到目前為止還沒有成熟，本文從硬件和軟件角度出發(fā)，介紹了FPGA與CF卡的接口設(shè)計、給出了用雙RAM訪問CF卡的編程，并且利用FPGA作為FIFO對AD采集的數(shù)據(jù)進(jìn)行緩沖，然后存儲到大容量的CF卡中。
  • 關(guān)鍵字： 海量數(shù)據(jù)采集  THS4052  MAX4125  FPGA  

基于FPGA的空間電場信號數(shù)據(jù)采集與處理系統(tǒng)設(shè)計

  • 提出一種基于FPGA的空間電場信號數(shù)據(jù)采集與處理系統(tǒng)的設(shè)計方案，F(xiàn)PGA為主控制器控制A／D采樣和同步422發(fā)送。X，Y，Z三個方向的空間電場信號經(jīng)過信號處理和A／D采樣，在FPGA片內(nèi)濾波劃分為不同的頻段，通過同步422接口發(fā)送到后續(xù)設(shè)備。該系統(tǒng)性能可靠穩(wěn)定，致力于應(yīng)用在探空火箭有效載荷——箭載電場儀上，對其他電場信號采集與處理系統(tǒng)也有
  • 關(guān)鍵字： 空間電場  數(shù)據(jù)采集  FPGA  

基于FPGA的跳頻通信系統(tǒng)設(shè)計

  • 本跳頻系統(tǒng)中，F(xiàn)PGA是硬件邏輯的載體，完成基帶信號采樣后的混頻、濾波等操作及對DDS、ADC等外部邏輯的控制；dsp控制FPGA內(nèi)部邏輯以及DDS、ADC等邏輯單元完成跳頻通信系統(tǒng)基帶部分的發(fā)射與接收及其一系列計算任務(wù)；高精度時鐘源為整個系統(tǒng)提供時間基準(zhǔn)，經(jīng)過dsp、FPGA、DDS等器件內(nèi)部鎖相環(huán)倍頻，為各器件提供主時鐘。
  • 關(guān)鍵字： 跳頻通信  基帶模塊  FPGA  

高速定點(diǎn)FFT算法的FPGA設(shè)計方案

  • 著重討論基于FPGA的64點(diǎn)高速FFT算法的實(shí)現(xiàn)方法。采用高基數(shù)結(jié)構(gòu)和流水線結(jié)構(gòu)，大大提高了FFT處理器的運(yùn)行速度。同時塊浮點(diǎn)結(jié)構(gòu)的引入，也大幅減少了浮點(diǎn)操作占用FPGA器件的資源數(shù)目，兼顧了FPGA高精度、低資源、低功耗的特點(diǎn)。
  • 關(guān)鍵字： 高速FFT算法  高基數(shù)結(jié)構(gòu)  FPGA  流水線結(jié)構(gòu)  

基于Nios II的多媒體廣告系統(tǒng)

  • 電子屏的出現(xiàn)，不僅可以使企業(yè)更全面的展示產(chǎn)品，推廣企業(yè)文化，而且可以滿足不同讀者的需求，改善城市環(huán)境，提升人民生活質(zhì)量，更重要的是廣告能夠更及時、更準(zhǔn)確、更全面的展示自己的新產(chǎn)品，第一時間與消費(fèi)者進(jìn)行溝通，贏得市場，獲取利潤，以及根據(jù)市場動態(tài)更及時更全面的做出市場決策?；谝陨显?，我們采用Nios II軟核設(shè)計了能及時發(fā)布戶外廣告、電子公告的多媒體廣告系統(tǒng)。
  • 關(guān)鍵字： NiosII處理器  多媒體廣告  FPGA  

基于FPGA的實(shí)時視頻信號處理平臺的設(shè)計與實(shí)現(xiàn)

  • 提出一種基于FPGA 的實(shí)時視頻信號處理平臺的設(shè)計方法，該系統(tǒng)接收低幀率數(shù)字YCbCr 視頻信號，對接收的視頻信號進(jìn)行格式和彩色空間轉(zhuǎn)換、像素和，利用片外SDRAM 存儲器作為幀緩存且通過時序控制器進(jìn)行幀率提高，最后通過VGA 控制模塊對圖像信號進(jìn)行像素放大并在VGA 顯示器上實(shí)時顯示。整個設(shè)計使用Verilog HDL 語言實(shí)現(xiàn)，
  • 關(guān)鍵字： 實(shí)時視頻信號處理  CCD圖像傳感器  FPGA  YCbCr  

FPGA設(shè)計者需要練好5項基本功

  • 在我看來，成為一名說得過去的FPGA設(shè)計者，需要練好5項基本功：仿真、綜合、時序分析、調(diào)試、驗(yàn)證。
  • 關(guān)鍵字： 設(shè)計流程  仿真  FPGA  綜合  時序分析  

基于SCF及CPLD的程控濾波電路設(shè)計

  • 以MOS開關(guān)、電容器和運(yùn)算放大器為核心的單片集成器件SCF，以其對截止頻率的精確控制，頻率響應(yīng)特性可大范圍調(diào)節(jié)，編程控制簡單，有效解決了模擬濾波器的通帶調(diào)節(jié)問題，在濾波電路設(shè)計中得到廣泛應(yīng)用。
  • 關(guān)鍵字： SCF  程控濾波電路  CPLD  

面向FPGA應(yīng)用的電源設(shè)計

  • 近幾年，F(xiàn)PGA 產(chǎn)業(yè)迅速擴(kuò)張，有越來越多的工程師從事著與 FPGA 相關(guān)的設(shè)計和研發(fā)工作。作為任何一款產(chǎn)品都不可或缺的電源，也面臨來自FPGA應(yīng)用的要求和挑戰(zhàn)。一方面是需求的增多，另一方面的技術(shù)指標(biāo)要求的不斷提升，如何幫助工程師輕松完成FPGA產(chǎn)品的電源設(shè)計，讓他們得以將更多的精力投入到核心部分的設(shè)計中，從而縮短設(shè)計周期，成了每個電源廠商要面對的問題。為此，筆者采訪了來自優(yōu)質(zhì)電源產(chǎn)品供應(yīng)商凌力爾特公司的DC/DC μModule 產(chǎn)品市場經(jīng)理Afshin Odabaee，來聽一聽他對面向FPGA應(yīng)用的電
  • 關(guān)鍵字： 靜態(tài)電流  散熱  FPGA  

基于EDA技術(shù)的FPGA設(shè)計

  • 對傳統(tǒng)電子系統(tǒng)設(shè)計方法與現(xiàn)代電子系統(tǒng)設(shè)計方法進(jìn)行了比較，引出了基于EDA技術(shù)的現(xiàn)場可編程門陣列（FPGA）電路，提出現(xiàn)場可編程門陣列（FPGA）是近年來迅速發(fā)展的大規(guī)?？删幊虒Ｓ眉呻娐罚ˋSIC），在數(shù)字系統(tǒng)設(shè)計和控制電路中越來越受到重視。介紹了這種電路的基本結(jié)構(gòu)、性能特點(diǎn)、應(yīng)用領(lǐng)域及使用中的注意事項。對基于EDA技術(shù)的FPGA進(jìn)行了展望。指出EDA技術(shù)將是未來電子產(chǎn)品設(shè)計技術(shù)發(fā)展的主要方向。
  • 關(guān)鍵字： 自動化設(shè)計  EDA  FPGA  

基于FPGA的多通道頻率檢測

  • 多通道頻率檢測是當(dāng)前數(shù)字接收機(jī)的一種常用的頻率測量方案,該方法可以較好地解決頻率截獲概率與頻率分辨力的矛盾,并在復(fù)雜的電磁環(huán)境中具有處理多個同時到達(dá)信號的能力。文中給出了基于FPGA來實(shí)現(xiàn)多信道頻率測量的具體方案。該方案能夠充分發(fā)揮FP-GA硬件資源豐富的特點(diǎn),并且易于實(shí)現(xiàn)并行處理,可大幅度提高系統(tǒng)的處理速度。
  • 關(guān)鍵字： 多信道頻率檢測  頻率截獲  FPGA  

采用EDA或FPGA實(shí)現(xiàn)IP保護(hù)

  • 提出一種結(jié)合電子設(shè)計自動化(Electronic Design Automation，簡稱EDA)軟件和FPGA的IP核保護(hù)機(jī)制。通過在EDA工具中加入保護(hù)機(jī)制防止設(shè)計者非授權(quán)使用IP核，在FPGA中加入保護(hù)機(jī)制防止設(shè)計被非法復(fù)制、竊取或篡改。
  • 關(guān)鍵字： IP保護(hù)  EDA  FPGA  

實(shí)時圖像小波無損壓縮系統(tǒng)的FPGA實(shí)現(xiàn)

  • 將Altera 公司的DE2 多媒體開發(fā)平臺與Terasic 公司的D5M 數(shù)碼相機(jī)開發(fā)套件相結(jié)合，設(shè)計了一套基于小波無損壓縮的實(shí)時圖像處理系統(tǒng)。系統(tǒng)采用便于可編程邏輯器件靈活實(shí)現(xiàn)的二維整數(shù)5 /3 提升小波變換實(shí)現(xiàn)壓縮。為保證圖像的無損壓縮，對邊界數(shù)據(jù)進(jìn)行對稱周期延拓處理。并針對實(shí)時處理過程中的大容量數(shù)據(jù)流的存儲問題，應(yīng)用片外存儲資源保存采集和處理過程中的圖像數(shù)據(jù)，有效地降低了片上存儲資源的消耗。測試結(jié)果表明: 系統(tǒng)滿足實(shí)時圖像采集、預(yù)處理及無損壓縮的要求。
  • 關(guān)鍵字： 圖像處理  無損壓縮  FPGA  

基于FPGA的H.264幀內(nèi)預(yù)測模塊設(shè)計

  • 提出一種能實(shí)時處理的H.264/AVC幀內(nèi)預(yù)測硬件結(jié)構(gòu)。通過對H.264/AVC各個預(yù)測模式的分析，設(shè)計了一個通用運(yùn)算單元，提高了硬件資源的可重用性。采用4個并行運(yùn)算單元計算預(yù)測值，對運(yùn)算比較復(fù)雜的plane模式預(yù)處理，并設(shè)計模式預(yù)測器，加快了系統(tǒng)處理速度。硬件電路結(jié)構(gòu)已通過RTL級仿真及綜合，并在Altera公司的Cyclone II FPGA平臺上進(jìn)行了驗(yàn)證和測試。
  • 關(guān)鍵字： H.264幀內(nèi)預(yù)測  視頻解碼器  FPGA  
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