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Altera發(fā)售全線65nm Cyclone III FPGA

　　Altera宣布低功耗、低成本Cyclone III系列65-nm FPGA所有8個型號的產(chǎn)品級芯片實現(xiàn)量產(chǎn)。自從2007年3月推出以來，Cyclone III系列產(chǎn)品已迅速應(yīng)用于無線、軍事、顯示、汽車和工業(yè)市場的大量客戶系統(tǒng)中。　　Altera公司低成本產(chǎn)品營銷總監(jiān)Luanne Schirrmeister評論說：“作為業(yè)界首款也是唯一一款65-nm低成本FPGA系列，Cyclone III器件在數(shù)字系統(tǒng)設(shè)計中前所未有地同時實現(xiàn)了高密度、低功耗和低成本。而當(dāng)今FPGA設(shè)計人員需要的是經(jīng)過硬件測試的
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高密度IC設(shè)計中面臨的ASIC與FPGA的抉擇

　　在過去10年間，全世界的設(shè)計人員都討論過使用ASIC或者FPGA來實現(xiàn)數(shù)字電子設(shè)計的好處。通常這些討論將完全定制IC的性能優(yōu)勢和低功耗與FPGA的靈活性和低NRE成本進行比較。設(shè)計隊伍應(yīng)當(dāng)在ASIC設(shè)計中先期進行NRE投資，以最大限度地提高性能、降低尺寸以及降低大批量制造時的成本?或者設(shè)計隊伍應(yīng)該為市場設(shè)計只有FPGA能夠提供的具有高度可配置功能、能夠快速完成任務(wù)的最終產(chǎn)品? 　　事實上，由于高密度IC設(shè)計面臨的日益嚴重的挑戰(zhàn)，上面的觀點并不重要。隨著ASIC設(shè)計人員進入每一個新的工藝過程，設(shè)計變得
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Stratix III FPGA性能達到了533-MHz DDR3接口標準

　　Altera公司宣布，Stratix® III FPGA的DDR3存儲器接口速率超過1067 Mbps，存儲器性能比競爭FPGA解決方案高出33%。更寬的存儲器帶寬支持新的通信、計算和視頻處理應(yīng)用，以前很難實現(xiàn)這類應(yīng)用或者需要增加存儲器塊才能實現(xiàn)。Altera的Stratix III FPGA系列是業(yè)界唯一完全符合JESD79-3 JEDEC DDR3 SDRAM標準的FPGA，該標準包括為提高性能而制定的高性能讀寫均衡規(guī)范。　　Altera高端產(chǎn)品營銷資深總監(jiān)David Greenfie
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基于FPGA的X射線安檢設(shè)備控制器設(shè)計

　　摘要：依據(jù)X射線安檢設(shè)備各部分工作原理及控制要求，本文采用FPGA和以太網(wǎng)技術(shù)設(shè)計了基于FPGA的X射線安檢設(shè)備控制器。本文以Xilinx公司的ISE為開發(fā)平臺，在ModelSim中仿真了控制器各個模塊的功能，得到了符合控制器要求的波形。　　關(guān)鍵詞：FPGA;X射線線性陣列探測卡;CS8900A;TCP/IP 　　引言　　X射線安檢設(shè)備廣泛應(yīng)用于機場、車站、海關(guān)、港口、倉庫等地。近年來由于犯罪分子大量使用先進的偽裝技術(shù)，使傳統(tǒng)的安檢設(shè)備顯得力不從心。針對上述情況，本文設(shè)計了基于FPGA的X
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基于FPGA的電渦流緩速器控制系統(tǒng)

　　摘　要：本文提出了一種基于FPAG芯片的控制系統(tǒng)設(shè)計方案。系統(tǒng)中利用FPGA狀態(tài)機高效地控制ADC進行信號采集。在FPGA中搭建的模糊控制器通過對勵磁電流的連續(xù)調(diào)節(jié)，實現(xiàn)了恒速、恒轉(zhuǎn)矩和恒流等控制策略。　　關(guān)鍵詞：電渦流緩速器;FPGA;狀態(tài)機;模糊控制　　引言　　電渦流緩速器的工作原理基于電磁感應(yīng)理論。作為一種輔助制動裝置，其減少了主制動裝置的機械摩擦，既提高了壽命，又提高了車輛行駛的安全性、經(jīng)濟性和舒適性，越來越受到汽車制造廠家的青睞。但是，由于汽車領(lǐng)域?qū)崟r性要求較高，且模糊控制算法
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ARM7與FPGA相結(jié)合在工業(yè)控制和故障檢測中的應(yīng)用

　　工業(yè)控制中往往需要完成多通道故障檢測及多通道命令控制(這種多任務(wù)設(shè)置非常普遍)，單獨的CPU芯片由于其外部控制接口數(shù)量有限而難以直接完成多路檢控任務(wù)。故利用ARM芯片與FPGA相結(jié)合來擴展檢控通道是一個非常好的選擇。這里介紹用Atmel公司ARM7處理器(AT91FR40162)和ALTERA公司的低成本FPGA芯片(cyclone2)結(jié)合使用完成多通道檢控任務(wù)的一種實現(xiàn)方法。　　各部分功能簡介　　圖1為此系統(tǒng)的結(jié)構(gòu)連接框圖。如圖所示，ARM芯片與FPGA芯片之間通過數(shù)據(jù)總線、地址總線及讀寫控
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使用ISE設(shè)計工具優(yōu)化FPGA的功耗

　　自從Xilinx公司推出FPGA二十多年來，研發(fā)工作大大提高了FPGA的速度和面積效率，縮小了FPGA與ASIC之間的差距，使FPGA成為實現(xiàn)數(shù)字電路的優(yōu)選平臺。今天，功耗日益成為FPGA供應(yīng)商及其客戶關(guān)注的問題。　　降低FPGA功耗是降低封裝和散熱成本、提高器件可靠性以及打開移動電子設(shè)備等新興市場之門的關(guān)鍵。　　Xilinx在提供低功耗FPGA解決方案方面較有經(jīng)驗。本文說明如何應(yīng)用計算機輔助設(shè)計(CAD)技術(shù)，如Xilinx ISE(集成軟件環(huán)境)9.2i版本軟件使功能有效降低。　　CM
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Actel推動最低功耗FPGA進入便攜式顯示屏領(lǐng)域

　　Actel公司宣布繼續(xù)專注于新興的高增長便攜式應(yīng)用市場，并推出專為液晶顯示 (LCD) 控制應(yīng)用設(shè)計的靈活的低功耗方案。新推出的IGLOO視頻演示板、帶有LCD面板的LCD適配器板、IGLOO視頻演示工具 (IVDK) 以及顯示相關(guān)的參考設(shè)計，都充分利用了該公司領(lǐng)先業(yè)界的5µW Actel IGLOO FPGA 的優(yōu)勢。Actel預(yù)期這三款產(chǎn)品將會吸引便攜及手持式消費電子、工業(yè)、醫(yī)療、汽車及軍用設(shè)備等對功耗敏感的產(chǎn)品設(shè)計人員，用于其中小型 LCD 顯示設(shè)備中。　　隨著個人媒體播放器、M
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做FPGA設(shè)計時需注意的一些關(guān)鍵問題

不管你是一名邏輯設(shè)計師、硬件工程師或系統(tǒng)工程師，甚或擁有所有這些頭銜，只要你在任何一種高速和多協(xié)議的復(fù)雜系統(tǒng)中使用了FPGA，你就很可能需要努力解決好器件配置、電源管理、IP集成、信號完整性和其他的一些關(guān)鍵設(shè)計問題。不過，你不必獨自面對這些挑戰(zhàn)，因為在當(dāng)前業(yè)內(nèi)領(lǐng)先的FPGA公司里工作的應(yīng)用工程師每天都會面對這些問題，而且他們已經(jīng)提出了一些將令你的設(shè)計工作變得更輕松的設(shè)計指導(dǎo)原則和解決方案。 I/O信號分配可提供最多的多功能引腳、I/O標準、端接方案和差分對的FPGA在信號分配方面也具有最復(fù)
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Xilinx和Brilliant電信推出基于FPGA的電信級時序（Timing）解決方案

　　賽靈思公司和Brilliant 電信公司日前宣布：針對下一代有線和無線網(wǎng)絡(luò)推出業(yè)界第一個基于FPGA的電信級時序(Timing)解決方案。這一聯(lián)合開發(fā)的解決方案為下一代通信網(wǎng)絡(luò)設(shè)計人員提供了第一個嵌入式可編程解決方案，該方案具有無與倫比的靈活性、現(xiàn)場可升級能力和定制化能力。通過將時序功能集成到賽靈思FPGA器件中，這一解決方案可顯著降低成本。在賽靈思Virtex™ 或 Spartan™ FPGA中實現(xiàn)的這一解決方案以兩款知識產(chǎn)權(quán)(IP)內(nèi)核—NGNTime 和 FemtoTim
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一種基于FPGA的準單輸入調(diào)變序列生成器設(shè)計

　　1.引言　　隨著集成電路復(fù)雜度越來越高，測試開銷在電路和系統(tǒng)總開銷中所占的比例不斷上升，測試方法的研究顯得非常突出。目前在測試源的劃分上可以采用內(nèi)建自測試或片外測試。內(nèi)建自測試把測試源和被測電路都集成在芯片的內(nèi)部，對于目前SOC級的芯片測試如果采用內(nèi)建自測試則付出的硬件面積開銷則是很大的，同時也增加了芯片設(shè)計的難度：因此片外測試便成為目前被普遍看好的方法。由于FPGA具有可重構(gòu)的靈活性，利用FPGA來作為測試源實現(xiàn)片外測試就是一種非常有效的手段。　　由于偽隨機模式測試只需要有限個數(shù)的輸入向量便
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ARM7與FPGA相結(jié)合在工業(yè)控制和故障檢測中的應(yīng)用(圖)

ARM7與FPGA相結(jié)合在工業(yè)控制和故障檢測中的應(yīng)用(圖),
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FPGA新手入門

FPGA簡介 FPGA是英文Field Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在可編程陣列邏輯PAL(Programmable Array Logic)、門陣列邏輯GAL(Gate Array Logic)、可編程邏輯器件PLD(Programmable Logic Device)等可編程器件的基礎(chǔ)什么是FPGA上進一步發(fā)展的產(chǎn)
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基于FPGA的串行Flash擴展實現(xiàn)

　　1 引言　　FPGA憑借其方便靈活、可重復(fù)編程等優(yōu)點而日益被廣泛應(yīng)用;閃速存儲器(Flash Memory)以其集成度高、成本低、使用方便等優(yōu)點，在眾多領(lǐng)域中也獲得了廣泛應(yīng)用。在現(xiàn)代數(shù)字電路設(shè)計中。經(jīng)常需要保存大量數(shù)據(jù)，而Flash存儲速度快、體積小、功耗低且價格低廉，可在線電擦寫，信息在掉電后不會丟失，因此成為設(shè)計人員的首選。　　2 M25P80的介紹　　Flash是一種具有電可擦除的可編程ROM，可以分為兩大類：并行Flash和串行Flash。并行Flash存儲量大，速度快;而串行Fl
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地面數(shù)字電視符號與載波同步的FPGA實現(xiàn)

　　1 引言　　中國于2006年8月頒布了數(shù)字電視的地面廣播標準GB20600-2006，成為繼美國ATSC、歐洲D(zhuǎn)VB-T、日本ISDB-T之后又一重要的地面數(shù)字電視廣播的國家標準。GB20600-2006中對中國數(shù)字電視地面?zhèn)鬏?DigitalTerrestrial Television Broadcasting，DTTB)系統(tǒng)傳輸?shù)膸Y(jié)構(gòu)、信道編碼和調(diào)制作了具體的規(guī)定。其中幀結(jié)構(gòu)的基本單元——信號幀采用了循環(huán)擴展的時域幀頭結(jié)構(gòu)，即在每3780個符號的幀體前加入一定長度的經(jīng)循環(huán)擴展后的偽隨機序列作
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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細 ]