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一種基于FPGA的可重構(gòu)密碼芯片的設(shè)計與實現(xiàn)
- 目前,國內(nèi)外廣泛使用的密碼處理芯片大都是實現(xiàn)某種特定密碼算法的專用芯片,如MD5芯片、SHA-1芯片等。由于專用密碼芯片實現(xiàn)的密碼算法是確定的且不可更改的,因此難以滿足不同密碼用戶多層次的安全性需要。為克服這一缺陷,本文設(shè)計一種新型的密碼處理芯片——可重構(gòu)密碼芯片。
- 關(guān)鍵字: SHA-1 SHA-224 SHA-256 可重構(gòu)密碼芯片 FPGA
利用FPGA IP平臺引進微控制器系統(tǒng)級芯片
- 工業(yè)設(shè)計人員所面對的上市時間壓力從未如此巨大。不論是設(shè)計網(wǎng)絡(luò)接口、電機控制器、邏輯控制器、通信系統(tǒng)、或任何數(shù)以百計的工業(yè)應用,F(xiàn)PGA結(jié)合種類繁多的可用IP正成為工業(yè)設(shè)計的優(yōu)選方案。就上市時間、執(zhí)行的靈活性及未來的產(chǎn)品廢棄過時等因素而言,F(xiàn)PGA較ASSP和ASIC解決方案具有更多優(yōu)勢。
- 關(guān)鍵字: 微控制器 IP平臺 FPGA 系統(tǒng)級芯片
基于FPGA的8051微控制器接口實現(xiàn)
- 本設(shè)計充分利用了Vertex器件的LUTs(Look-Up Tables)替代觸發(fā)器和基本門電路搭建乘法器和加法器這兩個顯著的結(jié)構(gòu)特點,節(jié)省了大量的觸發(fā)器資源,增加了器件利用率、布通率,DLL的運用降低了布線延遲,實現(xiàn)了通信的完全同步。筆者采用Xilinx公司的FPGA芯片自行設(shè)計了8051IP核與外圍設(shè)備的接口,完成了8051與外圍設(shè)備之間的通信功能,并且源代碼中的參數(shù)可調(diào),可作為IP軟核提供給8051開發(fā)用戶。
- 關(guān)鍵字: 微控制器 8051 FPGA 接口實現(xiàn)
如何采用SystemVerilog來改善基于FPGA的ASIC原型
- ASIC在解決高性能復雜設(shè)計概念方面提供了一種解決方案,但是ASIC也是高投資風險的,如90nm ASIC/SoC設(shè)計大約需要2000萬美元開發(fā)成本.為了降低成本,現(xiàn)在可采用FPGA來實現(xiàn)ASIC.但是,但ASIC集成度較大時,需要幾個FPGA來實現(xiàn),這就需要考慮如何來連接ASIC設(shè)計中所有的邏輯區(qū)塊.采用SystemVerilog,可以簡化這一問題.
- 關(guān)鍵字: SystemVerilog ASIC FPGA
針對微控制器應用的FPGA實現(xiàn)
- 當你打開任何智能電子設(shè)備(從老式的電視遙控器到全球定位系統(tǒng)),會發(fā)現(xiàn)幾乎所有的設(shè)備都至少采用了一個微控制器(MCU),很多設(shè)備里還會有多個微控制器。MCU往往被用于專用的終端產(chǎn)品或設(shè)備中,它能夠很好地完成特殊任務。另一方面,PC的大腦,即微處理器被設(shè)計用于實現(xiàn)許多通用的功能。微控制器可用于降低成本,加固工業(yè)和自動化應用,將其嵌入FPGA中時,還可以通過重新編程迅速改變功能。這種靈活性使得單個設(shè)備可應用于接口標準不同的多個市場。
- 關(guān)鍵字: 微控制器 SRAM FPGA
基于FPGA的高速數(shù)字隔離型串行ADC及其工程應用
- 目前,逆變器在很多領(lǐng)域有著越來越廣泛地應用。對逆變器的研究具有十分重要的意義和廣闊的工程應用前景。常見逆變技術(shù)的控制方法大致分為開環(huán)控制的載波調(diào)制方法和閉環(huán)控制的跟蹤控制方法。跟蹤控制方法屬于閉環(huán)控制,閉環(huán)反饋中的檢測環(huán)節(jié)需要與高壓主電路相互隔離,避免高壓側(cè)電磁噪聲對控制電路的竄擾。高性能的跟蹤型逆變器對反饋量的實時性要求很高,因此要求反饋環(huán)節(jié)具有高速隔離傳輸模擬信號的能力。
- 關(guān)鍵字: 數(shù)字隔離型 串行ADC FPGA 工程應用
基于FPGA的USB側(cè)音測距信號發(fā)生器設(shè)計
- 隨著我國航天技術(shù)的不斷進步,深空測距技術(shù)受到越來越多的關(guān)注。在深空測距系統(tǒng)中,中頻信號發(fā)生器對系統(tǒng)性能有著重要的意義。在USB(統(tǒng)一S頻段)系統(tǒng)中,原有的模擬電路實現(xiàn)的發(fā)射模塊存在性能不完善、輸入動態(tài)范圍小、可控性能差、不能適應中心頻率大范圍變化、體積大等問題,為了解決上述問題,可在一個標準化通用數(shù)字調(diào)制信號發(fā)生器的平臺上,通過外圍的控制電路,實現(xiàn)對載波中心頻率、輸出功率、調(diào)相指數(shù)、測距音通/斷控制等參數(shù)的改變。
- 關(guān)鍵字: PLD USB 測距 D/A FPGA
FPGA系列相關(guān)圖書介紹
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- 關(guān)鍵字: VHDL FPGA CPLD AltiumDesign XilinxISE
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