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EEPW首頁 >> 主題列表 >> fpga+dsp

基于改進(jìn)的布斯算法的嵌入FPGA的乘法器設(shè)計(jì)

  • 設(shè)計(jì)了一款嵌入FPGA的乘法器，該乘法器能夠滿足兩個(gè)18 b有符號或17 b無符號數(shù)的乘法運(yùn)算。該設(shè)計(jì)基于改進(jìn)的布斯算法，提出了一種新的布斯譯碼和部分積結(jié)構(gòu)，并對9-2壓縮樹和超前進(jìn)位加法器進(jìn)行了優(yōu)化。該乘法器采用TSMC 0．18μn CMOS工藝，其關(guān)鍵路徑延遲為3．46 ns。
  • 關(guān)鍵字： 布斯算法  18×18乘法器  FPGA  

基于ATE的FPGA測試

  • 隨著集成電路技術(shù)的飛速發(fā)展，F(xiàn)PGA的應(yīng)用越來越廣泛，其測試技術(shù)也得到了廣泛重視和研究。文章簡要介紹了FPGA的發(fā)展及其主要組成部分，提出了一種用ATE對FPGA進(jìn)行測試的方法和具體測試流程。
  • 關(guān)鍵字： AutomaticTestEquipment  配置數(shù)據(jù)  FPGA  

基于FPGA的DDS IP核設(shè)計(jì)及仿真

  • 以Altera公司的QuartusⅡ7．2作為開發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核NiosII，構(gòu)成可編程片上系統(tǒng)(SOPC)，利用極少的硬件資源實(shí)現(xiàn)了可重構(gòu)信號源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成，利用SOPC技術(shù)，在一片F(xiàn)PGA芯片上實(shí)現(xiàn)了整個(gè)信號源的硬件開發(fā)平臺，達(dá)到既簡化電路設(shè)計(jì)、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。
  • 關(guān)鍵字： 直接數(shù)字頻率合成  IP核  FPGA  

基于FPGA的遺傳算法組合邏輯電路設(shè)計(jì)

  • 基于遺傳算法的組合邏輯電路的自動設(shè)計(jì)，依據(jù)給出的真值表，利用遺傳算法自動生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性，采用軟件實(shí)現(xiàn)的方法在速度上往往受到本質(zhì)是串行計(jì)算的計(jì)算機(jī)制約，因此采用硬件化設(shè)計(jì)具有重要的意義。為了證明基于FPGA的遺傳算法的高效性，設(shè)計(jì)了遺傳算法的各個(gè)模塊，實(shí)現(xiàn)了基于FPGA的遺傳算法。
  • 關(guān)鍵字： 遺傳算法  自然進(jìn)化  FPGA  

FPGA設(shè)計(jì)安全性綜述

  • 現(xiàn)場可編程門陣列（Field Programmable Gate Array,FPGA）在通信、圖形、控制、計(jì)算等領(lǐng)域的廣泛應(yīng)用,已經(jīng)成為當(dāng)今電子系統(tǒng)中的重要組成部分.隨著越來越多的系統(tǒng)采用FPGA實(shí)現(xiàn)核心設(shè)計(jì),使得FPGA中的設(shè)計(jì)和知識產(chǎn)權(quán)變得更加重要,建立FPGA代碼運(yùn)行安全體系已成為大型產(chǎn)品設(shè)計(jì)中重要的考慮因素.本文闡述了FPGA的多種安全解決方案,并探討分析了FPGA的設(shè)計(jì)安全性.
  • 關(guān)鍵字： 代碼運(yùn)行安全  安全解決方案  FPGA  

基于FPGA的半導(dǎo)體激光器自動功率控制系統(tǒng)設(shè)計(jì)

  • 半導(dǎo)體激光器的自動功率控制是解決激光器閾值漂移的重要手段，本文設(shè)計(jì)了一個(gè)基于FPGA的數(shù)字激光自動功率控制系統(tǒng)，該控制系統(tǒng)主要由光電檢測、A／D轉(zhuǎn)換、SOC控制、APC判定、PWM反饋輸出及低通濾波幾個(gè)部分組成。該自動功率控制系統(tǒng)使用硬件資源少，根據(jù)不同的設(shè)計(jì)要求，通過增加PWM模塊和簡單的模擬器件或者改變控制寄存器的設(shè)置，就可以實(shí)現(xiàn)多級激光功率和多個(gè)激光器的控制，可以大大縮短設(shè)計(jì)周期。
  • 關(guān)鍵字： 數(shù)字激光器  自動功率控制  FPGA  

基于FPGA的數(shù)字顯示系統(tǒng)設(shè)計(jì)

  • 本文以Ｖｉｒｔｅｘ－ＩＩ系列ＰｌａｔｆｏｒｍＦＰＧＡ為例，說明采用ＦＰＧＡ方案進(jìn)行數(shù)字顯示系統(tǒng)設(shè)計(jì)所具有的靈活、快速和低成本等特性。
  • 關(guān)鍵字： 數(shù)字顯示系統(tǒng)  SoC  FPGA  

基于FPGA實(shí)現(xiàn)視頻圖像的一種運(yùn)動估計(jì)設(shè)計(jì)

  • 利用功能強(qiáng)大的FPGA實(shí)現(xiàn)視頻圖像的一種運(yùn)動估計(jì)設(shè)計(jì)，采用的搜索方法是三步搜索法。在進(jìn)行方案設(shè)計(jì)時(shí)，本文采用了技術(shù)比較成熟的VHDL語言進(jìn)行設(shè)計(jì)，并使用Quartus II軟件進(jìn)行時(shí)序仿真。由仿真結(jié)果可知，無論是在功能的實(shí)現(xiàn)上還是在搜索的準(zhǔn)確性、高效性以及FPGA片上資源的利用率上，本設(shè)計(jì)方案都具有明顯的優(yōu)越性。
  • 關(guān)鍵字： 運(yùn)動估計(jì)  視頻編碼器  FPGA  

基于FPGA的流水線結(jié)構(gòu)DDS多功能信號發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)

  • 在應(yīng)用FPGA進(jìn)行DDS系統(tǒng)設(shè)計(jì)過程中，選擇芯片的運(yùn)行速度優(yōu)化和資源利用優(yōu)化常常是相互矛盾的，從發(fā)展趨勢和運(yùn)算要求看，系統(tǒng)速度指標(biāo)的意義比面積指標(biāo)更趨重要?；诖?，介紹了一種流水線結(jié)構(gòu)來優(yōu)化傳統(tǒng)的相位累加器，在QuartusⅡ開發(fā)環(huán)境下搭建系統(tǒng)模型、仿真及下載，并采用嵌入式邏輯分析儀分析和驗(yàn)證了實(shí)驗(yàn)結(jié)果。該系統(tǒng)可以完成多位頻率控制字的累加，能夠產(chǎn)生正弦波、方波和三角波，具有良好的實(shí)時(shí)性。
  • 關(guān)鍵字： 流水線相位累加器  DDS  FPGA  

基于光纖通信和PCIExpress總線的高速圖像傳輸系統(tǒng)

  • 提出了一種基于光纖通信和PCI Express總線的高速圖像傳輸系統(tǒng)。分析了系統(tǒng)設(shè)計(jì)方案,并詳細(xì)闡述了FPGA內(nèi)部邏輯設(shè)計(jì),包括光纖接口的數(shù)據(jù)收發(fā)以及PCI Express總線的DMA傳輸;簡要介紹了Windows WDM驅(qū)動程序及MFC應(yīng)用程序的開發(fā);給出了系統(tǒng)測試結(jié)果。該系統(tǒng)傳輸速率可達(dá)1.5Gb/s,且具有低成本、易擴(kuò)展等優(yōu)點(diǎn),能夠滿足大多數(shù)高幀高清視頻圖像實(shí)時(shí)傳輸?shù)囊蟆?/li>
  • 關(guān)鍵字： PCIExpress  高速圖像傳輸  FPGA  

留有vector的FPGA有被黑的可能

  • Skorobogatov的研究表明，目前比較流行的現(xiàn)場可編程門陣列（FPGA）故意預(yù)留一個(gè)可以重新編譯的Vector(容器)。Skorobogatov表示，如果使用這樣的芯片，那么武器系統(tǒng)以及核工廠等軍事機(jī)構(gòu)可能被利用這個(gè)后門的病毒來禁止運(yùn)行。
  • 關(guān)鍵字： vector  黑客攻擊  FPGA  

基于FPGA的數(shù)字音頻廣播系統(tǒng)信號調(diào)制系統(tǒng)的實(shí)現(xiàn)

  • 本文設(shè)計(jì)并在FPGA芯片中實(shí)現(xiàn)了數(shù)字音頻廣播系統(tǒng)的信號調(diào)制系統(tǒng)。信號調(diào)制系統(tǒng)位于整個(gè)數(shù)字音頻廣播系統(tǒng)基帶信號處理鏈的末端，是基帶數(shù)字信號處理的核心系統(tǒng)。根據(jù)Eureka 147標(biāo)準(zhǔn)，信號調(diào)制系統(tǒng)需要對輸入的基帶碼流進(jìn)行數(shù)字調(diào)制、頻域交織、差分調(diào)制以及正交頻分復(fù)用等一系列處理。所設(shè)計(jì)的信號調(diào)制系統(tǒng)能夠?qū)斎氲幕鶐Тa流進(jìn)行實(shí)時(shí)處理，完成上述信號處理算法，并輸出數(shù)字音頻廣播的基帶信號。
  • 關(guān)鍵字： Simulink  DAB  FPGA  

FPGA在LVDS高速互連中的應(yīng)用

  • 高速串行互連是標(biāo)志并行數(shù)據(jù)總線向串行總線轉(zhuǎn)變的技術(shù)里程碑，這種技術(shù)是減少設(shè)計(jì)師面臨的信號阻塞問題的方法。這種轉(zhuǎn)變是由業(yè)界對系統(tǒng)成本和系統(tǒng)擴(kuò)展能力的要求所推動的。隨著芯片技術(shù)的發(fā)展和芯片尺寸的縮小，用速率達(dá)數(shù)千兆位的高速串行互連來取代傳統(tǒng)的并行結(jié)構(gòu)變得簡單易行。
  • 關(guān)鍵字： 差分信號技術(shù)  LVDS  FPGA  

基于FPGA的HDB3編碼實(shí)現(xiàn)

  • 主要介紹了HDB3 碼( 三階高密度雙極性碼) 的編碼原理，并提出了一種利用FPGA( 現(xiàn)場可編程門陣列) 實(shí)現(xiàn)HDB3編碼的設(shè)計(jì)方法。
  • 關(guān)鍵字： HDB3編碼  高密度雙極性碼  FPGA  

基于FPGA的電控單元噴油脈寬處理

  • 由于電控汽油機(jī)在燃用不同比例甲醇汽油時(shí)受空燃比自適應(yīng)調(diào)整的限制而不能正常運(yùn)轉(zhuǎn)的問題，提出利用FPGA技術(shù)將電控單元輸出的噴油脈寬信號進(jìn)行擴(kuò)展處理，使得電控汽油機(jī)在燃用不同比例甲醇汽油時(shí)，空燃比能夠維持在理論空燃比附近，從而使得電控汽油機(jī)能夠正常運(yùn)轉(zhuǎn)。本系統(tǒng)采用Altera公司的Cyclone系列FPGA芯片EP1C12Q240C8N，在Quatus II開發(fā)環(huán)境中給出硬件設(shè)計(jì)和功能仿真。經(jīng)過測試，系統(tǒng)滿足對噴油脈寬信號的擴(kuò)展處理要求且系統(tǒng)性能穩(wěn)定。
  • 關(guān)鍵字： 空燃比  噴油脈寬  FPGA  
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