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IIR數(shù)字濾波器的FPGA仿真與實現(xiàn)

  • 采用自頂向下的模塊化設(shè)計思想，介紹了一種采用級聯(lián)結(jié)構(gòu)在FPGA上實現(xiàn)IIR數(shù)字濾波器的設(shè)計方案。設(shè)計IIR數(shù)字濾波器的二階節(jié)，將二階節(jié)IIR數(shù)字濾波器級聯(lián)實現(xiàn)高階IIR數(shù)字濾波器，從而實現(xiàn)通過修改外圍參數(shù)來改變?yōu)V波器的頻率響應(yīng),根據(jù)不同的要求在不同規(guī)模的FPGA上加以實現(xiàn)。
  • 關(guān)鍵字： IIR數(shù)字濾波器  級聯(lián)結(jié)構(gòu)  FPGA  

FPGA設(shè)計的常見問題

  • 只要輸入信號同時變化，（經(jīng)過內(nèi)部走線）組合邏輯必將產(chǎn)生毛刺。將它們的輸出直接連接到時鐘輸入端、清零或置位端口的設(shè)計方法是錯誤的，這可能會導(dǎo)致嚴重的后果。 所以我們必須檢查設(shè)計中所有時鐘、清零和置位等對毛刺敏感的輸入端口，確保輸入不會含有任何毛刺。
  • 關(guān)鍵字： 毛刺  置位信號  FPGA  

基于FPGA的電子密碼鎖的研制

  • 介紹在QUATUSII環(huán)境下，采用FPGA可編程邏輯器件開發(fā)的電子密碼鎖，并利用狀態(tài)機（FSM）實現(xiàn)鍵盤消抖及系統(tǒng)主控模塊的行為控制，從實際工程設(shè)計角度闡述了系統(tǒng)所有模塊及其工作原理、軟件設(shè)計方法，提出了系統(tǒng)設(shè)計注意要點。
  • 關(guān)鍵字： QUATUSII  密碼鎖  FPGA  狀態(tài)機  

MP3的FPGA設(shè)計

  • FPGA能滿足MP3整個系統(tǒng)的價格、功耗和性能要求,它們靈活的結(jié)構(gòu)使系統(tǒng)設(shè)計人員能在每種MP3播放機中最佳地實現(xiàn)各種功能。
  • 關(guān)鍵字： MP3  邏輯模塊  FPGA  

基于FPGA的PWM計數(shù)器改進設(shè)計

  • 簡單改變FPGA計數(shù)器規(guī)格使作為DAC功能PWM計數(shù)器的紋波降低。
  • 關(guān)鍵字： PWM  紋波  FPGA計數(shù)器  

基于FPGA和單片機的掃頻儀研究與設(shè)計

  • 在系統(tǒng)設(shè)計時，各個網(wǎng)絡(luò)的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶、傳輸特性等都具有重要影響。實際操作中，掃頻儀大大簡化了測量操作，提高了工作效率，達到了測量過程快速、直觀、準確、方便的目的，在生產(chǎn)、科研、教學(xué)上得到廣泛運用。
  • 關(guān)鍵字： 頻率特性  掃頻儀  FPGA  

FPGA在航空電子系統(tǒng)中的設(shè)計應(yīng)用

  • 由于競爭的壓力和對飛機性能無止境的追求，航空電子從簡單、獨立的設(shè)備發(fā)展到如今以每秒百萬位乃至更快的速度交換信息的高級智能系統(tǒng)網(wǎng)絡(luò)。這也帶來了必須克服的許多設(shè)計問題。
  • 關(guān)鍵字： 高級智能系統(tǒng)網(wǎng)絡(luò)  航空電子  FPGA  

數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之：系統(tǒng)硬件配置方案

帶硬件地址識別的UART IP的設(shè)計和實現(xiàn)

  • 在通信和控制系統(tǒng)中，常使用異步串行通信控制器（UART）實現(xiàn)系統(tǒng)輔助信息的傳輸。為實現(xiàn)多點通信，通常用軟件識別發(fā)往本站點或其它站點的數(shù)據(jù)，這會加大CPU的開銷。介紹了一種基于FPGA的UART IP，由硬件實現(xiàn)多點通信時的數(shù)據(jù)過濾功能，降低了CPU的負擔(dān)，提高了系統(tǒng)性能。
  • 關(guān)鍵字： UART  IP  FPGA  

數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之：系統(tǒng)原理框圖

數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之：系統(tǒng)工作原理分析

  • 如前所述，本系統(tǒng)主要完成對輸入視頻圖像的兩倍放大。圖像的放大主要是通過插值算法來實現(xiàn)的，下面詳細分析如何應(yīng)用雙線性插值算法來實現(xiàn)倍焦功能。
  • 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng)  乘法器  FPGA  

有限狀態(tài)機的FPGA設(shè)計

  • 有限狀態(tài)機是一種常見的電路，由于時序電路和組合電路組成，設(shè)計有限狀態(tài)機的第一步是確定采用Moore狀態(tài)機還是采用Mealy狀態(tài)機。Mealy狀態(tài)機的狀態(tài)轉(zhuǎn)變不僅和當前狀態(tài)有關(guān)，而且和各輸入信號有關(guān)；Moore狀態(tài)機的轉(zhuǎn)變只和當前狀態(tài)有關(guān)。從電路實現(xiàn)功能上來講，任何一種都可以實現(xiàn)同樣的功能。但他們的輸出時序不同，所以選擇使用哪種狀態(tài)機是要根據(jù)具體情況來定。
  • 關(guān)鍵字： Moore狀態(tài)機  Mealy狀態(tài)機  FPGA  

數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之：設(shè)計需求分析與芯片選型

  • 在數(shù)字圖像處理和通信、遙感圖像分析、醫(yī)學(xué)成像診斷等應(yīng)用領(lǐng)域，為了便于顯示、觀察或進行進一步的處理，常常需要對原始的數(shù)字圖像進行特征提取(如邊緣檢測、邊緣銳化)、噪聲平滑濾波、幾何校正、尺寸縮放等處理，這類圖像處理技術(shù)稱為圖像的預(yù)處理。在實際應(yīng)用中，圖像的預(yù)處理功能很多可以通過FPGA來實現(xiàn)。
  • 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng)  視頻解碼器  FPGA  視頻編碼器  乒乓緩沖區(qū)  

H.264/AVC中CAVLC編碼器的硬件設(shè)計與實現(xiàn)

  • 設(shè)計了一種H.264標準的CAVLC編碼器，對原有軟件流程進行部分改進，提出了并行處理各編碼子模塊的算法結(jié)構(gòu)。
  • 關(guān)鍵字： 變長編碼  非零系數(shù)級編碼  FPGA  

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之：典型實例-整數(shù)DCT變換的設(shè)計與實現(xiàn)

  • 本節(jié)旨在設(shè)計實現(xiàn)了視頻壓縮標準H.264算法中的整數(shù)DCT變換部分，幫助讀者了解并行流水設(shè)計技巧在算法優(yōu)化中的作用。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  整數(shù)DCT變換  H.264  
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