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Verilog HDL阻塞屬性探究及其應(yīng)用

  • Verilog HDL中，有兩種過程賦值方式，即阻塞賦值(blocking)和非阻塞賦值(nonblocking)。阻塞賦值執(zhí)行時(shí)，RHS(right hand statement)估值與更新LHS(left hand statement)值一次執(zhí)行完成，計(jì)算完畢，立即更新。在執(zhí)行時(shí)
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基于Verilog HDL濾波器的設(shè)計(jì)

  • 　現(xiàn)代計(jì)算機(jī)和通信系統(tǒng)中廣泛采用數(shù)字信號(hào)處理的技術(shù)和方法，其基本思路是先把信號(hào)用一系列的數(shù)字來表示，然后對(duì)這些數(shù)字信號(hào)進(jìn)行各種快速的數(shù)學(xué)運(yùn)算。其目的是多種多樣的，有的是為了加密，有的是為了去掉噪聲等無
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XFAB 0.18um高壓工藝提供嵌入式閃存

  • X-FAB Silicon Foundries 在XH018 0.18um高壓工藝上增加高可靠性的嵌入式閃存(eFlash)方案。此方案提供了業(yè)界最少的光罩版數(shù)，32層，其中包含數(shù)字、模擬、高壓元件、并閃存，而閃存只要額外2層光罩。對(duì)高階片上混合信號(hào)系統(tǒng)芯片(SoCs)，此方案具有極高的性價(jià)比，其中的45V高壓元件與嵌入式內(nèi)存，EEPROM、非揮發(fā)性隨機(jī)內(nèi)存(NVRAM) 、嵌入式閃存(eFlash)，更適用于高速微處理器、數(shù)字電源、和車用電子。
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Car-to-x，恩智浦技術(shù)開啟車聯(lián)網(wǎng)新時(shí)代

  • 還記得去年長安街上的車禍案嗎？飛馳的英菲尼迪將?？吭诮煌羟暗谋咎镲w度2廂變1廂。同年，在甘肅敦煌，大眾...
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線性光耦器件IL300-F-X009原理及其應(yīng)用

  • 摘要：介紹在采集交流永磁同步電機(jī)母線電流時(shí)，為防止外界的各種干擾，必須將霍爾傳感器測(cè)量系統(tǒng)和DSP數(shù)字微處理器進(jìn)行電氣隔離。為了能更精確地傳送模擬信號(hào)，進(jìn)行電壓檢測(cè)，用線性光耦(IL300-F-X009)隔離是最好的選
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ST-BUS總線接口模塊的Verilog HDL設(shè)計(jì)

  • ST-BUS總線接口模塊的Verilog HDL設(shè)計(jì),ST-BUS是廣泛應(yīng)用于E1通信設(shè)備內(nèi)部的一種模塊間通信總線。結(jié)合某專用通信系統(tǒng)E1接口轉(zhuǎn)換板的設(shè)計(jì)，本文對(duì)ST-BUS總線進(jìn)行了介紹，討論了ST-BUS總線接口收發(fā)模塊的設(shè)計(jì)方法，給出了Verilog HDL實(shí)現(xiàn)和模塊的時(shí)序仿真圖。
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PLD/FPGA硬件語言設(shè)計(jì)verilog HDL

  • PLD/FPGA硬件語言設(shè)計(jì)verilog HDL,HDL概述　　隨著EDA技術(shù)的發(fā)展，使用硬件語言設(shè)計(jì)PLD/FPGA成為一種趨勢(shì)。目前最主要的硬件描述語言是VHDL和verilog HDL及System Verilog。 VHDL發(fā)展的較早，語法嚴(yán)格;而Verilog HDL是在C語言的基礎(chǔ)上發(fā)展起來的一種硬
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一種X 波段波導(dǎo)縫隙天線的設(shè)計(jì)與仿真

  • 隨著信息化水平的提高和無線電技術(shù)的發(fā)展，對(duì)高效率、低副瓣天線的需求日漸強(qiáng)烈，特別是彈載、機(jī)載搜索和...
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Maxim推出業(yè)內(nèi)首款8 x 4衛(wèi)星IF開關(guān)IC

  • 　　Maxim推出業(yè)內(nèi)首款8 x 4衛(wèi)星IF開關(guān)IC MAX12005，可擴(kuò)展至16路衛(wèi)星信號(hào)輸入。MAX12005具有高度集成特性，且應(yīng)用十分靈活，非常適合多種空間受限的衛(wèi)星IF分配和多開關(guān)應(yīng)用。 　　MAX12005應(yīng)用十分靈活，通過一路附加的IF開關(guān)輸入配置內(nèi)部8 x 4矩陣，可擴(kuò)展至16路衛(wèi)星信號(hào)輸入。器件支持單個(gè)四路低噪聲下變頻模塊(LNB)，垂直或水平極化信號(hào)可通過矩陣切換至四個(gè)衛(wèi)星接收器。使用兩片MAX12005 IC以及增加八個(gè)輸入分離器還可實(shí)現(xiàn)將八路衛(wèi)星IF輸入分配至八個(gè)衛(wèi)星接收器的配
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Maxim推出結(jié)構(gòu)緊湊的USB充電器識(shí)別開關(guān)

  • 　　Maxim推出USB充電器識(shí)別方案MAX14566E，支持采用筆記本電腦為便攜設(shè)備充電，即使筆記本電腦處于休眠或深度休眠模式也可進(jìn)行充電。該款開關(guān)支持USB電池充電規(guī)范1.1版以及面向中國市場(chǎng)的CCSA YD/T 1591-2006標(biāo)準(zhǔn)。MAX14566E結(jié)構(gòu)緊湊(2mm x 2mm)，與分立方案相比可有效節(jié)省電路板空間，降低軟件開銷。 　　MAX14566E通過充電器識(shí)別電路可自動(dòng)識(shí)別所連接的便攜設(shè)備類型，該電路無需外部軟件干預(yù)，主機(jī)USB端口可通過短接D+/D-檢測(cè)支持兼容USB電池充電規(guī)范1.
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Verilog HDL與VHDL及FPGA的比較分析

  • Verilog HDL與VHDL及FPGA的比較分析,　Verilog HDL　　優(yōu)點(diǎn)：類似C語言，上手容易，靈活。大小寫敏感。在寫激勵(lì)和建模方面有優(yōu)勢(shì)。　　缺點(diǎn)：很多錯(cuò)誤在編譯的時(shí)候不能被發(fā)現(xiàn)?！　HDL　　優(yōu)點(diǎn)：語法嚴(yán)謹(jǐn)，層次結(jié)構(gòu)清晰?！　∪秉c(diǎn)：熟悉時(shí)間長，不夠靈
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歐洲晶圓代工廠應(yīng)對(duì)亞洲同行挑戰(zhàn)

  • 　　據(jù)iSuppli公司，通過采用有針對(duì)性的技術(shù)、靈活的生產(chǎn)擴(kuò)張戰(zhàn)略和明智的收購行動(dòng)，歐洲半導(dǎo)體代工廠商X-FAB Semiconductor Foundries AG和LFoundry GmbH已經(jīng)在市場(chǎng)中占有一席之地，成為模擬與混合信號(hào)半導(dǎo)體供應(yīng)商。 　　
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基于Verilog HDL的UART模塊設(shè)計(jì)與仿真

  • 摘要：通用異步收發(fā)器UART常用于微機(jī)和外設(shè)之間的數(shù)據(jù)交換，針對(duì)UART的特點(diǎn)，提出了一種基于Ver4log HDL的UART設(shè)計(jì)方法。采用自頂向下的設(shè)計(jì)路線，結(jié)合狀態(tài)機(jī)的描述形式，使用硬件描述語言設(shè)計(jì)UART的頂層模塊及各個(gè)子
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X-FAB公布首款0.35微米100V高壓純晶圓代工廠技術(shù)

  • 　　X-FAB Silicon Foundries，業(yè)界領(lǐng)先的模擬/混合信號(hào)晶圓廠及“超越摩爾定律”技術(shù)的專家，今天公布了業(yè)界首款100V高壓0.35微米晶圓廠工藝。它能用于電池管理,提供新類型的可靠及高性能電池監(jiān)控與保護(hù)系統(tǒng)。它也非常適合用于功率管理設(shè)備，以及用于使用壓電驅(qū)動(dòng)器的超聲波成像和噴墨打印機(jī)的噴頭。此外，X-FAB加入了新興改良式N類與P類雙擴(kuò)散金屬氧化物半導(dǎo)體(DMOS)晶體管，對(duì)于達(dá)到100V的多運(yùn)作電壓，導(dǎo)通電阻可降低45%，晶片的占位能夠降低40%，從而降低了晶
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