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EEPW首頁 >> 主題列表 >> 數字信號處理(dsp)

數字信號處理(dsp) 文章 進入數字信號處理(dsp)技術社區(qū)

高效FPGA乘法器在無線基站中的使用

  • 　　基于WiMax及其派生標準的新興寬帶無線協(xié)議需要越來越高的吞吐量和數據速率。這些協(xié)議提出的快速芯片速率和數字射頻處理可以在使用FPGA方案的硬件上得到最佳的實現(xiàn)。 　　FPGA非常適合作為高性能、高性價比的解決方案來實現(xiàn)這些物理層協(xié)議中的數字功能，因為它們包括以下豐富的資源： 　　1.DSP模塊，可以用來實現(xiàn)各種FIR濾波和FFT/IFFT操作所要求的乘法器和加法器/累加器功能； 　　2. SERDES收發(fā)器，可以支持無線前端與基帶數字板之間的CPRI和OBSAI接口； 　　3. 重要的FPG
  • 關鍵字： FPGA  乘法器  無線  基站  WiMax  DSP  IP核  

一種基于多DSP協(xié)同工作的控制系統(tǒng)

  • 　　盡管數字信號處理器(DSP)的性能越來越強，基于DSP嵌入式系統(tǒng)的功能也越來越多，但對于實時性、容錯性、可靠性要求很高的多任務信號處理及多路過程控制方面的應用，單個DSP嵌入式系統(tǒng)的處理能力是不夠的。分布式系統(tǒng)處理能力強、可靠性高，采用多個DSP嵌入式子系統(tǒng)構成分布式系統(tǒng)，利用分布式系統(tǒng)的并發(fā)性實現(xiàn)多個DSP的并行處理，滿足多任務、實時性的要求。同時，通過硬件和軟件冗余設計，保證了系統(tǒng)的可靠性。 　　本文采用TMS320F2812 DSP實現(xiàn)了三個同構的、具有多種實時信號處理和多個過程控制功能的嵌入
  • 關鍵字： DSP  CAN總線  嵌入式  分布式系統(tǒng)  

用FPGA實現(xiàn)低成本實時深度感知

  • 引言 　　對于自主機器人導航和其它機器視覺應用來說，實時深度感知是很關鍵的。目前通過立體圖像來計算深度的算法計算量很大，例如差異測繪，要占用CPU大量的時間，或者需要用昂貴的器件進行實時操作。 　　針對立體攝像的深度感知，F(xiàn)PGA解決方案能使處理器的時間得到緩解，減少或除去器件的成本，例如MPU、DSP、激光器和昂貴的鏡頭。通過提供給機器人其環(huán)境中 的差異測繪，F(xiàn)PGA使機器人中的CPU專注于重要的高層任務，例如建圖和定位。 差異測繪 　　加深度感知到機器人的常用技術是用兩個水平放置的
  • 關鍵字： 機器視覺  FPGA  深度感知  嵌入式  DSP  200806  

基于CMOS圖像傳感器的嵌入式圖像采集與格式轉化

  • 開發(fā)了一種基于CMOS圖像傳感器的嵌入式圖像采集系統(tǒng)。該系統(tǒng)實現(xiàn)了圖像有效采集傳輸的功能，將采集到的Bayer格式數據轉化為RGB格式，采用嵌入式系統(tǒng)有利集成化、小型化設計。
  • 關鍵字： CMOS  圖像傳感器  DSP  Bayer格式  圖像采集  200806  

基于USB接口和DSP的飛機防滑剎車測試系統(tǒng)設計

  • 提出了以DSP為控制核心，采用USB通信設計的飛機防滑剎車測試系統(tǒng)。分析了飛機防滑剎車測試系統(tǒng)的組成，并介紹了測試系統(tǒng)主要硬件電路設計和系統(tǒng)上下位機軟件設計。
  • 關鍵字： 剎車  測試系統(tǒng)  設計  防滑  飛機  USB  接口  DSP  基于  

異步DSP核心設計:更低功耗,更高性能

  • 目前，處理器性能的主要衡量指標是時鐘頻率。絕大多數的集成電路 (IC) 設計都基于同步架構，而同步架構都采用全球一致的時鐘。這種架構非常普及，許多人認為它也是數字電路設計的唯一途徑。然而，有一種截然不同的設計技術即將走上前臺：異步設計。
    這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。

    異步技術由于諸多原因曾經備受冷落，其中最重要的是缺乏標準化的
  • 關鍵字： 功耗  高性能  設計  核心  DSP  異步  

基于DSP和模糊控制的尋線行走機器人設計與實現(xiàn)

  • 　　在最近的機器人比賽和電子設計競賽中，較多參賽題目要求機器人沿場地內白色或黑色指引線行進。一些研究人員提出了基于尋線的機器人設計策略，主要是關注指引線的檢測，但對于機器人的整體設計未做說明。本文在總結此類賽事的基礎上，提出了一種將DSP(Digital Signal Processor)和CPLD(Complex Programmable Logic Device)作為核心處理器，采用模糊控制策略處理來自檢測指引線傳感器信號的機器人行走機構的通用性設計方法。 　　1 車體機械設計 　　由于機器人比賽
  • 關鍵字： DSP  模糊控制  機器人  傳感器  單片機  

FPGA+DSP實時三維圖像信息處理系統(tǒng)

  • 　　三維圖像信息處理一直是圖像視頻處理領域的熱點和難點，目前國內外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預處理、重建、構型等囊括底層和高層的處理工作。三維圖像處理數據量特別大、運算復雜，單純依靠通用PC很難達到實時性要求，不能滿足現(xiàn)行高速三維圖像處理應用。 　　本系統(tǒng)中，采用FPGA實現(xiàn)底層的信號預處理算法，其處理數據量很大，處理速度高，但算法結構相對比較簡單，可同時兼顧速度和靈活性。高層處理算法數據量較少、算法結構復雜，可采用運算速度快、尋址方式靈活、通信機制強大的
  • 關鍵字： FPGA  DSP  三維圖像信息處理  EVIP  PCI  

基于DSP Builder的14階FIR濾波器的設計

  • 數字濾波器在數字信號處理的各種應用中發(fā)揮著十分重要的作用，他是通過對采樣數據信號進行數學運算處理來達到頻域濾波的目的。數字濾波器既可以是有限長單脈沖響應(FIR)濾波器也可以是無限長單脈沖響應(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現(xiàn)在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP
  • 關鍵字： 濾波器  設計  FIR  Builder  DSP  基于  

異步 DSP 核心設計: 更低功耗，更高性能

  • 這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。
  • 關鍵字： 功耗  高性能  設計  核心  DSP  異步  

EDGE手機基帶處理設計的幾種實現(xiàn)方法評估

用8位微處理器實現(xiàn)數字低通濾波器設計

  • 電子產品世界,為電子工程師提供全面的電子產品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
  • 關鍵字： 8位微處理器  DSP  數字  低通濾波器  

什么是DSP及DSP技術詳解

  • 電子產品世界,為電子工程師提供全面的電子產品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
  • 關鍵字： 數字信號處理  DSP  

基于DSP多處理器實時開發(fā)環(huán)境的設計

  • 本文通過研究提出了一種多處理器實時開發(fā)環(huán)境的設計思想，它可以支持多種型號處理器的同時開發(fā)，使系統(tǒng)級開發(fā)變得簡單易行。
  • 關鍵字： 環(huán)境  設計  開發(fā)  實時  DSP  處理器  基于  

DSP應用系統(tǒng)中的硬件接口電路設計

  • 介紹了DSP應用系統(tǒng)的硬件接口電路：包括電平變換電路、仿真器JTAG接口電路、以及可擴展的硬件接口（如A/D、D/A、SRAM）等的設計方法，并給出了接口電路在設計時須注意的幾個問題。
  • 關鍵字： DSP  應用系統(tǒng)  電路設計  硬件接口    
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數字信號處理(dsp)介紹

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