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EEPW首頁 >> 主題列表 >> asic ip核

基于Wishbone總線的UART IP核的設計

  • 隨著集成電路與嵌入式技術的發(fā)展與廣泛應用，許多嵌入式系統(tǒng)都需要進行串行通信，因此在片上嵌入式系統(tǒng)芯片中集...
  • 關鍵字： Wishbone總線  UART  IP核  

基于H.264的Exp-Golomb解碼器ASIC設計

  • 本文的研究目標是設計H．264標準中的Exp-Golomb解碼器，在對其算法進行深入探討的基礎上，提出了一種高效且低成本的ASIC實現(xiàn)方案。

    Exp-Golomb編碼原理及解碼算法分析

    在H．264基本規(guī)范中，除了殘差變
  • 關鍵字： ASIC  設計  解碼器  Exp-Golomb  H.264  基于  

基于DDR3存儲器接口控制器IP核的視頻數(shù)據(jù)處理

博世授予ADI 公司2009-2010年度最佳供應商稱號

  • Analog Devices, Inc. (NYSE:ADI)，全球領先的高性能信號處理解決方案供應商及汽車行業(yè)的長期合作伙伴，近日榮獲2009-2010年度“博世最佳供應商大獎”。此項殊榮源于 ADI 在電子產(chǎn)品領域（ASIC 和 ASSP）的杰出服務，尤其是其所提供的模擬和混合信號產(chǎn)品專門針對具體應用而設計，完全符合汽車工業(yè)極高的質(zhì)量和可靠性標準。
  • 關鍵字： ADI  ASIC   

基帶信號QPSK調(diào)制與脈沖成型濾波器ASIC實現(xiàn)

  • 摘要：WCDMA基帶處理器上行方向采用QPSK調(diào)制方式與根升余弦脈沖成型濾波器產(chǎn)生3GPP WCDMA協(xié)議25．213 Release6中規(guī)定的基帶信號。文章介紹了QPSK調(diào)制與此同時脈沖成型的基本原理，并給出了該調(diào)制方式與成型濾波器的A
  • 關鍵字： 濾波器  ASIC  實現(xiàn)  成型  脈沖  信號  QPSK  調(diào)制  基帶  

一種高速I2C總線從器件接口IP核的設計與實現(xiàn)

  • I2C總線作為一種事實上的國際標準，在超過100種不同的IC上實現(xiàn)并且得到超過50家公司的許可。它具有連線少，結構簡單的特點。本文介紹了一種高速I2C從器件接口電路IP核設計。在系統(tǒng)應用中，單片機作為主控器件，本IP核作為從器件中的接口電路，它們通過I2C總線相連，實現(xiàn)MCU對IC或FPGA中相關寄存器的訪問。從而代替了MCU通用的地址數(shù)據(jù)接口，大大減少了IC或FPGA的管腳數(shù)量，節(jié)省了I/O資源，這對于I/O資源緊張的IC設計和FPGA開發(fā)是非常有意義的。
  • 關鍵字： FPGA  I2C總線  IP核  201107  

基于SoPC的SD卡控制器IP核的設計

  • 摘要:針對目前在嵌入式平臺中使用SD卡控制器專用芯片價格昂貴、軟件模擬SPI時序控制讀寫速度較慢的問題...
  • 關鍵字： 控制器  IP核  Quartus  II  

基于FPGA IP核的線性調(diào)頻信號脈沖壓縮

  • 近年來，隨著現(xiàn)場可編程門陣列(FPGA)在雷達信號處理中的廣泛應用以及FPGA芯片技術的發(fā)展，為大家提供了一種較好...
  • 關鍵字： 調(diào)頻信號  IP核  脈沖壓縮  

一種ASIC硬件圖像匹配最大互相關算法的設計和實現(xiàn)

  • 一種ASIC硬件圖像匹配最大互相關算法的設計和實現(xiàn),圖像匹配是指通過一定的匹配算法在兩幅或多幅圖像之間識別同名點，如二維圖像匹配中通過比較目標區(qū)和搜索區(qū)中相同大小的窗口的相關系數(shù)，取搜索區(qū)中相關系數(shù)最大所對應的窗口中心點作為同名點。其實質(zhì)是在基元相似性
  • 關鍵字： 相關  算法  設計  實現(xiàn)  最大  匹配  ASIC  硬件  圖像  一種  

線性調(diào)頻信號基于FPGA IP核的脈沖壓縮設計

  • 摘要：為實現(xiàn)線性調(diào)頻信號的數(shù)字脈沖壓縮，設計一個FPGA硬件平臺，并著重提出一種基于FPGA IP核的脈沖壓縮設計方法。針對脈沖壓縮進行了理論分析和Matlab仿真，設計完成后對系統(tǒng)軟、硬件進行了全面測試，并根據(jù)實測數(shù)
  • 關鍵字： FPGA  線性調(diào)頻信號  IP核  脈沖壓縮    

萊迪思和FLEXIBILIS推出首個FPGA以太網(wǎng)交換IP核

  • 萊迪思半導體公司（NASDAQ: LSCC）和Flexibilis Oy今日宣布了即可獲取Flexibilis以太網(wǎng)交換（FES）IP核。三速（10Mbps/100Mbps/1Gbps）FES IP核工作在以太網(wǎng)第2層，每個端口具有Gigabit的轉(zhuǎn)換能力。支持Gigabit光纖和Gigabit雙絞線銅以太網(wǎng)接口。支持的服務質(zhì)量高達每端口四個隊列。
  • 關鍵字： LSCC  FES – HSR IP核  

數(shù)字下變頻(DDC)中坐標變換模塊的ASIC實現(xiàn)

  • 數(shù)字下變頻(DDC)中坐標變換模塊的ASIC實現(xiàn),數(shù)字下變頻器中坐標變換模塊的ASIC實現(xiàn)1．引言

    數(shù)字下變頻(DDC)技術是軟件無線電接收機的核心技術。其基本功能是從輸人的寬帶高速數(shù)字信號中提取所需的窄帶信號，將其下變頻為數(shù)字基帶信號，并轉(zhuǎn)換成較低的數(shù)據(jù)率
  • 關鍵字： 模塊  ASIC  實現(xiàn)  變換  坐標  變頻  DDC  數(shù)字  

數(shù)字下變頻器中坐標變換模塊的ASIC實現(xiàn)

  • 1．引言數(shù)字下變頻(DDC)技術是軟件無線電接收機的核心技術。其基本功能是從輸人的寬帶高速數(shù)字信號...
  • 關鍵字： 數(shù)字下變頻  DDC  ASIC  坐標變換  

ASIC后端設計中的時鐘樹綜合

  • 摘要：時鐘樹綜合是當今集成電路設計中的重要環(huán)節(jié)，因此在FFT處理器芯片的版圖設計過程中，為了達到良好的布局效果，采用時序驅(qū)動布局，同時限制了布局密度；為了使時鐘偏移盡可能少，采用了時鐘樹自動綜合和手動修改
  • 關鍵字： ASIC  后端設計  時鐘樹    

賽靈思變革生態(tài)系統(tǒng)加速可編程平臺主流應用進程

  • 　　日前， 全球可編程平臺領導廠商賽靈思公司 （Xilinx, Inc. (NASDAQ:XLNX)）宣布，為建立新的 FPGA 應用市場， 賽靈思公司將通過其開放式平臺以及對業(yè)界重要標準的支持變革生態(tài)系統(tǒng)， 推動賽靈思聯(lián)盟計劃向縱深層次發(fā)展。作為該計劃的一部分， 賽靈思將幫助 FPGA 用戶根據(jù)其具體的設計與開發(fā)要求更方便快捷地找到理想的合作伙伴， 同時提升客戶與賽靈思聯(lián)盟計劃成員合作時的滿意度和質(zhì)量。 　　賽靈思合作伙伴生態(tài)系統(tǒng)及聯(lián)盟高級總監(jiān) Dave Tokic 指出： “客戶開始越來
  • 關鍵字： Xilinx  ASIC  ASSP  
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