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嵌入式系統(tǒng)的自適應前照燈系統(tǒng)設計

  • 摘要:為了改善駕駛員在夜間或能見度較低環(huán)境下的視野范圍,提高行駛的安全性,介紹了一種基于嵌入式系統(tǒng)的汽車自適應前照燈系統(tǒng)的設計方案。此系統(tǒng)中的前照燈控制器采用FPGA來控制CAN總線控制器、數(shù)/模轉(zhuǎn)換器和全橋
  • 關鍵字: 步進電機  FPGA  MCP2510  LMD18245  

單片機,ARM,F(xiàn)PGA,嵌入式這些有什么區(qū)別,各自特點是什么?

  • 單片機的特點:(1)受集成度限制,片內(nèi)存儲器容量較小,一般內(nèi)ROM:8KB以下;(2)內(nèi)RAM:256KB以內(nèi)。(3)可靠性高(4)易擴展(5)控制功能強(6)易于開發(fā)ARM的特點:(1) 自帶廉價的程序存儲器(FLASH)和非易失的數(shù)據(jù)存儲器(E
  • 關鍵字: 單片機  嵌入式  FPGA  ARM  

基于CPLD的FPGA從并快速加載方案

  • 現(xiàn)場可編程門陣列(FPGA)作為專用集成電路(ASIC)領域的一種半定制電路,可以根據(jù)設計的需要靈活實現(xiàn)各種接口或者總線的輸出,在設備端的通信產(chǎn)品中已得到越來越廣泛的使用。FPGA 是基于靜態(tài)隨機存儲器(SRAM)結構的,
  • 關鍵字: FPGA    CPLD    控制器    從并    加載  

基于FPGA的多路視頻收發(fā)系統(tǒng)的設計與實現(xiàn)

  • 摘要:為了實現(xiàn)對多路視頻和數(shù)據(jù)信號的同步傳輸,提出了一種基于FPGA的視頻數(shù)據(jù)綜合傳輸系統(tǒng)設計方案,并完成系統(tǒng)的軟硬件設計。該系統(tǒng)的硬件部分主要由FPGA、CPLD芯片及光模塊等設備組成,軟件部分采用VHDL語言進行
  • 關鍵字: 視頻傳輸  FPGA  數(shù)據(jù)傳輸  光模塊  

智原發(fā)表PowerSlash(TM)硅智財于聯(lián)電55奈米超低功耗製程支援物聯(lián)網(wǎng)應用開發(fā)

  •   聯(lián)華電子今(12日)與ASIC設計服務暨IP研發(fā)銷售廠商智原科技(Faraday Technology Corporation,TWSE:3035)共同發(fā)表智原科技于聯(lián)電55奈米超低功耗製程(55ULP)的PowerSlash™基礎IP方案。智原PowerSlash™與聯(lián)電製程技術相互結合設計,為超低功耗的無線應用需求技術進行優(yōu)化,滿足無線物聯(lián)網(wǎng)產(chǎn)品的電池長期壽命需求。   智原科技行銷暨投資副總于德旬表示:「物聯(lián)網(wǎng)應用建構過程中,效能往往受制于低功耗技術。而今透過聯(lián)電55奈
  • 關鍵字: 聯(lián)華電子  ASIC  

FPGA實現(xiàn)的FIR算法在汽車動態(tài)稱重儀中的應用

  •   引言   車輛在動態(tài)稱重時,作用在平臺上的力除真實軸重外,還有許多因素產(chǎn)生的干擾力,如:車速、車輛自身諧振、路面激勵、輪胎驅(qū)動力等,給動態(tài)稱重實現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波,參數(shù)則不能過大,否則將產(chǎn)生過大的延遲導致不能實現(xiàn)實時處理,從而造成濾波后的信號仍然含有相當一部分的噪聲。所以必須采用數(shù)字濾波消除干擾。   FIR濾波的原理及實現(xiàn)   本文采用FIR數(shù)字濾波,其原理如公式1所示。   Y(n)= (1)   其中h(k)為系統(tǒng)濾波參數(shù),x(n)為采集的信
  • 關鍵字: FPGA  FIR  

基于USB2.0協(xié)議的通用測控通信接口設計

  • 隨著我國航空航天技術的迅速發(fā)展,對地面遙控遙測接收機的實時性和高速數(shù)據(jù)傳輸性能的要求越來越高。越來越多的遙測遙控地面信道處理器都采用了實時能力更強的高速DSP/FPGA架構設計方案?;贒SP/FPGA架構的設計方案
  • 關鍵字: CY7C68013A  測控通信  FPGA  USB固件設計  

ARM與神經(jīng)網(wǎng)絡處理器的通信方案設計

  • 摘要:基于ARM芯片和FPGA的特點,設計了一種ARM與FPGA人工神經(jīng)網(wǎng)絡處理器之間的通信方案。該方案采用ARM的ZDMA控制器對數(shù)據(jù)傳輸進行控制,完成ARM與神經(jīng)網(wǎng)絡處理器的控制寄存器組、分布式存儲器、樣本存儲器等存儲體
  • 關鍵字: 神經(jīng)網(wǎng)絡  嵌入式  通信  ARM  FPGA  S3C44BOX  ZDMA  

基于雙口RAM核監(jiān)測數(shù)字示波器設計研究

  • 摘要:在核監(jiān)測中,常將各種傳感器輸出的信號通過A/D轉(zhuǎn)換器轉(zhuǎn)換為數(shù)字信號,然后利用數(shù)字信號處理技術對各種核信號進行數(shù)字處理。為了準確測量核信號數(shù)字波形的各種參數(shù),對基于FPGA雙口RAM的數(shù)字示波器進行了設計和
  • 關鍵字: 核脈沖  數(shù)字示波器  數(shù)字波形  FPGA  雙口RAM  

基于FPGA的數(shù)字通信實訓平臺的設計與實現(xiàn)

  • 摘要:本實訓平臺著眼于提升高職層次學生的職業(yè)能力,圍繞典型的數(shù)字通信系統(tǒng)模型,設計了擴展性強、可測性好的FPGA核心板,并開發(fā)了多個配套的功能模塊。憑借著FPGA強大的硬件可編程能力,創(chuàng)設了分層遞進的實驗模式
  • 關鍵字: FPGA  數(shù)字通信系統(tǒng)  EP1C3T144  QuartusⅡ9.0  片上通信系統(tǒng)  

基于FPGA IP核的FFT實現(xiàn)與改進

  • 摘要 利用FPGA IP核設計了一種快速、高效的傅里葉變換系統(tǒng)。針對非整數(shù)倍信號周期截斷所導致的頻譜泄露問題,提出了一種通過時輸入信號加窗處理來抑制頻譜泄露的方法。利用Modelsim和Matlab對設計方案進行了仿真,同
  • 關鍵字: FFT  FPGA  IP核  加窗處理  

基于FPGA的多路數(shù)字信號復接系統(tǒng)設計與實現(xiàn)

  • 摘要 數(shù)字復分接技術是數(shù)字通信網(wǎng)中的一項重要技術,能將若干路低速信號合并為一路高速信號,以提高帶寬利用率和數(shù)據(jù)傳輸效率。文中在介紹數(shù)字復接系統(tǒng)的基礎上,采用VHDL對數(shù)字復分接系統(tǒng)進行建模設計和實現(xiàn)。并利
  • 關鍵字: 數(shù)字復接系統(tǒng)  乒乓操作  先進先出存儲器  FPGA  

JPEG2000數(shù)據(jù)壓縮的FPGA實現(xiàn)

  • 高性能的數(shù)據(jù)壓縮可以有效的減少數(shù)據(jù)對存儲空間和通信帶寬的要求,降低通信成本。為解決圖像數(shù)據(jù)的高壓縮性能問題,本文提出了基于JPEG2000標準的數(shù)據(jù)壓縮系統(tǒng)的FPGA實現(xiàn)方案。相對于軟件算法實現(xiàn)和其他硬件方法,采用FPGA硬件實現(xiàn)可降低系統(tǒng)復雜度提高性能。最終設計的IP核具有資源占用少,性能良好和便于擴展等優(yōu)點,能夠滿足通信傳輸和照相設備等應用需求。
  • 關鍵字: JPEG2000  數(shù)據(jù)壓縮  FPGA  DWT  

基于NiosⅡ的單點自適應控制器設計研究

  • 摘要 為了提高道路交叉口通行能力,設計了一種單點交叉口自適應控制系統(tǒng)。系統(tǒng)采用SOPC方案,利用具有NiosⅡ軟核的FPGA芯片設計了控制器的硬件,井利用遺傳算法建立了信號配時優(yōu)化模型、VHDL語言進行了遺傳算法的硬
  • 關鍵字: NiosⅡ  FPGA  單點交叉口  自適應控制  遺傳算法硬件化  

高速實際據(jù)采集智能控制器的設計與實現(xiàn)

  • 摘要:文章以嵌入式和數(shù)據(jù)采集技術為基礎,研究設計并實現(xiàn)了基于ARM+FPGA體系架構面向高速實時數(shù)據(jù)采集應用的一種實用新型智能控制器。本文闡述了主處理器ARM最小系統(tǒng)、協(xié)處理器FPGA最小系統(tǒng)和ARM與FPGA通信接口等硬
  • 關鍵字: ARM  FPGA  智能控制器  高速實時數(shù)據(jù)采集  
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