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EEPW首頁 >> 主題列表 >> dsp-fta410

基于DSP Builder的14階FIR濾波器的設(shè)計

  • 數(shù)字濾波器在數(shù)字信號處理的各種應(yīng)用中發(fā)揮著十分重要的作用，他是通過對采樣數(shù)據(jù)信號進行數(shù)學(xué)運算處理來達到頻域濾波的目的。數(shù)字濾波器既可以是有限長單脈沖響應(yīng)(FIR)濾波器也可以是無限長單脈沖響應(yīng)(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現(xiàn)在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設(shè)計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP
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異步 DSP 核心設(shè)計: 更低功耗，更高性能

  • 這一新技術(shù)的主要推動力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi)，降低功耗就已成為首要事務(wù)。異步設(shè)計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。
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EDGE手機基帶處理設(shè)計的幾種實現(xiàn)方法評估

用8位微處理器實現(xiàn)數(shù)字低通濾波器設(shè)計

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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什么是DSP及DSP技術(shù)詳解

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于DSP多處理器實時開發(fā)環(huán)境的設(shè)計

  • 本文通過研究提出了一種多處理器實時開發(fā)環(huán)境的設(shè)計思想，它可以支持多種型號處理器的同時開發(fā)，使系統(tǒng)級開發(fā)變得簡單易行。
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DSP應(yīng)用系統(tǒng)中的硬件接口電路設(shè)計

  • 介紹了DSP應(yīng)用系統(tǒng)的硬件接口電路：包括電平變換電路、仿真器JTAG接口電路、以及可擴展的硬件接口（如A/D、D/A、SRAM）等的設(shè)計方法，并給出了接口電路在設(shè)計時須注意的幾個問題。
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一種基于DSP平臺的快速H.264編碼算法的設(shè)計

  • 　　視頻壓縮編碼標(biāo)準(zhǔn)H.264／AVC是由ISO／IEC和ITU-T組成的聯(lián)合視頻專家組(JVT)制定的，他引進了一系列先進的視頻編碼技術(shù)，如4×4整數(shù)變換、空域內(nèi)的幀內(nèi)預(yù)測，多參考幀與多種大小塊的幀間預(yù)測技術(shù)等，標(biāo)準(zhǔn)一經(jīng)推出，就以其高效的壓縮性能和友好的網(wǎng)絡(luò)特性受到業(yè)界的廣泛推崇。特別是在2004年7月JVT組織做了重要的保真度范圍擴展的補充后，更加擴大了標(biāo)準(zhǔn)的應(yīng)用范圍，但同時巨大的運算量卻成為其廣泛應(yīng)用的瓶頸?？紤]到H.264協(xié)議實現(xiàn)的復(fù)雜度，本文的思路是：一方面提高硬件處理速度和能力，采
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在采用FPGA設(shè)計DSP系統(tǒng)中仿真的重要性

  • 仿真是所有系統(tǒng)成功開發(fā)的基礎(chǔ)。通過在不同條件、參數(shù)值和輸入情況下對系統(tǒng)進行高級行為仿真，工程師可以迅速找到、分離并糾正系統(tǒng)的設(shè)計問題。因為在這一階段，比較容易區(qū)分設(shè)計問題和編程問題。通過在系統(tǒng)級工作，設(shè)計人員可以確定這一階段的問題是來自設(shè)計缺陷，而不是編程問題。此外，在信號處理系統(tǒng)設(shè)計中使用基于模型的方法大大縮短了“錯誤診斷延遲”時間――從設(shè)計中出現(xiàn)錯誤到發(fā)現(xiàn)錯誤并分離錯誤的時間。
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32位DSP兩級cache的結(jié)構(gòu)設(shè)計

  • 采用自頂向下的流程設(shè)計了一款32位DSP的cache。該cache采用兩級結(jié)構(gòu)，第一級采用哈佛結(jié)構(gòu)，第二級采用普林斯頓結(jié)構(gòu)。本文詳細論述了該cache的結(jié)構(gòu)設(shè)計及采用的算法。
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合眾達推出達芬奇音視頻應(yīng)用解決方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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ADSP-21262型DSP的監(jiān)控設(shè)計

  • 　　1 引言 　　隨著數(shù)字信號處理理論的日趨完善和超大規(guī)模集成電路技術(shù)的飛速發(fā)展,在各種實時處理應(yīng)用需求的推動下,數(shù)字信號處理器(DSP)也得到了越來越廣泛的應(yīng)用。 　　DSP的監(jiān)控是DSP開發(fā)和應(yīng)用中十分重要的環(huán)節(jié)。目前在DSP的開發(fā)過程中,最常用的方式是通過購買處理器的JTAG仿真器和開發(fā)軟件包實現(xiàn)對DSP的調(diào)試和監(jiān)控。JTAG調(diào)試工具的功能十分強大,對于不熟悉DSP內(nèi)部結(jié)構(gòu)和細節(jié)的開發(fā)者而言是一種非常不錯的選擇。但是此種方法也有其缺陷：首先,開發(fā)成本比較昂貴,一般購買正版仿真器和軟件包的價格都在
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基于DSP的音頻會議信號合成算法研究

  • 　　隨著在數(shù)字信號處理(DSP)算法和芯片處理能力以及通信網(wǎng)絡(luò)結(jié)構(gòu)優(yōu)化等方面的不斷發(fā)展，現(xiàn)代化通信已經(jīng)迅速普及。音頻會議是眾多通信系統(tǒng)的必備功能。有多個用戶參與的音頻會議，最簡單的模式可以使用令牌控制下的互斥模式，使只有擁有發(fā)言權(quán)的那個與會者才可以講話。在這種模式下，每個與會者某一時刻只能聽到一路音頻信號，這種“半雙工”模式對于音頻會議是不方便和不實際的。 　　真正的電話會議應(yīng)當(dāng)仿真多個與會者在一個會議室進行對話的情形。但是由于與會終端在物理上并不在一起，而每個終端只有一套音頻輸
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視頻監(jiān)控系統(tǒng)中ARM與DSP的HPI接口設(shè)計

  • 　　1 引言 　　隨著網(wǎng)絡(luò)技術(shù)、圖像處理技術(shù)及嵌入式技術(shù)日趨成熟，視頻監(jiān)控技術(shù)得到廣泛的應(yīng)用。銀行、工廠、政府、學(xué)校等部門，都設(shè)置有監(jiān)控系統(tǒng)。尤其是在國際上一系列恐怖事件后，人們更感到監(jiān)控系統(tǒng)的重要。而且要求視頻監(jiān)控設(shè)備有高清晰的視頻效果的同時，還能對現(xiàn)場進行實時控制。所以，此類設(shè)備不但要有更高的數(shù)據(jù)處理能力和處理精度，還要有強大的系統(tǒng)控制、管理能力以及高速的網(wǎng)絡(luò)數(shù)據(jù)傳輸速率。 　　目前，市面上主流的視頻監(jiān)控設(shè)備，大致可以分成兩類，一是基于通用微處理器，二是基于數(shù)字信號處理器DSP。兩種芯片在功能上有
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CEVA和ARM合作CEVA DSP + ARM多處理器SoC的開發(fā)支持

  • 　　硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺解決方案和數(shù)字信號處理器 (DSP) 內(nèi)核授權(quán)廠商CEVA公司宣布與ARM合作，針對多處理器系統(tǒng)級芯片 (SoC) 解決方案的開發(fā)，在ARM? CoreSight? 技術(shù)實現(xiàn)CEVA DSP內(nèi)核的實時跟蹤支持。這種強化的支持將使得日益增多的采用基于CEVA DSP + ARM處理器的SoC客戶，在使用具有ARM Embedded Trace Macrocell? (ETM) 技術(shù)的處理器時，受益于完全的系統(tǒng)可視化，從而簡化調(diào)試過程及確?？?/li>
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