“我們在NI CompactRIO平臺上開發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時間又保證了系統(tǒng)的穩(wěn)定性。”挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時也帶來了無功分量和高次諧波等危害，
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FPGA 無功補(bǔ)償 控制器
電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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DSP FPGA 汽車電子
電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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激光 DSP FPGA 控制單元
基于ARM＋FPGA的重構(gòu)控制器設(shè)計, 可重構(gòu)技術(shù)是指利用可重用的軟硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計方法。常規(guī)SRAM工藝的FPGA都可以實(shí)現(xiàn)重構(gòu)，利用硬件復(fù)用原理，本文設(shè)計的可重構(gòu)控制器采用ARM核微控制器作為主控制器
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控制器 重構(gòu) 設(shè)計 需求 不同 作為 FPGA 可以 靈活 系統(tǒng)
IP網(wǎng)絡(luò)故障定位的復(fù)雜程度，非一般運(yùn)維人員所能掌握。如何讓運(yùn)維人員追本溯源，了解IP故障發(fā)生的機(jī)理，掌握從現(xiàn)象到定位的過程，并順利排障？IP網(wǎng)絡(luò)故障管理難表現(xiàn)為兩點(diǎn)：第一，告警數(shù)量多，甚至是泛濫，每天告警工
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解決方案 故障 網(wǎng)絡(luò) IP 診治
引言可編程衰減器位于基站和終端之間，通過對射頻信號的衰減控制，實(shí)現(xiàn)對無線信號的模擬，從而實(shí)現(xiàn)對測試場景的模擬?？删幊趟p器提供多個數(shù)控接口，從小到大可以構(gòu)建各個層次的測試網(wǎng)絡(luò)。所構(gòu)成的衰減矩陣通過模擬
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FPGA 可編程 衰減器
安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing Asia)與賽靈思公司 (NASDAQ: XLX) 日前宣布啟動亞洲區(qū)X-fest 研討會注冊。X-fest 是深受 FPGA、DSP 和嵌入式系統(tǒng)開發(fā)人員歡迎的、為期一天的培訓(xùn)活動。
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賽靈思 FPGA X-fest
基于FPGA技術(shù)的存儲器設(shè)計及其應(yīng)用,復(fù)雜可編程邏輯器件—FPGA技術(shù)在近幾年的電子設(shè)計中應(yīng)用越來越廣泛。FPGA具有的硬件邏輯可編程性、大容量、高速、內(nèi)嵌存儲陣列等特點(diǎn)使其特別適合于高速數(shù)據(jù)采集、復(fù)雜控制邏輯、精確時序邏輯等場合的應(yīng)用。而應(yīng)
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及其 應(yīng)用 設(shè)計 存儲器 FPGA 技術(shù) 基于
基于FPGA的圖像采集模塊設(shè)計,1 引言 圖像采集是圖像處理的前提。圖像采集卡是常用的圖像輸入設(shè)備，通常占用PC機(jī)總線的一個插槽。它主要包括圖像存儲器單元、CCD或CMOS攝像頭接口、PC機(jī)總線接口等。傳統(tǒng)的圖像采集卡大多數(shù)采用 PCI接口，這種圖
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模塊 設(shè)計 采集 圖像 FPGA 基于
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計,隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展，F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測系統(tǒng)中信號采集模塊控制器的 IP核，是采用硬件描述語言來實(shí)現(xiàn)的。首先它是以ADS8364芯片為控制對象，結(jié)合
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IP 設(shè)計 控制器 數(shù)據(jù)采集 高速 通道 FPGA
采用FPGA解決通信接口問題,引言
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接口 問題 通信 解決 FPGA 采用
基于FPGA的中文字符顯示的VHDL程序,--文件名：lcd_driver.vhd?！ ?-功能：FGAD驅(qū)動LCD顯示中文字符“年”?！ ?-最后修改日期：2004.3.24。 library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use
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VHDL 程序 顯示 字符 FPGA 中文 基于
用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程為： 1.文本編輯：用任何文本編輯器都可以進(jìn)行，也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件，Verilog文件保存為.v文件 2.功能仿真：將文件調(diào)入HDL仿真
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完整 流程 PLD/FPGA 開發(fā) 語言 VHDL/VerilogHD
基于FPGA的LED電視動態(tài)背光系統(tǒng)設(shè)計,本文設(shè)計一款基于FPGA(現(xiàn)場可編程門陣列)的液晶電視動態(tài)背光系統(tǒng)，采用LED側(cè)背光方式，符合當(dāng)前液晶電視LED背光應(yīng)用主流?！ ‰娨晞討B(tài)背光 以往的電視機(jī)主板將圖像信號通過LVDS(LowVoltageDifferentialSignal，低
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背光 系統(tǒng) 設(shè)計 動態(tài) 電視 FPGA LED 基于
基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn),筆者在參加國家“863”重大專題項(xiàng)目“高速密碼芯片及驗(yàn)證平臺系統(tǒng)”的過程中，遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開，然后在數(shù)據(jù)部分送密碼芯片進(jìn)行加/解密處理，最后再將處理后的數(shù)據(jù)部分與
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封裝 實(shí)現(xiàn) 分離 數(shù)字 FPGA IPV6 基于
fpga ip介紹
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