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基于FPGA的高速數(shù)據(jù)采集存儲系統(tǒng)的設計

  • 0 引言
    信息技術的發(fā)展，特別是各種數(shù)字處理器件處理速度的提高，實時處理大量的數(shù)據(jù)已經(jīng)成為現(xiàn)實。但是，在一些惡劣環(huán)境和數(shù)據(jù)無法進行實時傳輸?shù)那闆r下，還必須用到存儲測試的方法。存儲測試是指在對被測對象
  • 關鍵字： FPGA  高速數(shù)據(jù)  采集  存儲系統(tǒng)    

基于EP1C3T144C8的FPGA的開發(fā)板設計

  • O 引言
    現(xiàn)場可編程門陣列(FPGA，F(xiàn)ield Programmable Gate Array)的出現(xiàn)是超大規(guī)模集成電路(VISI)技術和計算機輔助設計(CAD)技術發(fā)展的結果。FPGA器件集成度高、體積小，具有通過用戶編程實現(xiàn)專門應用的的功能。
  • 關鍵字： 144C  T144  FPGA  144    

一種基于FPGA并行流水線的FIR濾波器設計方案

  • 1 Fir濾波器原理
    有限沖激響應(FIR)數(shù)字濾波器和無限沖激響應(IIR)數(shù)字濾波器廣泛應用于數(shù)字信號處理系統(tǒng)中。IIR數(shù)字濾波器方便簡單，但它相位的非線性，要求采用全通網(wǎng)絡進行相位校正，且穩(wěn)定性難以保障。FIR濾
  • 關鍵字： FPGA  FIR  并行  流水線    

基于Matlab和FPGA的FIR數(shù)字濾波器設計及實現(xiàn)

  • 摘要：基于FIR數(shù)字濾波器的原理和層次化、模塊化設計思想，結合Altera公司的CycloneII系列FPGA芯片，提出了FIR數(shù)字濾波器的實現(xiàn)硬件方案，給出了采用Matlab、QuartusⅡ設計及實現(xiàn)32階低通FIR濾波器的方法步驟，仿真及
  • 關鍵字： Matlab  FPGA  FIR  數(shù)字    

2009年3月30日，Altera在天津大學成立國內第60所EDA/SOPC聯(lián)合實驗室

  • 　　Altera公司今天宣布，Altera公司于2009年3月10日在天津大學成立EDA/SOPC聯(lián)合實驗室。這是Altera自2004年3月在中國電子科技大學成立首個EDA/SOPC聯(lián)合實驗室以來的國內第60所聯(lián)合實驗室和培訓中心。該實驗室將為數(shù)字邏輯電路、硬件描述語言、微機原理、電視原理、現(xiàn)代數(shù)字系統(tǒng)設計等本科或研究生課程的實驗教學以及電子類課程設計提供支持，Altera®公司的FPGA開發(fā)環(huán)境將成為貫穿天津大學電子工程類專業(yè)本科和研究生教育階段的實驗平臺。 　　作為全球領先的可編程邏輯器件
  • 關鍵字： Altera  FPGA  SOPC  

基于FPGA的高速圖像采集系統(tǒng)設計

  • 在高速圖像采集系統(tǒng)中，CPU時鐘資源、I／O端口資源、傳輸單元等都成為系統(tǒng)的瓶頸。本系統(tǒng)采用FPGA+RAM+USB的設計：FPGA硬件采樣模塊，有效降低采樣時延和CPU時鐘資源；獨特的RAM時序控制與讀寫控制分離設計，增加了模塊之間的獨立性，降低了控制的復雜度；USB設計在實現(xiàn)高速率數(shù)據(jù)傳輸?shù)耐瑫r又具有低成本、易安裝等優(yōu)點。
  • 關鍵字： FPGA  高速圖像采集  系統(tǒng)設計    

基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設

  • 基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設,1、引言　　最佳聲納系統(tǒng)的設計需要從聲納波形、聲納信道和聲納接收機三方面進行綜合考慮[1]。在聲納信道一定的假設下，需要設計最佳聲納波形和最佳接收機，使聲納系統(tǒng)能在給定的聲納環(huán)境中對目標有最佳的檢測效果。
  • 關鍵字： 產(chǎn)生  系統(tǒng)  波形  聲納  ARM  FPGA  基于  ARM  FPGA  聲納波形產(chǎn)生系統(tǒng)  DDS  軟件  

基于DSP Builder的正弦信號源優(yōu)化設計及其FPGA實現(xiàn)

  • 實現(xiàn)信號源常用的方法是頻率合成法，其中直接數(shù)字頻率合成法是繼直接頻率合成法和間接頻率合成法之后，隨著電子技術迅速發(fā)展的第三代頻率合成技術。DDS是一種全數(shù)字技術，它從相位概念出發(fā)直接合成所需頻率，它具有頻
  • 關鍵字： Builder  FPGA  DSP  正弦    

USB OTG的IP Core設計與FPGA驗證

  • 為了實現(xiàn)USB設備之間的直接通信，介紹一款USB 0TG IP核的設計與FPGA驗證。在分析OTG補充規(guī)范的基礎上，重點描述了USB OTG IP核的設計原理、模塊劃分以及每個模塊的功能，然后對USBOTG的部分特性進行詳細的闡述，最后給出該IP核在ModelSim中的功能仿真及FPGA驗證結果。結果表明，該IP核具備主機功能和設備功能，可作為一個獨立的IP模塊應用到SoC系統(tǒng)中。
  • 關鍵字： FPGA  驗證  設計  Core  OTG  IP  USB  

用 FPGA 產(chǎn)生高斯白噪聲序列的一種快速方法

  • 0 引言 短波信道存在多徑時延、多普勒頻移和擴散、高斯白噪聲干擾等復雜現(xiàn)象。為了測試短波通信設備的性能，通常需要進行大量的外場實驗。相比之下，信道模擬器能夠在實驗室環(huán)境下進行類似的性能測試，而且測試費用
  • 關鍵字： FPGA  高斯白噪聲  方法  序列    

無線基站中的FPGA和DSP組合

  • FPGA和DSP之間的“智能配分”可使無線系統(tǒng)設計師獲得最佳性能組合和成本――效能。應用DSP和FPGA組合可使成本降低。對于無線基站，組合有DSP可編程邏輯的系統(tǒng)配分，可促使更大的產(chǎn)品設計和市場成功率。更高數(shù)據(jù)率的需
  • 關鍵字： FPGA  DSP  無線基站  組合    

用FPGA實現(xiàn)數(shù)字電視條件接收系統(tǒng)

  • 摘　要：根據(jù)數(shù)字電視條件接收系統(tǒng)的原理，提出一種ECM在 TS層加入、復接和條件接收相互獨立的CAS實現(xiàn)方法。ECM在TS層加入，對于TS層加擾來說，易于實現(xiàn)加擾和解擾同步；復接和條件接收相互分離使條件接收系統(tǒng)實現(xiàn)比
  • 關鍵字： FPGA  數(shù)字電視  條件接收系統(tǒng)    

UWB模塊Wisair DV9110M 配置的FPGA實現(xiàn)

  • 本方法在實際應用過程中得到了驗證，能夠穩(wěn)定地代替軟件行使UWB模塊的配置管理功能，并顯著提高了系統(tǒng)性能，極大方便了Wisair DV9110M的研發(fā)應用。
  • 關鍵字： Wisair  9110M  9110  FPGA    

基于SRAM的FPGA連線資源的一種可測性設計

  • 本文提出在FPGA芯片內插入多條移位寄存器鏈的方法，可使測試開關盒連線資源的時問比傳統(tǒng)的測試方法和已有的一種方法時間上減少了99％以上，大大降低了測試的時間，降低了測試成本，并且消耗的硬件面積比大約在5％左右，在可接受的范圍內。
  • 關鍵字： SRAM  FPGA  資源  可測性設計    

可編程應用的引爆點即將到來

  • 　　25年前，賽靈思(Xilinx)公司發(fā)明了FPGA(現(xiàn)場可編程門陣列)。如今，以FPGA為代表的可編程芯片應用已經(jīng)成為勢不可擋的發(fā)展趨勢，尤其在ASSP和傳統(tǒng)ASIC之間出現(xiàn)的市場缺口上，F(xiàn)PGA將開辟出新的領域,而目前席卷全球的金融危機更是成為FPGA迅速發(fā)展的催化劑。
  • 關鍵字： Xilinx  FPGA  200903  
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