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實時圖像小波無損壓縮系統(tǒng)的FPGA實現(xiàn)

  • 將Altera 公司的DE2 多媒體開發(fā)平臺與Terasic 公司的D5M 數(shù)碼相機開發(fā)套件相結(jié)合，設(shè)計了一套基于小波無損壓縮的實時圖像處理系統(tǒng)。系統(tǒng)采用便于可編程邏輯器件靈活實現(xiàn)的二維整數(shù)5 /3 提升小波變換實現(xiàn)壓縮。為保證圖像的無損壓縮，對邊界數(shù)據(jù)進(jìn)行對稱周期延拓處理。并針對實時處理過程中的大容量數(shù)據(jù)流的存儲問題，應(yīng)用片外存儲資源保存采集和處理過程中的圖像數(shù)據(jù)，有效地降低了片上存儲資源的消耗。測試結(jié)果表明: 系統(tǒng)滿足實時圖像采集、預(yù)處理及無損壓縮的要求。
  • 關(guān)鍵字： 圖像處理  無損壓縮  FPGA  

獨立分量分析中NLPCA-RLS算法IP核的設(shè)計

  • 為解決實時性盲信號分離的問題,基于獨立分量分析的模型,設(shè)計出了NLPCA-RLS算法的IP核。利用Simulink和DSP Builder對算法中用到的乘法器、查找表、狀態(tài)機等進(jìn)行建模,通過Quartus II綜合后在Altera FPGA器件中進(jìn)行硬件仿真。仿真實驗分別采用人工生成的周期信號和真實的語音信號進(jìn)行驗證。實驗結(jié)果表明,該IP核能很好的完成瞬時混合模型中盲信號的分離,具有很強的實用性。
  • 關(guān)鍵字： DSPBuilder  IP核  FPGA  

基于FPGA的鍵盤輸入累計存儲IP核的設(shè)計與驗證

  • 基于FPGA設(shè)計了一款通用鍵盤IP核,該核主要實現(xiàn)對鍵盤輸入信號的計算與存儲功能,并在quartusⅡ環(huán)境下使用VHDL語言,采用自頂向下設(shè)計方式,編輯生成RTL原理圖,并做了相關(guān)的時序仿真驗證。經(jīng)驗證此IP核具有較強的魯棒性和較高的反應(yīng)速度,可作為基礎(chǔ)輸入模塊,為其他模塊提供有力控制輸入與數(shù)據(jù)支持。
  • 關(guān)鍵字： 鍵盤IP核  VHDL  FPGA  

大規(guī)模FPGA設(shè)計中的C/C++解決方案

  • systemC和Handle-C，它們相應(yīng)的開發(fā)系統(tǒng)為：CoCentric System Stadio和Celoxica DK1。這兩種語言都是在C/C＋＋的基礎(chǔ)上根據(jù)硬件設(shè)計的需求加以改進(jìn)和擴充，用戶可以在它們的開發(fā)環(huán)境編輯代碼，調(diào)用庫文件，甚至可以引進(jìn)HDL程序，并進(jìn)行仿真，最終生成網(wǎng)表文件，放到FPGA中執(zhí)行。
  • 關(guān)鍵字： EDA技術(shù)  C語言  FPGA  

基于FPGA的紅外成像導(dǎo)引頭信號調(diào)理卡設(shè)計

  • 紅外成像導(dǎo)引頭采用紅外焦平面陣列探測器，易受太陽光等雜散光的影響，評估雜散光對紅外探測器成像質(zhì)量的影響十分重要。由于導(dǎo)引頭輸出的信號一般采用LVDS或HOTLink格式傳輸，不能被雜散光測試設(shè)備直接接收，設(shè)計了一種圖像調(diào)理卡，采用FPGA為控制核心，將紅外探測器輸出的圖像信號進(jìn)行格式轉(zhuǎn)換和調(diào)理后傳輸至雜散光測試設(shè)備。
  • 關(guān)鍵字： 導(dǎo)引頭  LVDS  FPGA  

一種混合結(jié)構(gòu)高速LDPC編碼器的FPGA實現(xiàn)

  • 分析了準(zhǔn)循環(huán)低密度奇偶校驗碼生成矩陣的結(jié)構(gòu)特點,討論了硬件可實現(xiàn)的三種常見編碼器結(jié)構(gòu),提出了一種混合結(jié)構(gòu)的FPGA實現(xiàn)方法。通過利用循環(huán)矩陣的結(jié)構(gòu)特性,增加少量硬件開銷,就可以實現(xiàn)編碼器高速編碼,滿足高速通信需求,吞吐量達(dá)1.36Gb/s。
  • 關(guān)鍵字： 奇偶校驗碼  循環(huán)矩陣  FPGA  

SRAM型FPGA單粒子效應(yīng)試驗研究

  • 針對軍品級SRAM型FPGA的單粒子效應(yīng)特性,文中采用重離子加速設(shè)備,對Xilinx公司Virtex-II系列可重復(fù)編程FPGA中一百萬門的XQ2V1000進(jìn)行輻射試驗。試驗中,被測FPGA單粒子翻轉(zhuǎn)采用了靜態(tài)與動態(tài)兩種測試方式。并且通過單粒子功能中斷的測試,研究了基于重配置的單粒子效應(yīng)減緩方法。試驗發(fā)現(xiàn)被測FPGA對單粒子翻轉(zhuǎn)與功能中斷都較為敏感,但是在注入粒子LET值達(dá)到42MeV.cm2/mg時仍然對單粒子鎖定免疫。
  • 關(guān)鍵字： 單粒子效應(yīng)  重離子加速設(shè)備  FPGA  

基于FPGA的LCoS顯示驅(qū)動系統(tǒng)的設(shè)計與實現(xiàn)

  • 研究了硅基液晶(LCoS)場序彩色顯示驅(qū)動系統(tǒng)的設(shè)計與實現(xiàn).該系統(tǒng)以FPGA作為主控芯片,用兩片高速DDR2 SDRAM作為幀圖像存儲器.通過對圖像數(shù)據(jù)以幀為單位進(jìn)行處理,系統(tǒng)將并行輸入的紅、綠、藍(lán)數(shù)據(jù)轉(zhuǎn)換成申行輸出的紅、綠、藍(lán)單色子幀.將該驅(qū)動系統(tǒng)與投影光機配合,實現(xiàn)了分辨率為800×600的LCoS場序彩色顯示.
  • 關(guān)鍵字： 硅基液晶  DDR  FPGA  

基于FPGA的平方根升余弦濾波器設(shè)計

  • 為了滿足陸上集群無線電（TETRA）數(shù)字集群系統(tǒng)對基帶信號成形處理的要求,提出了一種用于TETRA數(shù)字集群系統(tǒng)的平方根升余弦（SRRC）濾波器設(shè)計,論述了基帶成形濾波和SRRC濾波器的基本原理,分析了窄帶調(diào)制帶寬限制、TETRA鄰道干擾限制和濾波器階數(shù)等需解決的問題,論述了濾波器參數(shù)設(shè)計和FIR濾波器FPGA實現(xiàn)等關(guān)鍵技術(shù),完成了對基于FPGA的SRRC濾波器設(shè)計的仿真分析。
  • 關(guān)鍵字： 數(shù)字集群系統(tǒng)  基帶信號  FPGA  

基于FPGA的LCoS驅(qū)動及圖像FFT變換系統(tǒng)設(shè)計

  • 本文設(shè)計了基于FPGA 的LCoS 驅(qū)動代碼及圖像的FFT 變換系統(tǒng)， 為計算全息三維顯示圖像處理和顯示提供了硬件平臺。
  • 關(guān)鍵字： DDRII  全息三維顯示  FPGA  

基于FPGA圖形字符加速的液晶顯示模塊

  • 在傳統(tǒng)的工業(yè)控制應(yīng)用中,由于工業(yè)控制計算機中集成了高性能的顯卡,故通常采用工業(yè)控制計算機＋液晶顯示器的體系結(jié)構(gòu),可方便地實現(xiàn)以圖形和字符為主的人機界面。而在對實時性能和可靠性要求比較高的航空航天領(lǐng)域,通常要求液晶顯示器內(nèi)部集成圖形顯示功能,以減輕主控處理器的負(fù)擔(dān),并提高系統(tǒng)的實時性。重點介紹了如何利用FPGA實現(xiàn)基于Bresenham算法的2D圖形繪制（包括畫點、畫線、畫圓、畫橢圓）,以及點陣字符和位圖在液晶屏上的顯示,并提出了顯示性能優(yōu)化的一系列策略。
  • 關(guān)鍵字： 圖形顯示  2D圖形繪制  FPGA  

基于FPGA的簡易微機的結(jié)構(gòu)分析與實現(xiàn)

  • 微型計算機的原理及結(jié)構(gòu)一般不易理解掌握，利用FPGA來學(xué)習(xí)并構(gòu)建一個簡易微型計算機無疑是一個好方法，對EDA的軟硬件學(xué)習(xí)也是一個不錯的選擇，可為將來進(jìn)行相關(guān)ASIC沒計打下良好的基礎(chǔ)。
  • 關(guān)鍵字： 微型計算機  FPGA  EDA  

基于FPGA的高清圖像處理設(shè)計

  • FPGA解決方案可容易地支持超過HDTV要求的數(shù)據(jù)傳輸速率，這意味著一個器件可以支持所有這些格式，只需要根據(jù)設(shè)備的需要進(jìn)行重新編程就可以了。這可減少企業(yè)的用料清單項目，同時還排除了ASSP供應(yīng)商可能存在的供貨風(fēng)險。
  • 關(guān)鍵字： 廣播格式  圖像處理  FPGA  

基于FPGA的光纖陀螺慣導(dǎo)系統(tǒng)溫控電路接口設(shè)計

  • 本文介紹了一種基于FPGA的光纖陀螺慣導(dǎo)系統(tǒng)溫控電路接口設(shè)計。主要說明了溫控電路整體結(jié)構(gòu),溫控電路工作流程,FPGA與外圍電路的通信接口和FPGA的邏輯設(shè)計等幾個方面。
  • 關(guān)鍵字： 溫控電路  光纖陀螺  FPGA  

基于FPGA的AVS解碼芯片驗證平臺

  • 針對AVS視頻解碼芯片仿真和驗證的要求，提出了基于FPGA的驗證平臺框架。該驗證平臺主要用于對AVS解碼芯片進(jìn)行硬件模塊的驗證，從而為整個視頻解碼芯片的開發(fā)提供可靠的依據(jù)。該平臺基于Nios II軟核處理器，可使軟件模塊和硬件模塊在一個平臺下真正實現(xiàn)軟硬件協(xié)同工作?；谠撈脚_實現(xiàn)了多個硬件模塊和AVS視頻解碼芯片的驗證，其結(jié)果證明了該驗證平臺的正確性和可靠性。
  • 關(guān)鍵字： 視頻解碼  驗證平臺  FPGA  
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