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Xilinx：FPGA和SoC顛覆傳統(tǒng)控制

　　FPGA的特點(diǎn)是擅長(zhǎng)做信號(hào)的并行處理和硬件加速。Xilinx亞太區(qū)Zynq業(yè)務(wù)發(fā)展經(jīng)理羅霖認(rèn)為，在電機(jī)方面，由于現(xiàn)在中高端的機(jī)器人、數(shù)控機(jī)床等會(huì)用到六軸及以上的電機(jī)，這方面基本是FPGA一統(tǒng)天下。而三軸、四軸方案有時(shí)會(huì)看到x86、DSP和FPGA方案并存。　　圖1 機(jī)器人的智能控制示意圖　　中國(guó)現(xiàn)在四軸方案多一些，但是未來(lái)會(huì)向中高端去做。因?yàn)楝F(xiàn)在中國(guó)的電子元器件加工，食品飲料生產(chǎn)線、汽車生產(chǎn)線還主要靠采購(gòu)國(guó)外設(shè)備，未來(lái)會(huì)逐漸國(guó)產(chǎn)化。　　“針對(duì)工廠自動(dòng)化設(shè)備、高端數(shù)控機(jī)床、機(jī)
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基于FPGA的短波通信接收機(jī)

　　短波通信又稱高頻通信，是利用HF波段(3-30MHz)電磁波進(jìn)行的無(wú)線電通信。短波通信主要靠天波傳播，可經(jīng)電離層一次或數(shù)次反射，最遠(yuǎn)可傳至上萬(wàn)里，如按氣候、電離層的電子密度和高度的日變化以及通信距離等因素選擇合適頻率，就可用較小功率進(jìn)行遠(yuǎn)距離通信。短波通信設(shè)備較簡(jiǎn)單，機(jī)動(dòng)性大，因此也適應(yīng)于應(yīng)急通信和抗災(zāi)通信?，F(xiàn)代短波通信接收機(jī)正向著數(shù)字化、大通信帶寬方向發(fā)展。文獻(xiàn)[1-3]研究了短波通信的數(shù)字化實(shí)現(xiàn)方式，但其未對(duì)短波通信的大帶寬應(yīng)用進(jìn)行探討;文獻(xiàn)[4-6]研究了通信信道化算法，其對(duì)一定帶寬內(nèi)的多信道高
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FPGA的FIR抽取濾波器設(shè)計(jì)

　　用FPGA實(shí)現(xiàn)抽取濾波器比較復(fù)雜，主要是因?yàn)樵贔PGA中缺乏實(shí)現(xiàn)乘法運(yùn)算的有效結(jié)構(gòu)，現(xiàn)在，F(xiàn)PGA中集成了硬件乘法器，使FPGA在數(shù)字信號(hào)處理方面有了長(zhǎng)足的進(jìn)步。本文介紹了一種采用Xilinx公司的XC2V1000實(shí)現(xiàn)FIR抽取濾波器的設(shè)計(jì)方法。　　具體實(shí)現(xiàn) 　　結(jié)構(gòu)設(shè)計(jì) 　　基于抽取濾波器的工作原理，本文采用XC2V1000實(shí)現(xiàn)了一個(gè)抽取率為2、具有線性相位的3階FIR抽取濾波器，利用原理圖和VHDL共同完成源文件設(shè) 計(jì)。圖1是抽取濾波器的頂層原理圖。其中，clock是工作時(shí)鐘，reset是
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FPGA四大設(shè)計(jì)要點(diǎn)解析及應(yīng)用方案集錦

　　本文敘述概括了FPGA應(yīng)用設(shè)計(jì)中的要點(diǎn)，包括，時(shí)鐘樹(shù)、FSM、latch、邏輯仿真四個(gè)部分。　　FPGA的用處比我們平時(shí)想象的用處更廣泛，原因在于其中集成的模塊種類更多，而不僅僅是原來(lái)的簡(jiǎn)單邏輯單元(LE)。早期的FPGA相對(duì)比較簡(jiǎn)單，所有的功能單元僅僅由管腳、內(nèi)部buffer、LE、RAM構(gòu)建而成，LE由LUT(查找表)和D觸發(fā)器構(gòu)成，RAM也往往容量非常小?，F(xiàn)在的FPGA不僅包含以前的LE，RAM也更大更快更靈活，管教IOB也更加的復(fù)雜，支持的IO類型也更多，而且內(nèi)部還集成了一些特殊功能單元，
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【從零開(kāi)始走進(jìn)FPGA】非同于MCU的獨(dú)立按鍵消抖動(dòng)

　進(jìn)入電子，無(wú)處不用到按鍵， FPGA中的按鍵消抖動(dòng)更是非同一般，并針對(duì)不同情況有相應(yīng)的對(duì)策。
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權(quán)威調(diào)查（七）：軟件是促成更多客戶使用FPGA的原因

　　Xilinx亞太區(qū)銷售及市場(chǎng)副總裁楊飛在2014歲末如此總結(jié)：以前FPGA廠商的目標(biāo)是填補(bǔ)ASIC和ASSP空白，現(xiàn)在我們說(shuō)取代ASIC、ASSP，而我們現(xiàn)在要做的就是，不僅是硬件，還有軟件方面，讓系統(tǒng)級(jí)的架構(gòu)工程師和軟件編程工程師也能夠直接使用FPGA?！　ilinx亞太區(qū)銷售及市場(chǎng)副總裁楊飛　　因?yàn)镕PGA到今天為止，從來(lái)不乏風(fēng)險(xiǎn)投資公司的介入，但是三十多年以來(lái)，初創(chuàng)企業(yè)總是做不成、長(zhǎng)不大，根本原因和最大挑戰(zhàn)不是說(shuō)FPGA公司是硬件公司，因?yàn)槲覀兏臼且患腋丬浖墓?。FPGA就是把硬件變成軟件
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在使用CNN算法的云數(shù)據(jù)中心，Altera FPGA實(shí)現(xiàn)的加速功能具有優(yōu)異的每瓦性能

　　Altera公司今天宣布，微軟采用Altera Arria® 10 FPGA (現(xiàn)場(chǎng)可編程門陣列)實(shí)現(xiàn)基于CNN (卷積神經(jīng)網(wǎng)絡(luò))算法的數(shù)據(jù)中心加速功能，其每瓦性能非常優(yōu)異。這些算法通常用于圖像分類、圖像識(shí)別，以及自然語(yǔ)言處理等。　　微軟研究人員在云技術(shù)上不斷取得進(jìn)展，采用Arria 10開(kāi)發(fā)套件和Arria 10 FPGA工程樣片，展示了每瓦40 GFLOPS的性能——數(shù)據(jù)中心業(yè)界最好的性能水平。而且，與GPGPU相比，在CNN平臺(tái)上，這一FPGA的性能功耗比是C
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一種面向云架構(gòu)的高性能網(wǎng)絡(luò)接口實(shí)現(xiàn)技術(shù)

　　0概述　　在傳統(tǒng)的電信IT產(chǎn)品中，高性能網(wǎng)絡(luò)接口一般采用特殊的硬件模塊來(lái)實(shí)現(xiàn)，比如網(wǎng)絡(luò)處理器、ASIC、FPGA等等。這些特殊硬件模塊一般會(huì)采用特殊的架構(gòu)和指令集對(duì)網(wǎng)絡(luò)數(shù)據(jù)收發(fā)過(guò)程進(jìn)行優(yōu)化以達(dá)到更好的性能。然而，這也相應(yīng)使得開(kāi)發(fā)和維護(hù)這些模塊的成本非常的昂貴，同時(shí)還有一個(gè)無(wú)法解決的問(wèn)題是基于這些特殊硬件模塊實(shí)現(xiàn)的網(wǎng)絡(luò)接口不能移植到云中，因?yàn)樗鼈兏布鸟詈隙忍吡?。摩爾定律的出現(xiàn)，使得通用處理器的性能得到了極大的提升，這也為基于通用處理器實(shí)現(xiàn)高性能網(wǎng)絡(luò)接口提供了可能，同時(shí)也為移植到云中提供了前提條
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怎樣做一塊好的PCB板

　　大家都知道理做PCB板就是把設(shè)計(jì)好的原理圖變成一塊實(shí)實(shí)在在的PCB電路板，請(qǐng)別小看這一過(guò)程，有很多原理上行得通的東西在工程中卻難以實(shí)現(xiàn)，或是別人能實(shí)現(xiàn)的東西另一些人卻實(shí)現(xiàn)不了，因此說(shuō)做一塊PCB板不難，但要做好一塊PCB板卻不是一件容易的事情。　　微電子領(lǐng)域的兩大難點(diǎn)在于高頻信號(hào)和微弱信號(hào)的處理，在這方面PCB制作水平就顯得尤其重要，同樣的原理設(shè)計(jì)，同樣的元器件，不同的人制作出來(lái)的PCB就具有不同的結(jié)果，那么如何才能做出一塊好的PCB板呢?根據(jù)我們以往的經(jīng)驗(yàn)，想就以下幾方面談?wù)勛约旱目捶ǎ? 　　
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PCB的慘痛經(jīng)歷，值得工程師借鑒

　　PCB即印刷電路板，是電子電路的承載體。在現(xiàn)代電子產(chǎn)品中，幾乎都要使用PCB. PCB設(shè)計(jì)是電路設(shè)計(jì)的最后一個(gè)環(huán)節(jié)，也是對(duì)原理電路的再設(shè)計(jì)。一些新的工程師往往低估PCB設(shè)計(jì)的重要性，將這一即煩瑣又費(fèi)事的工作完全交由技術(shù)員去完成。在這里我先講一個(gè)關(guān)于PCB設(shè)計(jì)的故事，由于涉及企業(yè)的隱私，故此隱去了真實(shí)的地點(diǎn)和企業(yè)名稱。　　故事所涉及的企業(yè)是生產(chǎn)電話機(jī)的一家公司。普通按鍵式電話機(jī)，其實(shí)并不是什么高科技的產(chǎn)品，與早期的撥盤(pán)式電子電話機(jī)相比，它在電路中增加了一塊雙音頻/脈沖撥號(hào)控制集成電路，一些產(chǎn)品還增加
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Altera宣布通過(guò)與Mentor Graphics合作，推出業(yè)界領(lǐng)先的SoC FPGA系列產(chǎn)品虛擬原型

　　Altera公司今天宣布，與Mentor Graphics合作為嵌入式軟件開(kāi)發(fā)人員提供同類最佳的Vista®虛擬平臺(tái)，它支持Altera全系列SoC FPGA，包括具有64位四核ARM® Cortex-A53處理器的第三代14 nm Stratix® 10 SoC。這些先進(jìn)的SoC虛擬平臺(tái)加速了整個(gè)產(chǎn)品生命周期中嵌入式軟件的開(kāi)發(fā)，顯著縮短了產(chǎn)品面市時(shí)間，同時(shí)降低了成本。　　Mentor Graphics Vista SoC虛擬平臺(tái)是經(jīng)過(guò)預(yù)先開(kāi)發(fā)的全功能ARM處理器子系統(tǒng)仿真
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Altera發(fā)售20 nm SoC

　　Altera公司今天開(kāi)始發(fā)售其第二代SoC系列，進(jìn)一步鞏固了在SoC FPGA產(chǎn)品上的領(lǐng)先地位。Arria? 10 SoC是業(yè)界唯一在20 nm FPGA架構(gòu)上結(jié)合了ARM?處理器的可編程器件。與前一代SoC FPGA相比，Arria 10 SoC進(jìn)行了全面的改進(jìn)，支持實(shí)現(xiàn)性能更好、功耗更低、功能更豐富的嵌入式系統(tǒng)。Altera將在德國(guó)紐倫堡舉行的嵌入式世界2015大會(huì)上展示其基于SoC的解決方案，包括業(yè)界唯一的20 nm SoC FPGA。　　Altera的SoC產(chǎn)品市場(chǎng)資深總監(jiān)
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工程師分享：如何正確選擇電源模塊？

　　也許你常常會(huì)發(fā)現(xiàn)自己面臨相當(dāng)緊張的項(xiàng)目最后期限要求。舉例來(lái)說(shuō)，你的經(jīng)理剛給你布置了為一個(gè)新電信系統(tǒng)設(shè)計(jì)電源的任務(wù)。設(shè)計(jì)從在FPGA上實(shí)現(xiàn)的概念證明開(kāi)始，現(xiàn)在到了必須創(chuàng)造電源的時(shí)候。一個(gè)隔離式電源模塊提供12V電源，為先進(jìn)的ASIC、微控制器、FPGA和各種其他元件供電。一如既往，這些元件實(shí)際上充滿了電路板的空間，提供充分的電力、穩(wěn)定性、熱性能、低噪聲及可靠性需要挑戰(zhàn)物理定律。而你只有一個(gè)星期時(shí)間來(lái)創(chuàng)造這個(gè)電源。(嘆息)沒(méi)錯(cuò)，就是這樣，好戲開(kāi)場(chǎng)了! 　　由于ASIC、微控制器和FPGA的大電流要求，你
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FPGA在數(shù)字信號(hào)處理中的簡(jiǎn)單應(yīng)用

　　數(shù)字信號(hào)處理技術(shù)已經(jīng)成功運(yùn)用于信號(hào)地濾波、語(yǔ)音、圖像、音頻、信息系統(tǒng)、控制和儀表設(shè)備?？删幊虜?shù)字信號(hào)處理器在20 世紀(jì)70 年代地引入更是使DSP 技術(shù)突飛猛進(jìn)，取得巨大成功，這些PDSP 都是基于精簡(jiǎn)指令集(RISC)計(jì)算機(jī)范例的架構(gòu)。它的優(yōu)勢(shì)源于大多說(shuō)信號(hào)處理算法的乘-累加運(yùn)算(MAC)都是非常密集的。通過(guò)多級(jí)流水線架構(gòu)，PDSP 可以獲得僅受陣列乘法器的速度限制的MAC 速度。由此可以認(rèn)為FPGA 也能夠用來(lái)實(shí)現(xiàn)MAC 單元，且具有速度優(yōu)勢(shì)，但是，如果PDSP 能夠滿足所需要的MAC 速度，那么
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FPGA四大設(shè)計(jì)要點(diǎn)解析

　　本文敘述概括了FPGA應(yīng)用設(shè)計(jì)中的要點(diǎn)，包括，時(shí)鐘樹(shù)、FSM、latch、邏輯仿真四個(gè)部分。　　FPGA的用處比我們平時(shí)想象的用處更廣泛，原因在于其中集成的模塊種類更多，而不僅僅是原來(lái)的簡(jiǎn)單邏輯單元(LE)。　　早期的FPGA相對(duì)比較簡(jiǎn)單，所有的功能單元僅僅由管腳、內(nèi)部buffer、LE、RAM構(gòu)建而成，LE由LUT(查找表)和D觸發(fā)器構(gòu)成，RAM也往往容量非常小。　　現(xiàn)在的FPGA不僅包含以前的LE，RAM也更大更快更靈活，管教IOB也更加的復(fù)雜，支持的IO類型也更多，而且內(nèi)部還集成了一
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