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EEPW首頁 >> 主題列表 >> pam4 serdes

Avago于28nm CMOS工藝達成32Gbps的SerDes性能

  • Avago Technologies (Nasdaq: AVGO)為有線、無線和工業(yè)應(yīng)用模擬接口零組件領(lǐng)先供應(yīng)商宣布其28nm串行/解串器(SerDes)核心已經(jīng)達到32Gbps的性能，并且可以承受高達40dB的通道損耗，這個最新的SerDes核心不僅僅重新定義了芯片到芯片、連接端口和背板等接口可達到的數(shù)據(jù)率，并且反映了Avago為數(shù)據(jù)中心和企業(yè)應(yīng)用提供領(lǐng)先解決方案的持續(xù)承諾。
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優(yōu)化封裝以滿足SerDes應(yīng)用鍵合線封裝規(guī)范

  • 對于10Gbps及以上數(shù)據(jù)速率的SerDes，每個數(shù)據(jù)位的單位間隔是隨著近 20～30ps的信號上升/下降時間而縮短的。選擇合適的封裝互連結(jié)構(gòu)，有效地傳輸這些信號已成為最大限度減少信號完整性問題的重要考慮因素，如串擾、阻
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基于GMSL SerDes的雙汽車電子控制單元的應(yīng)用

  • Maxim的吉比特(千兆)多媒體串行鏈路(GMSL)方案可以對數(shù)字視頻和音頻數(shù)據(jù)進行串行轉(zhuǎn)換，然后通過一對雙絞線串行傳輸。另外，集成雙向控制通道可以使能單個微處理器(micro;C)對串行器、解串器和所有連接外設(shè)編程。在典
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LatticeECP4高速配置SERDES

  • LatticeECP4? FPGA系列結(jié)合了高性能FPGA結(jié)構(gòu)、高性能I/O和多達16個通道的嵌入式SERDES，帶有相關(guān)的物理編碼子層(PCS)邏輯。每個PCS邏輯通道包含專用的發(fā)送和接收電路，用于高速、全雙工的串行數(shù)據(jù)傳輸，傳輸速率高達
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GMSL SerDes在雙汽車電子控制單元(ECU)中的應(yīng)用

  • 摘要：Maxim的吉比特(千兆)多媒體串行鏈路(GMSL)方案可以對數(shù)字視頻和音頻數(shù)據(jù)進行串行轉(zhuǎn)換，然后通過一對雙絞線串行傳輸。另外，集成雙向控制通道可以使能單個微處理器(micro;C)對串行器、解串器和所有連接外設(shè)編程
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優(yōu)化遠程及遙測應(yīng)用的視頻SERDES電路

  • 優(yōu)化遠程及遙測應(yīng)用的視頻SERDES電路,為了滿足視頻系統(tǒng)、工業(yè)和醫(yī)療顯示和視頻傳送等應(yīng)用消除較長連接電纜限制、提高數(shù)據(jù)速率，以及需要雙向傳輸輔助數(shù)據(jù)的要求。Intersil公司推出了一款采用雙向I2C接口的SERDESIC ISL34340，有助于各種應(yīng)用實現(xiàn)遠程配置
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通過SerDes遠端I2C接口訪問16位I2C外設(shè)寄存器地址

  • 摘要：本應(yīng)用筆記介紹如何通過吉比特多媒體串行鏈路（GMSL） SerDes的遠端I2C接口訪問16位寄存器地址。引言Maxim吉比特多媒體串行鏈路（GMSL）串行器/解串器（SerDes）系列包括MAX9249、MAX9259、MAX9260、MAX9263和
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高性能SERDES及其在CPRI接口的應(yīng)用分析

  • 1引言
    隨著數(shù)據(jù)寬帶網(wǎng)絡(luò)的迅猛發(fā)展，需要不斷提高系統(tǒng)設(shè)備的業(yè)務(wù)容量。目前的趨勢是采用高速串行通信技術(shù)，即采用串行解串器SERDES，把低速的并行數(shù)據(jù)轉(zhuǎn)換為高速串行數(shù)據(jù)連接。SERDES串行接口可在背板或電纜/光纖等
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SERDES的數(shù)字系統(tǒng)中高效時鐘設(shè)計方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù)

  • 低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術(shù),由于現(xiàn)代數(shù)字信號處理器(dsp)設(shè)計、半導體工藝、并行處理和互連與傳輸技術(shù)的進步，現(xiàn)代高性能dsp的處理能力得到極大發(fā)展。但在移動通信、雷達信號處理和實時圖像處理等復雜電子系統(tǒng)中，單片dsp的性能仍可能無法滿足需
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第四代無線基礎(chǔ)架構(gòu)的離散式 SerDes 解決方案

  • 當網(wǎng)絡(luò)設(shè)備制造商建置4G的基礎(chǔ)架構(gòu)時，對于分布式基站架構(gòu)部署中無線電設(shè)備控制及無線電設(shè)備之間的高序列數(shù)據(jù)速率需求將大幅升高。要滿足如此需求，光纖纜線兩端的SerDeson必須發(fā)揮更高的效能。網(wǎng)絡(luò)設(shè)備制造商可將系統(tǒng)切割開來，便能使用同一個熟悉的FPGA平臺進行邏輯層處理。
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高性能FPGA中的高速SERDES接口

  • 引言　 串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是獨立的ASSP或ASIC器
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符合EMI/EMC標準的SerDes――基本測試策略和指南

  • 摘要：電磁干擾（EMI）和電磁兼容（EMC）測試是汽車應(yīng)用領(lǐng)域中串行器/解串器（SerDes）設(shè)計必須驗證的參數(shù)，需要在設(shè)計之初謹慎考慮EMI和EMC問題，避免不必要的設(shè)計修改。以下應(yīng)用筆記詳細介紹了如何在SerDes系統(tǒng)
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基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計

  • 基于SERDES收發(fā)器和CPRI的電信系統(tǒng)低延遲變化設(shè)計,　　本文討論利用帶嵌入式SERDES收發(fā)器和CPRI鏈路IP內(nèi)核的低成本FPGA，來實現(xiàn)電信系統(tǒng)低延遲變化設(shè)計的考慮因素?！　o線電信設(shè)備制造商正受到以更小體積、更低功耗、更低制造成本來布署基站架構(gòu)的壓力。當通過WiMa
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TI推出分立式雙通道串行器／解串器

  • 　　日前，德州儀器 (TI) 宣布推出業(yè)界首款 6 千兆位每秒 (Gbps) 的雙通道串行器-解串器 IC (SerDes)，其可為無線應(yīng)用提供 高達470 兆位每秒 (Mbps) 至6.25 Gbps 的連續(xù)數(shù)據(jù)速率。該 TLK6002 支持從原有速度到最新更快速度的升級，符合所有無線基站設(shè)計所需的 OBSAI 與 CPRI 標準要求。TLK6002 可用于各種無線基礎(chǔ)設(shè)施應(yīng)用，其中包括 WiMAX、TD-SCDMA、WCDMA 以及 CDMA2000 等。 　　最新 SerDes 使用統(tǒng)一 12
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