基于FPGA+DSP技術(shù)的Bayer格式圖像預(yù)處理
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3 圖像預(yù)處理系統(tǒng)的硬件工作過(guò)程
圖像預(yù)處理系統(tǒng)硬件框圖如圖3所示，整個(gè)系統(tǒng)在通電后，先由TMS320DM642通過(guò)I2C向500萬(wàn)像素的CMOS攝像頭發(fā)出控制命令，調(diào)整攝像頭輸出的圖像分辨率、焦距等，之后由攝像頭將采集到的圖像數(shù)據(jù)發(fā)送至FPGA。由于攝像頭輸出的圖像格式為12位的Bayer圖像，而DSP的vp-ort口支持為8位或者16位的RAW采集方式，本項(xiàng)目中采用了更適合于DSP處理的8位數(shù)據(jù)，所以需要FPGA對(duì)采集的圖像數(shù)據(jù)取高8位以方便DSP獲取圖像數(shù)據(jù)。FPGA在Frame_Valid和Line_Valid同時(shí)為高電平的時(shí)，在Pixclk的上升沿采樣圖像數(shù)據(jù)，并將原來(lái)的12位圖像數(shù)據(jù)取其高8位轉(zhuǎn)換成8位Bayer圖像數(shù)據(jù)，然后利用FPGA內(nèi)部的FD-FIFO模型結(jié)構(gòu)取圖像的3x3矩陣并利用雙線性插值算法將Bayer圖像轉(zhuǎn)換成24位的RGB圖像格式。除此之外，F(xiàn)PGA還將Bayer圖像數(shù)據(jù)轉(zhuǎn)換成了Y亮度信號(hào)以達(dá)到DSP對(duì)運(yùn)算數(shù)據(jù)的要求，使得DSP只工作在核心算法上。本文引用地址：http://butianyuan.cn/article/191433.htm
轉(zhuǎn)換好的亮度圖像數(shù)據(jù)由FPGA通過(guò)TMS320DM642的VPort1口發(fā)送至DSP進(jìn)行核心算法處理。為了更好地達(dá)到整個(gè)DSP算法處理的實(shí)時(shí)性，DSP采用了BIOS實(shí)時(shí)操作系統(tǒng)。經(jīng)算法處理好的圖像數(shù)據(jù)由TMS320DM642通過(guò)其VPortO口發(fā)送至FPGA。圖像預(yù)處理過(guò)程是在Spartan-3系列的XC3S1500x中進(jìn)行的。FPGA使用的設(shè)計(jì)方法是HDL設(shè)計(jì)輸入法，常用的HDL語(yǔ)言有VHDL和VerilogDHL語(yǔ)言，在本系統(tǒng)中使用VHDL語(yǔ)言進(jìn)行硬件設(shè)計(jì)。
系統(tǒng)采用的是通過(guò)FPGA固件支持高傳輸率USB2．0的CY7C68013芯片，采用Slave_FIFO模式接收FPGA輸出的圖像數(shù)據(jù)，再通過(guò)USB口輸送給上位機(jī)。如圖4所示，圖4(a)為RAW圖像，即每個(gè)像素點(diǎn)只含有單一顏色分量的Bayer格式圖像，圖4(b)為系統(tǒng)處理后的RGB格式的亮度信號(hào)圖像。
4 結(jié)論
可見(jiàn)，本文所提出的基于FPGA+DSP的圖像處理系統(tǒng)，能在FPGA硬件設(shè)備中高速、高質(zhì)量地對(duì)CMOS傳感器采集的Bayer圖像進(jìn)行預(yù)處理，為DSP數(shù)字信號(hào)處理器進(jìn)行核心算法減少運(yùn)算量，提高整個(gè)圖像處理的實(shí)時(shí)性，縮短了開(kāi)發(fā)周期，并且這種FPGA+DSP的組合模式也可以推廣到處理各種數(shù)字視頻信號(hào)。
評(píng)論